將VHDL設計轉換成Verilog設計的程式
標簽： Verilog VHDL 程式
上傳時間： 2016-01-18
上傳用戶：wkchong
JPEG的硬體設計採用的是VHDL設計,有源碼
標簽： JPEG VHDL 有源
上傳用戶：agent
使用FPGA設計WiMax接收機之OFDM同步硬體電路(內附VHDL code)
標簽： WiMax FPGA OFDM VHDL
上傳時間： 2016-01-22
上傳用戶：zhuyibin
一個簡單的游戲設計...好好玩的
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上傳時間： 2013-12-31
上傳用戶：edisonfather
這是一個利用模擬退火來計算TSP旅行家的問題
標簽： TSP 模 旅行 家
上傳時間： 2016-01-28
上傳用戶：chenxichenyue
這是利用基因演算法來計算皇后問題的小程式 絕對是狠快速的方法
標簽： 基因 算法 程式 速的方法
上傳用戶：英雄
這是一個可以計算學期成績的視窗程式 是利用讀入純文字檔案 來計算學期成績和平均
標簽： 程式
上傳用戶：天涯
倒數計時器 提供時間到關機的功能 可自由設定是否關機或者提供警示
上傳時間： 2016-02-02
上傳用戶：lepoke
一套多文件摘要的計算方法，給予每一個新聞群組簡短的摘要，使新聞讀者可以藉由這些簡短的摘要，大略瞭解新聞群組的內容及所要傳達的消息。
上傳時間： 2016-02-17
上傳用戶：jqy_china
一階Markov 實做 將文件讀進來並計算出 entroy
標簽： Markov entroy
上傳時間： 2013-11-29
上傳用戶：yuzsu
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