PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為: 為確保產(chǎn)品之製造性, R&D在設(shè)計(jì)階段必須遵循Layout相關(guān)規(guī)範(fàn), 以利製造單位能順利生產(chǎn), 確保產(chǎn)品良率, 降低因設(shè)計(jì)而重工之浪費(fèi).
標(biāo)簽： Layout 1.70 Rule PCB
上傳時(shí)間： 2015-05-23
上傳用戶：it男一枚
完整的I2C slave model以及spec詳附在內(nèi),適合想利用verilog開發(fā)此類傳輸?shù)娜藚⒖?/p>
標(biāo)簽： verilog slave model spec
上傳時(shí)間： 2015-06-10
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shen ying kong zhi,zhe shi lang ya de chu li
標(biāo)簽： shen kong lang ying
上傳時(shí)間： 2013-11-29
上傳用戶：ecooo
embedded visual C++和基本的OpenGLES設(shè)定環(huán)境程式
標(biāo)簽： embedded OpenGLES visual 程式
上傳時(shí)間： 2014-01-16
上傳用戶：wanqunsheng
shoujie ri li baincheng jaca xiao cheng cu
標(biāo)簽： baincheng shoujie cheng jaca
上傳時(shí)間： 2015-06-23
上傳用戶：13215175592
DelphiPackage實(shí)用集錦 動(dòng)態(tài)數(shù)據(jù)模組 設(shè)計(jì)模式重整技術(shù)運(yùn)用實(shí)例 以DelphiPackage架構(gòu)多人開發(fā)應(yīng)用程式環(huán)境
標(biāo)簽： DelphiPackage 集錦 動(dòng)態(tài)數(shù)據(jù) 模組
上傳時(shí)間： 2014-11-22
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一般認(rèn)為Windows CE是一個(gè)適合嵌入式應(yīng)用的通用作業(yè)系統(tǒng)，然而，從系統(tǒng)的角度來看，Windows CE並不只是一個(gè)作業(yè)系統(tǒng)，它還包括對(duì)多種目標(biāo)處理器以及週邊設(shè)備的支援，並提供了系統(tǒng)開發(fā)工具、應(yīng)用開發(fā)工具、整合的應(yīng)用程式
標(biāo)簽： Windows 嵌入式 系統(tǒng)
上傳時(shí)間： 2015-07-01
上傳用戶：asasasas
Flash8程式設(shè)計(jì)電子書, 讓你輕輕鬆鬆的進(jìn)入flash8的程式設(shè)計(jì)世界,
標(biāo)簽： Flash8 flash8 程式
上傳時(shí)間： 2014-01-25
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IDARP 分類演算法..(使用Matlab開發(fā))
標(biāo)簽： Matlab IDARP 分 算法
上傳時(shí)間： 2015-07-06
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<Java手機(jī)程式設(shè)計(jì)入門>詳細(xì)介紹j2me手機(jī)程序設(shè)計(jì)以及相關(guān)其他開發(fā)設(shè)計(jì)模式
標(biāo)簽： Java j2me lt gt
上傳時(shí)間： 2015-07-21
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