這是一個修改Oreilly Java 網(wǎng)路程式設(shè)計(jì)範(fàn)例的程式 主要是將裡面的一個小程式加上視窗管理者介面方便使用 使用環(huán)境： 需有JRE的環(huán)境 path需有指到JAVA_HOME下bin/ 如環(huán)境設(shè)定OK，在windows直接點(diǎn)選執(zhí)行即可 如在其他OS(unix-like) java -jar nsLookUp.jar
標(biāo)簽： JAVA_HOME Oreilly Java path
上傳時(shí)間： 2014-01-15
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最新程序最好的在線程序設(shè)計(jì) 建議同學(xué)們好好看看。最好的
標(biāo)簽： 程序
上傳時(shí)間： 2016-03-10
上傳用戶：zhuoying119
由遠(yuǎn)峰公司所設(shè)計(jì)的燒入flash軟體,歡迎使用2410/2440可用
標(biāo)簽： flash 2410 2440
上傳時(shí)間： 2014-01-10
上傳用戶：dyctj
先對故障依序編碼為陣列形式在用免疫演算法去做計(jì)算模擬得到正確的解答
標(biāo)簽： 免疫 算法 模 正
上傳時(shí)間： 2013-12-21
上傳用戶：R50974
UML 2 for Dummies ( UML 理想設(shè)計(jì)方案 )
標(biāo)簽： UML Dummies for 方案
上傳時(shí)間： 2014-01-17
上傳用戶：ommshaggar
TFT設(shè)計(jì)原理應(yīng)用設(shè)計(jì)
標(biāo)簽： TFT
上傳時(shí)間： 2014-01-13
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圖形話介面顯示設(shè)計(jì), 主要透過Embedded Visual C
標(biāo)簽： Embedded Visual
上傳時(shí)間： 2016-04-25
上傳用戶：weiwolkt
使用硬體描述語言HDL 設(shè)計(jì)硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設(shè)計(jì)入門學(xué)習(xí)。VHDL基本語法架構(gòu)，VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽： HDL
上傳時(shí)間： 2014-01-22
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clock_spliter 採用彈性設(shè)計(jì) , 可調(diào)整週期寬度.
標(biāo)簽： clock_spliter
上傳時(shí)間： 2013-12-27
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FPGA可促進(jìn)嵌入式系統(tǒng)設(shè)計(jì)改善即時(shí)應(yīng)用性能，臺灣人寫的，關(guān)于FPGA應(yīng)用的技術(shù)文章
標(biāo)簽： FPGA 嵌入式 系統(tǒng) 性能
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