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誤差函數

  • C語言庫函數使用大全.rar

    這是關于C語言函數庫大全的手冊,大家可以在忘記函數的情況下查閱該手冊,相信一定很實用~~

    標簽: C語言 庫函數

    上傳時間: 2013-07-14

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  • 時序電路邏輯設計與特殊組合函數-266頁-6.7M.pdf

    專輯類-實用電子技術專輯-385冊-3.609G 時序電路邏輯設計與特殊組合函數-266頁-6.7M.pdf

    標簽: 266 6.7 時序電路

    上傳時間: 2013-06-14

    上傳用戶:adamszq

  • 交流電能電功率測量綜合誤差的測試計算及改進技術-698頁-8.9M.pdf

    專輯類-測試技術專輯-134冊-1.93G 交流電能電功率測量綜合誤差的測試計算及改進技術-698頁-8.9M.pdf

    標簽: 698 8.9 交流

    上傳時間: 2013-06-20

    上傳用戶:wangxuan

  • 用C51編寫單片機延時函數.rar

    用C51編寫單片機延時函數 ,測試和計算了一些已有的延時函數。

    標簽: C51 編寫 單片機

    上傳時間: 2013-07-02

    上傳用戶:西伯利亞狼

  • 基于ANN的無刷直流電機無位置傳感器控制及轉矩波動研究.rar

    該文研究了無刷直流電機的無位置傳感器控制理論、轉矩波動抑制方法、數字仿真算法和DSP控制技術.首先,該文介紹了無刷直流電機無位置傳感器控制原理,比較了目前幾種常用的無位置傳感器控制方法,提出了基于徑向基函數(RBF)神經網絡的無位置傳感器控制方法.通過離散化位置信號的映射方程,得到網絡的基本輸入輸出,網絡的輸出通過邏輯處理,處理后的結果作為電機控制信號,同時也作為網絡的訓練教師.采用在線學習和離線學習兩種方式訓練網絡,并詳細介紹了兩種方式的算法;其次,該文概述了無刷直流電機轉矩波動的產生原因,重點分析了換相轉矩波動產生的原理,提出了基于誤差反傳(BP)神經網絡的轉矩波動抑制新方法.采用兩個結構相同三層網絡,建立了電壓自校正調節器,對電機端電壓進行瞬時調節,保持電路中電流幅值不變,實現了轉矩波動的自適應調節.另外,該文推導了較全面的電機數學模型,重點研究了無刷直流電機仿真中的幾個關鍵技術,包括氣隙磁場的建立、位置信號的模擬、中心點電壓的計算、二極管續流狀態的實現以及PWM電流控制的仿真.采用面向對象程序設計(OOP)方法,設計了多功能的仿真軟件SIMOT.最后該文介紹了數字信號處理器(DSP)TMS320LF2407的結構和性能,給出了PWM控制和A/D轉換的算法,采用反電勢法原理實現了無位置傳感器控制,并給出了相關的實驗結果.

    標簽: ANN 無刷直流電機 無位置傳感器

    上傳時間: 2013-07-14

    上傳用戶:klds

  • PWM逆變器中滯環電流控制策略的研究.rar

    由于目前尚未有文獻對以上三類控制器進行詳細的研究比較,因此該文利用MATLAB中Simulink的模塊函數建立了以上三類滯環電流控制器的仿真模型,對以上三類控制器進行詳細的仿真研究,探討其各方面性能的優劣. 通過對基于空間矢量調制的三相滯環電流控制器(SVMHCC)的仿真研究表明,當其外滯環寬度太小時,三相電流容易產生畸變,三相總開關次數反而較小;當其外滯環寬度太大時,三相電流能夠得到有效控制,但是最大電流誤差和三相總開關次數增加,因此選擇外滯環寬度時需要綜合考慮控制器的控制性能、最大電流誤差和三相總開關次數等因素.但是由于需要考慮的因素大多而且它們相互制約,因此如何選擇合適的外滯環寬度就成為SVMHCC中難以解決的問題. 在仿真研究的基礎上,該文提出了改進方案.仿真和實驗結果均表明,改進的滯環電流控制器綜合了以上幾種控制器的優點,具有三相總開關次數低、開關頻率變化規則、三相控制對稱和能有效控制三相最大電流誤差等優點.

    標簽: PWM 逆變器 環電

    上傳時間: 2013-06-07

    上傳用戶:小碼農lz

  • 能量回收系統中超級電容電壓檢測與分析.rar

    近年來,隨著工農業的迅速發展,世界能源消耗速度急劇增加。因此,新能源和節能技術的開發已經成為世界各國科技工作者的當務之急。而機車制動能量回收系統是目前國內外節能技術方面研究的熱點之一。 超級電容作為一種新型電荷儲能元件,具有大容量、大電流快速充放電、壽命長和無污染等特性。這些獨特的優點使其在儲能和能量回收方面有著廣闊的應用前景。但是由于超級電容單體電壓的差異,如不對其進行實時檢測,在使用過程中將對整個組件的性能造成極大的影響。另外對超級電容內部特性的不了解也會對其使用造成障礙。 對超級電容電壓檢測方案的研究和對超級電容時域模型的研究,將為超級電容的電壓均衡方案和超級電容的電參數分析提供支持,從而為整個能量回收系統的控制策略提供理論依據。因此以上兩方面的研究將是整篇論文的核心內容。 本文采用模塊化的設計理念,提出了一種兼顧均壓的新型電壓檢測方案。在軟件設計方面,對電壓檢測系統的軟件架構進行分析,利用LabVIEW和ZLGCAN驅動函數包設計了友好的上位機軟件監控界面。本文利用誤差理論相關知識,對超級電容電壓檢測電路的誤差精度進行了詳細分析。 本文對兩種超級電容時域模型進行建模和參數推導,并通過試驗驗證了所建模型的正確性。

    標簽: 能量 回收

    上傳時間: 2013-05-16

    上傳用戶:浮塵6666

  • 基于LabVIEW和SOPC的智能型函數發生器的研究與設計.rar

    函數發生器又名任意波形發生器,是一種常用的信號源,廣泛應用于通信、雷達、導航等現代電子技術領域。信號發生器的核心技術是頻率合成技術,主要方法有:直接模擬頻率合成、鎖相環頻率合成(PLL)、直接數字合成技術(DDS)。DDS是開環系統,無反饋環節,輸出響應速度快,頻率穩定度高。因此直接數字頻率合成技術是目前頻率合成的主要技術之一,其輸出信號具有相對較大的帶寬、快速的相位捷變、極高的相位分辨率和相位連續等優點。本文的主要工作是采用SOPC結合虛擬儀器技術,進行DDS智能函數發生器的研制。 本文介紹了虛擬儀器技術的基本理論,簡要闡述了儀器驅動程序、VISA等相關技術。對SOPC技術進行了深入的研究:SOPC技術是基于可編程邏輯器件的可重構片上系統,它作為SOC和CPLD/FPGA相結合的一項綜合技術,結合了兩者的優點,集成了硬核或軟核CPU、DSP、鎖相環、存儲器、I/O接口及可編程邏輯,可以靈活高效地解決SOC方案,而且設計周期短,設計成本低,非常適合本設計的應用。本文還對基于DDS原理的設計方案進行了分析,介紹了DDS的基本理論以及數學綜合,在研究DDS原理的基礎上,利用SOPC技術,在一片FPGA芯片上實現了整個函數發生器的硬件集成。 本文就函數發生器的設計制定了整體方案,對軟硬件設計原理及實現方法進行了具體的介紹,包括整個系統的硬件電路,SOPC片上系統和PC端軟件的設計。在設計中,LabVIEW波形編輯軟件和函數發生器二者采用異步串口進行通信。利用LabVIEW的強大功能,把波形的編輯,系統的設置放到計算機上完 成,具有人機界面友好、系統升級方便、節約硬件成本等諸多優勢。同時充分利用了FPGA內部大量的邏輯資源,將DDS模塊和微處理器模塊集成到一個單片FPGA上,改變了傳統的系統設計思路。通過對系統仿真和實際測試,結果表明該智能型函數發生器不僅能產生理想的輸出信號,還具有集成度高、穩定性好和擴展性強等優點。關鍵詞:智能型函數發生器,虛擬儀器,可編程片上系統,直接數字合成技術,NiosⅡ處理器。

    標簽: LabVIEW SOPC 智能型

    上傳時間: 2013-07-09

    上傳用戶:zw380105939

  • 實時視頻縮放算法研究及FPGA實現.rar

    調整視頻圖像的分辨率需要視頻縮放技術。如果圖像縮放技術的處理速度達到實時性要求就可以應用于視頻縮放。 傳統圖像縮放技術利用插值核函數對已有像素點進行插值重建還原圖像。本文介紹了圖像插值的理論基礎一采樣定理,并對理想重建函數Sinc函數進行了討論。本文介紹了常用的線性圖像插值技術及像素填充、自適應插值和小波域圖像縮放等技術。然后,本文討論了分級線性插值算法的思想,設計并實現了FPGA上的分級雙三次算法。最后本文對各種算法的縮放效果進行了分析和討論。 本文在分析現有視頻縮放算法基礎之上,提出了分級線性插值算法,并應用在簡化線性插值算法中。分級線性插值算法以犧牲一定的計算精度為代價,用查找表代替乘法計算,降低了算法復雜度。本文設計并實現了分級雙三次插值算法,詳細說明了板上系統的模塊結構。最后本文將分級線性插值算法與原線性插值算法效果圖進行比較,比較結果顯示分級插值算法與原算法誤差較小,在放大比例較小時可以取代原算法。結果證明分級雙三次線性插值算法的FPGA實現能夠滿足額定幀頻,可以進行實時視頻縮放。

    標簽: FPGA 實時視頻 算法研究

    上傳時間: 2013-04-24

    上傳用戶:亞亞娟娟123

  • 基于FPGA的高速FIR數字濾波器設計.rar

    本論文設計了一種基于FPGA的高速FIR數字濾波器,濾波器實現低通濾波,截止頻率為1MHz,通帶波紋小于1 dB,阻帶最大衰減為-40 dB,輸入輸出數據為8位二進制,采樣頻率為10MHz。 論文首先簡要介紹了數字濾波器的基本原理和線性FIR數字濾波器的性質、結構,根據濾波器的性能要求選擇窗函數、確定系數,在算法上為了滿足數字濾波器的要求,對系數放大512倍并取整,并用Matlab對數字濾波器原理進行了證明。同時簡述了EDA技術和FPGA設計流程。 其次,論文說明了FIR數字濾波器模塊的劃分,并用Verilog語言在Modelsim環境下進行了功能測試。對于數字濾波器系數中的-1,-2,4這些簡單的系數乘法直接進行移位和取反,可以極大的節省資源和優化設計。而對普通系數乘法采用4-BANT(4bits-at-a-time)的并行算法,用加法累加快速實現了乘積的運算;另外,在本設計進行部分積累加時,采用舍取冗余位,主要是根據設計時已對系數進行了放大,而輸出時又要將結果相應的縮小,所以在累加時,提前對部分積縮小,從而減少了運算量,從時間和資源上都得到了優化。 論文的最后分別用Modelsim和Quartus II進行了FIR數字濾波器的前仿真和后仿真,將仿真的結果和Matlab中原理驗證時得到的理想值進行了比較,并對所產生的誤差進行了分析。仿真結果表明:本16階FIR數字濾波器設計能夠實現截止頻率為1MHz的低通濾波,并且工作頻率可達150MHz以上。

    標簽: FPGA FIR 數字

    上傳時間: 2013-05-24

    上傳用戶:qiaoyue

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