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軟件實(shí)現(xiàn)

  • PCB阻抗匹配計(jì)算工具(附教程)

    附件是一款PCB阻抗匹配計(jì)算工具,點(diǎn)擊CITS25.exe直接打開使用,無需安裝。附件還帶有PCB連板的一些計(jì)算方法,連板的排法和PCB聯(lián)板的設(shè)計(jì)驗(yàn)驗(yàn)。 PCB設(shè)計(jì)的經(jīng)驗(yàn)建議:       1.一般連板長寬比率為1:1~2.5:1,同時(shí)注意For FuJi Machine:a.最大進(jìn)板尺寸為:450*350mm,       2.針對有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位.     3.連板方向以同一方向?yàn)閮?yōu)先,考量對稱防呆,特殊情況另作處理.     4.連板掏空長度超過板長度的1/2時(shí),需加補(bǔ)強(qiáng)邊.       5.陰陽板的設(shè)計(jì)需作特殊考量.       6.工藝邊需根據(jù)實(shí)際需要作設(shè)計(jì)調(diào)整,軌道邊一般不少於6mm,實(shí)際中需考量板邊零件的排布,軌道設(shè)備正常卡壓距離為不少於3mm,及符合實(shí)際要求下的連板經(jīng)濟(jì)性.       7.FIDUCIAL MARK或稱光學(xué)定位點(diǎn),一般設(shè)計(jì)在對角處,為2個(gè)或4個(gè),同時(shí)MARK點(diǎn)面需平整,無氧化,脫落現(xiàn)象;定位孔設(shè)計(jì)在板邊,為對稱設(shè)計(jì),一般為4個(gè),直徑為3mm,公差為±0.01inch.       8.V-cut深度需根據(jù)連板大小及基板板厚考量,角度建議為不少於45°.       9.連板設(shè)計(jì)的同時(shí),需基於基板的分板方式考量<人工(治具)還是使用分板設(shè)備>.  10.使用針孔(郵票孔)聯(lián)接:需請考慮斷裂后的毛刺,及是否影響COB工序的Bonding機(jī)上的夾具穩(wěn)定工作,還應(yīng)考慮是否有無影響插件過軌道,及是否影響裝配組裝. 

    標(biāo)簽: PCB 阻抗匹配 計(jì)算工具 教程

    上傳時(shí)間: 2013-10-15

    上傳用戶:3294322651

  • STC-ISP下載編程燒錄軟件控件注冊工具

    STC-ISP下載編程燒錄軟件控件注冊工具。

    標(biāo)簽: STC-ISP 編程 燒錄軟件

    上傳時(shí)間: 2013-11-11

    上傳用戶:hakim

  • ZigBee開發(fā)套件內(nèi)容

    ZigBee開發(fā)套件內(nèi)容開發(fā)套件

    標(biāo)簽: ZigBee 開發(fā)套件

    上傳時(shí)間: 2013-11-04

    上傳用戶:jinyao

  • SF-CY3 FPGA套件開發(fā)指南Ver6.00 (by特權(quán)同學(xué))

    SF-CY3 FPGA套件開發(fā)指南Ver6.00 (by特權(quán)同學(xué))

    標(biāo)簽: SF-CY FPGA 6.00 Ver

    上傳時(shí)間: 2014-01-25

    上傳用戶:ewtrwrtwe

  • EDA技術(shù)實(shí)用教程VHDL版本課件

    EDA技術(shù)實(shí)用教程VHDL版本課件

    標(biāo)簽: VHDL EDA 實(shí)用教程 版本

    上傳時(shí)間: 2013-10-10

    上傳用戶:ruan2570406

  • 夏宇聞老師優(yōu)秀的verilog教程課件

          本資料是關(guān)于夏宇聞老師優(yōu)秀的verilog教程課件,其中包括verilog講稿PPT、verilog課件、verilog例題等。

    標(biāo)簽: verilog 教程

    上傳時(shí)間: 2013-11-21

    上傳用戶:電子世界

  • 《EDA原理及應(yīng)用》(何賓教授)實(shí)驗(yàn)課件

          本資料是《EDA原理及應(yīng)用》一書的配套實(shí)驗(yàn)課件,一共有18個(gè)實(shí)驗(yàn)。大家可以參考著自己做!當(dāng)然做完后也可以到電子發(fā)燒友網(wǎng)站FPGA技術(shù)聯(lián)盟QQ群(263281510)討論討論...

    標(biāo)簽: EDA 實(shí)驗(yàn)

    上傳時(shí)間: 2013-11-10

    上傳用戶:rlgl123

  • 《EDA原理及應(yīng)用》(何賓教授)課件 PPT

      第1章-EDA設(shè)計(jì)導(dǎo)論   第2章-可編程邏輯器件設(shè)計(jì)方法   第3章-VHDL語言基礎(chǔ)   第4章-數(shù)字邏輯單元設(shè)計(jì)   第5章-VHDL高級設(shè)計(jì)技術(shù)   第6章-基于HDL和原理圖的設(shè)計(jì)輸入   第7章-設(shè)計(jì)綜合和行為仿真   第8章-設(shè)計(jì)實(shí)現(xiàn)和時(shí)序仿真   第9章-設(shè)計(jì)下載和調(diào)試   第10章-設(shè)計(jì)示例(數(shù)字鐘、UART、數(shù)字電壓表)     點(diǎn)擊鏈接,【《EDA原理及應(yīng)用》(何賓教授)實(shí)驗(yàn)課件下載 】

    標(biāo)簽: EDA

    上傳時(shí)間: 2013-11-10

    上傳用戶:zhangliming420

  • cpld開發(fā)套件光盤說明

    cpld開發(fā)套件光盤說明

    標(biāo)簽: cpld 開發(fā)套件 光盤

    上傳時(shí)間: 2013-10-24

    上傳用戶:hfmm633

  • FPGA電子課件_共8課

    學(xué)習(xí)FPGA的課件,內(nèi)容含有軟件的介紹,Altera和Xilinx芯片的介紹,以及VHDL的編程風(fēng)格。和一些實(shí)例講解。

    標(biāo)簽: FPGA 電子課件

    上傳時(shí)間: 2013-11-10

    上傳用戶:胡岸888

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