fpga實(shí)現(xiàn)ＣＡＮ總線控制器源碼,每個項(xiàng)目都有說明文件，介紹使用方法。
標(biāo)簽： fpga CAN 總線控制器 源碼
上傳時間： 2013-08-31
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cpld與單片機(jī)8051的通信的設(shè)計(jì)方法 以及cpld和單片機(jī)的端口對應(yīng)
標(biāo)簽： cpld 8051 單片機(jī) 通信
上傳時間： 2013-09-01
上傳用戶：wettetw
單片機(jī)與cpld總線方式通信，通過單片機(jī)io口模擬總線
標(biāo)簽： cpld 單片機(jī) 總線 方式
上傳用戶：epson850
用cpld開發(fā)的激光控制器的源碼，已經(jīng)是成型產(chǎn)品，希望對大家有用
標(biāo)簽： cpld 激光控制器 源碼
上傳時間： 2013-09-02
上傳用戶：dxxx
并口epp模式下與fpga通信例子，附源碼
標(biāo)簽： fpga epp 并口 模式
上傳時間： 2013-09-03
上傳用戶：caiqinlin
結(jié)合XILINXCPLD所做的模擬RS232通信verilog源程序
標(biāo)簽： XILINXCPLD verilog 232 RS
上傳用戶：gps6888
用VHDL語言在CPLD上實(shí)現(xiàn)串行通信
標(biāo)簽： VHDL CPLD 語言 串行通信
上傳時間： 2013-09-06
上傳用戶：q3290766
程序主要用硬件描述語言（VHDL）實(shí)現(xiàn)：\r\n單片機(jī)與FPGA接口通信的問題
標(biāo)簽： VHDL FPGA 單片機(jī) 接口通信
上傳用戶：ddddddos
1、 利用FLEX10的片內(nèi)RAM資源，根據(jù)DDS原理，設(shè)計(jì)產(chǎn)生正弦信號的各功能模塊和頂層原理圖； 2、 利用實(shí)驗(yàn)板上的TLC7259轉(zhuǎn)換器，將1中得到的正弦信號，通過D/A轉(zhuǎn)換，通過ME5534濾波后在示波器上觀察； 3、 輸出波形要求： 在輸入時鐘頻率為16KHz時，輸出正弦波分辨率達(dá)到1Hz； 在輸入時鐘頻率為4MHz時，輸出正弦波分辨率達(dá)到256Hz； 4、 通過RS232C通信，實(shí)現(xiàn)FPGA和PC機(jī)之間串行通信，從而實(shí)現(xiàn)用PC機(jī)改變頻率控制字，實(shí)現(xiàn)對輸出正弦波頻率的控制。
標(biāo)簽： FPGA PC機(jī) 串行通信 輸出
上傳用戶：zhuimenghuadie
筆者以Freescale的S08系列8位微處理器MC9S08SL8為核心，為某電動汽車設(shè)計(jì)了一款儀表盤信號轉(zhuǎn)換器，實(shí)現(xiàn)了電機(jī)轉(zhuǎn)速檢測、與電機(jī)控制器的LIN通信、原車儀表信號模擬等功能。利用芯片內(nèi)部資源特性設(shè)計(jì)了其硬件結(jié)構(gòu)及電路，根據(jù)儀表盤的原理和工作方式設(shè)計(jì)了軟件流程，裝車試驗(yàn)運(yùn)行穩(wěn)定，有很高的實(shí)用價值。
標(biāo)簽： MC9 S08 SL8 MC
上傳時間： 2013-11-23
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