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通信研究

  • WCDMA下行鏈路同步的研究和FPGA實現(xiàn).rar

    同步技術(shù)在許多通訊系統(tǒng)中都是至關(guān)重要的,而WCDMA作為第三代移動通信的標準之一,對其同步算法進行研究是非常必要的。FPGA在許多硬件實現(xiàn)中充當了很重要的角色,所以研究如何在FPGA上實現(xiàn)同步算法是非常具有實際意義的。 本文討論了三步小區(qū)搜索的算法,仿真了其性能,并且對如何進行算法的FPGA移植展開了深入的討論。 本文對三步小區(qū)搜索的算法按照算法計算量和運算速度的標準分別進行了比較和討論,并以節(jié)省資源和運行穩(wěn)定為前提進行了FPGA移植。最終在主同步中提出了改進型的PSC匹配濾波器算法,在FPGA上提出了采用指針型雙口RAM的實現(xiàn)方式;在輔同步中提出了改進型PFHT算法并采用查表遍歷算法判決,在FPGA上提出了用綜合型邏輯方式來實現(xiàn);在導頻同步中采用了移位寄存器式擾碼生成算法,并引入了計分制判決算法。 與以往的WCDMA同步的FPGA實現(xiàn)相比,本文提出的實現(xiàn)方案巧妙地利用了FPGA的并行運算結(jié)構(gòu),在XILINX的V4芯片上只用了500個slice就完成了整個小區(qū)搜索,最大限度地節(jié)省了資源,為小區(qū)搜索在FPGA中的模塊小型化提供了途徑。

    標簽: WCDMA FPGA 下行鏈路

    上傳時間: 2013-08-05

    上傳用戶:leileiq

  • G729A語音編解碼算法研究及FPGA實現(xiàn).rar

    語音編碼技術(shù)始終是語音研究的熱點。語音編碼作為多媒體通信中信息傳輸?shù)囊粋€重要環(huán)節(jié),越來越受到廣泛的重視。G729是由美國、法國、日本和加拿大的幾家著名國際電信實體聯(lián)合開發(fā)的,國際電信聯(lián)盟(ITU-T)于1995年11月正式通過了G729。96年ITU-T又制定了G729的簡化方案G729A,主要降低了計算的復雜度以便于實時實現(xiàn)。因其具有良好的合成語音質(zhì)量、適中的復雜度、較低的時延等優(yōu)點,G729A標準已被廣泛應用在VOIP網(wǎng)關(guān)、IP電話中。 論文利用Altera公司的新一代可編程邏輯器件在數(shù)字信號處理領(lǐng)域的優(yōu)勢,對G729A語音編碼中的線性預測(LP)濾波器系數(shù)提取的FPGA(現(xiàn)場可編程門陣列,F(xiàn)ield Programmable Gate Array)實現(xiàn)進行了深入研究。論文首先對語音信號處理及其發(fā)展進行介紹,深入討論了G729A語音編解碼技術(shù)。第二,對Altera公司的Stratix系列可編程器件的內(nèi)部結(jié)構(gòu)進行了研究,分析了在QuartusII開發(fā)平臺上進行FPGA設計的流程。第三,基于FPGA,對G729A編碼系統(tǒng)的LP分析部分做了具體設計,其中包括自相關(guān)函數(shù)和杜賓(Durbin)遞推兩個主要功能模塊,并對其工作過程進行了詳細的分析。第四,針對系統(tǒng)所使用的除法運算都是商小于1的特點,設計并實現(xiàn)了一個系統(tǒng)專用的除法器模塊。最后,在Altera FPGA目標芯片EP1S30F780C7上,對LP分析系統(tǒng)進行了驗證,證明了方案的可行性。

    標簽: G729A FPGA 語音編解碼

    上傳時間: 2013-06-20

    上傳用戶:pwcsoft

  • 基于FFT的GPS信號并行捕獲的研究及其FPGA實現(xiàn).rar

    本課題深入分析了GPS軟件接收機基于FFT并行捕獲算法并詳細闡述了其FPGA的實現(xiàn)。相比于其它的捕獲方案,該方案更好地滿足了信號處理實時性的要求。 論文的主體部分首先簡單分析了擴頻通信系統(tǒng)的基本原理,介紹了GPS系統(tǒng)的組成,詳細闡述了GPS信號的特點,并根據(jù)GPS信號的組成特點介紹了接收機的體系結(jié)構(gòu)。其次,通過對GPS接收機信號捕獲方案的深入研究,確定了捕獲速度快且實現(xiàn)復雜度不是很高的基于FFT的并行捕獲方案,并對該方案提出了幾點改進的措施,根據(jù)前面的分析,提出了系統(tǒng)的實現(xiàn)方案,利用MATLAB對該系統(tǒng)進行仿真,仿真的結(jié)果充分的驗證了方案的可行性。接著,對于捕獲環(huán)節(jié)中的核心部分—FFT處理器,設計中沒有采用ALTERA提供的IP核,獨立設計實現(xiàn)了基于FPGA的FFT處理器,并通過對一組數(shù)據(jù)在MATLAB中運算得到結(jié)果和FPGA輸出結(jié)果相對比,可以驗證該FFT處理器的正確性。再次重點分析了GPS接收機并行捕獲部分的FPGA具體實現(xiàn),通過捕獲的FPGA時序仿真波形,證明了該系統(tǒng)已經(jīng)能成功地捕獲到GPS信號。最后,對全文整個研究工作進行總結(jié),并指出以后繼續(xù)研究的方向。 本課題雖然是對于GPS接收機的研究,但其原理與GALILEO、北斗等導航系統(tǒng)的接收機相近,因此該課題的研究對我國衛(wèi)星導航事業(yè)的發(fā)展起到了積極的推動作用。

    標簽: FPGA FFT GPS

    上傳時間: 2013-08-06

    上傳用戶:青春123

  • 基于FPGA的通用數(shù)字化音頻處理平臺的研究與實現(xiàn).rar

    目前對數(shù)字化音頻處理的具體實現(xiàn)主要集中在以DSP或?qū)S肁SIC芯片為核心的處理平臺的開發(fā)方面,存在著并行處理性能差,系統(tǒng)升級和在線配置不靈活等缺點。另一方面現(xiàn)有解決方案的設計主要集中于處理器芯片,而對于音頻編解碼芯片的關(guān)注度較低,而且沒有提出過從芯片層到PCB板層的完整設計思路。本文針對上述問題對數(shù)字化音頻處理平臺進行了研究,主要內(nèi)容包括: 1、提出了基于FPGA的通用音頻處理平臺,該方案有別于現(xiàn)有的基于MCU、DSP和其它專用ASIC芯片的方案,論證了基于FPGA的音頻處理系統(tǒng)的結(jié)構(gòu)及設計工作流程,并對嵌入式音頻處理系統(tǒng)專門進行了研究。 2、提出了從芯片層到PCB板層的完整設計思路,并將設計思路得以實現(xiàn)。完成了FPGA的設計及實現(xiàn)過程,包括:系統(tǒng)整體分析,設計流程分析,配置模塊和數(shù)據(jù)通信模塊的RTL實現(xiàn)等;解決了FPGA與音頻編解碼芯片TLV320AIC23B之間接口不匹配問題;給出配置和數(shù)據(jù)通信模塊的功能方框圖;從多個角度完善PCB板設計,給出了各個系統(tǒng)組成部分的詳細設計方案和硬件電路原理圖,并附有PCB圖。 3、建立了實驗和分析環(huán)境,完成了各項實驗和分析工作,主要包括:PCB板信號完整性分析和優(yōu)化,F(xiàn)PGA系統(tǒng)中各個功能模塊的實驗與分析等。實驗和分析結(jié)果論證了系統(tǒng)設計的合理性和實用性。 本文的研究與實現(xiàn)工作通過實驗和分析得到了驗證。結(jié)果表明,本文提出的由FPGA和音頻編解碼芯片TLV320AIC23B組成的數(shù)字化音頻處理系統(tǒng)完全可以實現(xiàn)音頻信號的數(shù)字化處理,從而可以將FPGA在數(shù)字信號處理領(lǐng)域的優(yōu)點充分發(fā)揮于音頻信號處理領(lǐng)域。

    標簽: FPGA 通用數(shù)字 處理平臺

    上傳時間: 2013-04-24

    上傳用戶:lanwei

  • H264AVC的CAVLC編碼算法研究及FPGA實現(xiàn).rar

    H.264/AVC是國際電信聯(lián)盟與國際標準化組織/國際電工委員會聯(lián)合推出的活動圖像編碼標準,簡稱H.264。作為最新的國際視頻編碼標準,H.264/AVC與MPEG-4、H.263等視頻編碼標準相比,性能有了很大的提高,并已在流媒體、數(shù)字電視、電話會議、視頻存儲等諸多領(lǐng)域得到廣泛的應用。 本論文的研究課題是基于H.264/AVC視頻編碼標準的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自適應可變長編碼)編碼算法研究及FPGA實現(xiàn)。對于變換后的熵編碼,H.264/AVC支持兩種編碼模式:基于上下文的可變長編碼(CAVLC)和基于上下文的自適應算術(shù)編碼(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,盡管CAVLC算法也是采用了VLC編碼,但是同以往標準不同,它所有的編碼都是基于上下文進行。這種方法比傳統(tǒng)的查單一表的方法提高了編碼效率,但也增加了設計上的困難。 作者在全面學習H.264/AVC協(xié)議和深入研究CAVLC編碼算法的基礎上,確定了并行編碼的CAVLC編碼器結(jié)構(gòu)框圖,并總結(jié)出了影響CAVLC編碼器實現(xiàn)的瓶頸。針對這些瓶頸,對CAVLC編碼器中的各個功能模塊進行了優(yōu)化設計,這些優(yōu)化設計包括多參考塊的表格預測法、快速查找表法、算術(shù)消除法等。最后,用Verilog硬件描述語言對所設計的CAVLC編碼器進行了描述,用EDA軟件對其主要功能模塊進行了仿真,并在Cyclone II系列EP2C20F484的FPGA上驗證了它們的功能。結(jié)果表明,該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實時通信要求,為整個CAVLC編碼器的實時通信提供了良好的基礎。

    標簽: CAVLC H264 FPGA 264

    上傳時間: 2013-06-22

    上傳用戶:diamondsGQ

  • 基于FPGA的8PSK調(diào)制解調(diào)技術(shù)研究.rar

    軟件無線電是近年提出的新的通信體系,由于其具有靈活性和可重配置性并且符合通信的發(fā)展趨勢,已成為通信系統(tǒng)設計的研究熱點。因此對基于軟件無線電的調(diào)制解調(diào)技術(shù)進行深入細致的研究非常有意義。 本文首先從闡述軟件無線電的理論基礎入手,對多速率信號處理中的內(nèi)插和抽取、帶通采樣、數(shù)字變頻等技術(shù)進行了分析與探討,為設計和實現(xiàn)8PSK調(diào)制解調(diào)器提供了非常重要的理論依據(jù)。然后,研究了8PSK調(diào)制解調(diào)技術(shù),詳細論述了它們的基本概念和原理,提出了系統(tǒng)實現(xiàn)方案,在DSP+FPGA平臺上實現(xiàn)了8PSK信號的正確調(diào)制解調(diào)。文中著重研究了突發(fā)通信的同步和頻偏糾正算法,針對同步算法選取了一種基于能量檢測法的快速位同步算法,采用相關(guān)器實現(xiàn),同時實現(xiàn)位同步和幀同步。并且對于突發(fā)通信的多普勒頻偏糾正,設計了一個基于自動頻率控制(AFC)環(huán)的頻偏檢測器,通過修改數(shù)控振蕩器(NCO)的頻率控制字方法來校正本地載波頻率,整個算法結(jié)構(gòu)簡單,運算量小,頻偏校正速度快,具有較好的實用性。其次,對相干解調(diào)的初始相位進行糾正時,提出了一種簡單易行的CORDIC方法,同時對FPGA編程當中的一些關(guān)鍵問題進行了介紹。最后,設計了自適應調(diào)制解調(diào)器,根據(jù)信噪比和誤碼率來自適應的改變調(diào)制方式,以達到最佳的傳輸性能。

    標簽: FPGA 8PSK 調(diào)制解調(diào)

    上傳時間: 2013-04-24

    上傳用戶:mingaili888

  • 基于FPGA的圖像處理算法研究及硬件設計.rar

    隨著圖像分辨率的越來越高,軟件實現(xiàn)的圖像處理無法滿足實時性的需求;同時FPGA等可編程器件的快速發(fā)展使得硬件實現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國內(nèi)外的一個熱門領(lǐng)域。 本文在FPGA平臺上,用Verilog HDL實現(xiàn)了一個研究圖像處理算法的可重復配置的硬件模塊架構(gòu),架構(gòu)包括PC機預處理和通信軟件,控制模塊,計算單元,存儲器模塊和通信適配模塊五個部分。其中的計算模塊負責具體算法的實現(xiàn),根據(jù)不同的圖像處理算法可以獨立實現(xiàn)。架構(gòu)為計算模塊實現(xiàn)了一個可添加、移出接口,不同的算法設計只要符合該接口就可以方便的加入到模塊架構(gòu)中來進行調(diào)試和運行。 在硬件架構(gòu)的基礎上本文實現(xiàn)了排序濾波,中值濾波,卷積運算及高斯濾波,形態(tài)學算子運算等經(jīng)典的圖像處理算法。討論了FPGA的圖像處理算法的設計方法及優(yōu)化策略,通過性能分析,F(xiàn)PGA實現(xiàn)圖像處理在時間上比軟件處理有了很大的提高;通過結(jié)果的比較,發(fā)現(xiàn)FPGA的處理結(jié)果達到了軟件處理幾乎同等的效果水平。最后本文在實現(xiàn)較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進,提高了算法的可用性,同時為進一步的研究提供了更加便利的平臺。 整個設計都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開發(fā)的,在xilinx的Spartan-3E XC3S500E硬件平臺上實現(xiàn)。在軟件仿真過程中利用了ISE8.2自帶仿真工具和ModelSim結(jié)合使用。 本課題為制造FPGA的專用圖像處理芯片做了有益的探索性研究,為實現(xiàn)FPGA為核心處理芯片的實時圖像處理系統(tǒng)有著積極的作用。

    標簽: FPGA 圖像處理 算法研究

    上傳時間: 2013-07-29

    上傳用戶:愛順不順

  • 基于FPGA的GPS信號捕獲與跟蹤系統(tǒng)設計研究.rar

    互聯(lián)網(wǎng)、移動通信、星基導航是21世紀信息社會的三大支柱產(chǎn)業(yè),而GPS系統(tǒng)的技術(shù)水平和發(fā)展歷程代表著全世界衛(wèi)星導航系統(tǒng)的發(fā)展狀況。目前,我國已經(jīng)成為GPS的使用大國,衛(wèi)星導航產(chǎn)業(yè)鏈也已基本形成。然而,我們對GPS核心技術(shù)的研究還不夠深入,我國GPS產(chǎn)品的核心部分多數(shù)還是靠進口。 GPS接收機工作時,為了將本地信號和接收到的信號同步,要完成復雜的信號處理過程。其中,如何捕獲衛(wèi)星信號并保持對信號的跟蹤是最重要的核心技術(shù)。很多研究者提出了多種解決方法,但這些方法多數(shù)都只停留在理論階段,無法應用于GPS接收機系統(tǒng)進行實時處理。 本課題在分析了多種現(xiàn)有算法的基礎上,研究設計了基于FPGA的GPS信號捕獲與跟蹤系統(tǒng)。在研究過程中,首先利用Nemerix公司的GPS芯片組設計制作了GPS接收機模塊,它能正常穩(wěn)定地工作,并可用作GPS基帶信號處理的研究平臺;該平臺可實時地輸出GPS數(shù)字中頻信號;本課題在中頻信號的基礎上深入研究了GPS信號的捕獲與跟蹤技術(shù)。先詳細分析比較了幾種GPS信號捕獲方法,給出了步進相關(guān)的捕獲方案;接著分析了跟蹤環(huán)路的特點,給出了鎖頻環(huán)和鎖相環(huán)交替工作跟蹤載波以及載波輔助偽碼的跟蹤方案,并最終實現(xiàn)了這些方案。 本課題設計的GPS信號捕獲與跟蹤處理系統(tǒng)是通過硬件和軟件協(xié)同工作的方式實現(xiàn)的。硬件電路主要實現(xiàn)數(shù)據(jù)速率高、邏輯簡單的相關(guān)器功能;而基于MicroBlaze軟處理器的軟件主要實現(xiàn)數(shù)據(jù)速率低、邏輯復雜的功能。本文給出了硬件電路的詳細設計、仿真結(jié)果以及軟件設計的詳細流程。 本課題最終在FPGA上實現(xiàn)了GPS信號的捕獲與跟蹤功能,而且系統(tǒng)的性能良好。由此可以得出結(jié)論:本設計能夠滿足系統(tǒng)功能和性能的要求,可以直接用于實時GPS接收機系統(tǒng)的設計中,為自主設計GPS接收機奠定了基礎。 本課題的研究得到了大連市信息產(chǎn)業(yè)局集成電路設計專項的資助,項目名稱是“定位與通信集成功能的SOC設計”,研究成果將在2008年上半年投入試用。

    標簽: FPGA GPS 信號捕獲

    上傳時間: 2013-04-24

    上傳用戶:1583060504

  • 基于FPGA的QDPSK調(diào)制解調(diào)技術(shù)的研究及實現(xiàn).rar

    現(xiàn)代通信系統(tǒng)要求通信距離遠、通信容量大、傳輸質(zhì)量好。作為其關(guān)鍵技術(shù)之一的調(diào)制解調(diào)技術(shù)一直是人們研究的一個重要方向。用FPGA實現(xiàn)調(diào)制解調(diào)器具有體積小、功耗低、集成度高、可軟件升級、抗干擾能力強的特點,符合未來通信技術(shù)發(fā)展的方向。論文從以下幾個方面討論和實現(xiàn)了基于FPGA的調(diào)制解調(diào)系統(tǒng)。 論文首先介紹了調(diào)制解調(diào)系統(tǒng)的發(fā)展現(xiàn)狀及FPGA的相關(guān)知識。然后介紹了幾種常見的相位調(diào)制解調(diào)方式,重點是QDPSK調(diào)制解調(diào)系統(tǒng)的理論算法。 論文重點介紹了QDPSK解調(diào)調(diào)制系統(tǒng)的具體實現(xiàn)。首先,在在MATLAB環(huán)境下對系統(tǒng)里的每個子模塊完成了功能仿真,并取得滿意的仿真結(jié)果;其次,在QDPSK調(diào)制解調(diào)系統(tǒng)功能仿真正確的基礎上,對每個模塊的功能編寫C++算法,并且驗證了算法的正確性和可實現(xiàn)性;最后,在altera公司的FPGA開發(fā)平臺Quartus Ⅱ 6.0上,采用Verilog硬件描述語言對QDPSK調(diào)制解調(diào)系統(tǒng)實現(xiàn)了時序仿真和綜合仿真。

    標簽: QDPSK FPGA 調(diào)制

    上傳時間: 2013-04-24

    上傳用戶:lepoke

  • 軟件無線電中數(shù)字下變頻技術(shù)研究及FPGA實現(xiàn).rar

    軟件無線電(SDR,Software Defined Radio)由于具備傳統(tǒng)無線電技術(shù)無可比擬的優(yōu)越性,已成為業(yè)界公認的現(xiàn)代無線電通信技術(shù)的發(fā)展方向。理想的軟件無線電系統(tǒng)強調(diào)體系結(jié)構(gòu)的開放性和可編程性,減少靈活性著的硬件電路,把數(shù)字化處理(ADC和DAC)盡可能靠近天線,通過軟件的更新改變硬件的配置、結(jié)構(gòu)和功能。目前,直接對射頻(RF)進行采樣的技術(shù)尚未實現(xiàn)普及的產(chǎn)品化,而用數(shù)字變頻器在中頻進行數(shù)字化是普遍采用的方法,其主要思想是,數(shù)字混頻器用離散化的單頻本振信號與輸入采樣信號在乘法器中相乘,再經(jīng)插值或抽取濾波,其結(jié)果是,輸入信號頻譜搬移到所需頻帶,數(shù)據(jù)速率也相應改變,以供后續(xù)模塊做進一步處理。數(shù)字變頻器在發(fā)射設備和接收設備中分別稱為數(shù)字上變頻器(DUC,Digital Upper Converter)和數(shù)字下變頻器(DDC,Digital Down Converter),它們是軟件無線電通信設備的關(guān)鍵部什。大規(guī)模可編程邏輯器件的應用為現(xiàn)代通信系統(tǒng)的設計帶來極大的靈活性。基于FPGA的數(shù)字變頻器設計是深受廣大設計人員歡迎的設計手段。本文的重點研究是數(shù)字下變頻器(DDC),然而將它與數(shù)字上變頻器(DUC)完全割裂后進行研究顯然是不妥的,因此,本文對數(shù)字上變頻器也作適當介紹。 第一章簡要闡述了軟件無線電及數(shù)字下變頻的基本概念,介紹了研究背景及所完成的主要研究工作。 第二章介紹了數(shù)控振蕩器(NCO),介紹了兩種實現(xiàn)方法,即基于查找表和基于CORDIC算法的實現(xiàn)。對CORDIc算法作了重點介紹,給出了傳統(tǒng)算法和改進算法,并對基于傳統(tǒng)CORDIC算法的NCO的FPGA實現(xiàn)進行了EDA仿真。 第三章介紹了變速率采樣技術(shù),重點介紹了軟件無線電中廣泛采用的級聯(lián)積分梳狀濾波器 (cascaded integratot comb, CIC)和ISOP(Interpolated Second Order Polynomial)補償法,對前者進行了基于Matlab的理論仿真和FPGA實現(xiàn)的EDA仿真,后者只進行了基于Matlab的理論仿真。 第四章介紹了分布式算法和軟件無線電中廣泛采用的半帶(half-band,HB)濾波器,對基于分布式算法的半帶濾波器的FPGA實現(xiàn)進行了EDA仿真,最后簡要介紹了FIR的多相結(jié)構(gòu)。 第五章對數(shù)字下變頻器系統(tǒng)進行了噪聲綜合分析,給出了一個噪聲模型。 第六章介紹了數(shù)字下變頻器在短波電臺中頻數(shù)字化應用中的一個實例,給出了測試結(jié)果,重點介紹了下變頻器的:FPGA實現(xiàn),其對應的VHDL程序收錄在本文最后的附錄中,希望對從事該領(lǐng)域設計的技術(shù)人員具有一定參考價值。

    標簽: FPGA 軟件無線電 數(shù)字下變頻

    上傳時間: 2013-06-30

    上傳用戶:huannan88

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