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通信開關(guān)(guān)

無線通信FPGA設(shè)計(jì) 書的附帶代碼

無線通信FPGA設(shè)計(jì) 書的附帶代碼。書中涉及無線通信的各個(gè)環(huán)節(jié)，但是介紹的都不細(xì)，而且例程太簡(jiǎn)單，但是可以做入門學(xué)習(xí)用。

標(biāo)簽： FPGA 無線通信代碼

上傳時(shí)間： 2013-08-21

上傳用戶：mickey008
多路18b20測(cè)溫顯示系統(tǒng),可同時(shí)測(cè)量n個(gè)第三18b20

多路18b20測(cè)溫顯示系統(tǒng),可同時(shí)測(cè)量n個(gè)第三18b20

標(biāo)簽： 18b20 多路測(cè)溫顯示系統(tǒng)

上傳時(shí)間： 2013-08-21

上傳用戶：zhangchu0807
用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語言編寫

用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語言編寫，非常有用的好東東啊

標(biāo)簽： FPGA VHDL 232 RS

上傳時(shí)間： 2013-08-21

上傳用戶：爺?shù)臍赓|(zhì)
FPGA實(shí)現(xiàn)頻率合成的技術(shù)，含軟硬件設(shè)計(jì)

盡管頻率合成技術(shù)已經(jīng)經(jīng)歷了大半個(gè)世紀(jì)的發(fā)展史，但直到今天，人們對(duì)\\r\\n它的研究仍然在繼續(xù)。現(xiàn)在，我們可以開發(fā)出輸出頻率高達(dá)IG的DDS系統(tǒng)，\\r\\n武漢理工大學(xué)碩士學(xué)位論文\\r\\n已能滿足絕大多數(shù)頻率源的要求，集成DDS產(chǎn)品的信噪比也可達(dá)到75dB以上，\\r\\n已達(dá)到鎖相頻率合成的一般水平。電子技術(shù)的發(fā)展己進(jìn)入數(shù)字時(shí)代，模擬信號(hào)\\r\\n數(shù)字化的方法也是目前一個(gè)熱門研究課題，高速AD、DA器件在通信、廣播電\\r\\n視等領(lǐng)域的應(yīng)用越來越廣泛。本次設(shè)計(jì)完成了軟件仿真和硬件實(shí)現(xiàn)，對(duì)設(shè)計(jì)原

標(biāo)簽： FPGA 頻率合成軟硬件設(shè)計(jì)

上傳時(shí)間： 2013-08-21

上傳用戶：asdkin
DSP與CPLD通信方法有需要的請(qǐng)下載

DSP與CPLD通信方法有需要的請(qǐng)下載

標(biāo)簽： CPLD DSP 通信

上傳時(shí)間： 2013-08-23

上傳用戶：Ants
單片機(jī)用總線方式與CPLD系統(tǒng)進(jìn)行通信

單片機(jī)用總線方式與CPLD系統(tǒng)進(jìn)行通信。

標(biāo)簽： CPLD 單片機(jī) 總線方式

上傳時(shí)間： 2013-08-25

上傳用戶：風(fēng)行天下
可編程邏輯器件的開發(fā)與應(yīng)用實(shí)驗(yàn)教學(xué)大綱

可編程邏輯器件的開發(fā)與應(yīng)用實(shí)驗(yàn)教學(xué)大綱\r\n本課程是高等院校電氣、信息、通信類專業(yè)的一門技術(shù)基礎(chǔ)課。通過本課程的學(xué)習(xí)，使學(xué)生獲得數(shù)字系統(tǒng)設(shè)計(jì)和可編程邏輯器件方面的基本概念、基本知識(shí)和基本技能，培養(yǎng)他們對(duì)數(shù)字系統(tǒng)的分析與設(shè)計(jì)的能力，為后續(xù)課程的學(xué)習(xí)及今后的實(shí)際工作打下良好的基礎(chǔ)。

標(biāo)簽： 可編程邏輯器件實(shí)驗(yàn) 教學(xué)大綱

上傳時(shí)間： 2013-08-26

上傳用戶：shinesyh
可編程邏輯器件cpld與單片機(jī)雙向通信的源程序

可編程邏輯器件cpld與單片機(jī)雙向通信的源程序

標(biāo)簽： cpld 可編程邏輯器件單片機(jī) 雙向通信

上傳時(shí)間： 2013-08-28

上傳用戶：梧桐
使8051能訪問整個(gè)128KB的RAM空間和128KB的FlashRom空間,在CPLD內(nèi)建兩個(gè)寄存器\r\n

8051工作于11.0592MHZ,RAM擴(kuò)展為128KB的628128,FlashRom擴(kuò)展為128KB的AT29C010A\r\n 128KB的RAM分成4個(gè)區(qū)(Bank) 地址分配為0x0000-0x7FFF\r\n 128KB的FlashRom分成8個(gè)區(qū)(Bank) 地址分配為0x8000-0xBFFF\r\n 為了使8051能訪問整個(gè)128KB的RAM空間和128KB的FlashRom空間,在CPLD內(nèi)建兩個(gè)寄存器\r\n RamBankReg和FlashRomBankReg用于存放高位地址

標(biāo)簽： 128 FlashRom 8051 KB

上傳時(shí)間： 2013-08-30

上傳用戶：cainaifa
基于FPGA 的OFDM 寬帶數(shù)據(jù)通信同步系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

這是篇, 覺得甚是有用，大家共同學(xué)學(xué)。

標(biāo)簽： FPGA OFDM 寬帶數(shù)據(jù) 同步系統(tǒng)

上傳時(shí)間： 2013-08-31

上傳用戶：ming52900

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