使用verilog作為CPU設計語言實現單數據通路五級流水線的CPU。具有32個通用寄存器、一個程序計數器PC、一個標志寄存器FLAG
使用verilog作為CPU設計語言實現單數據通路五級流水線的CPU。具有32個通用寄存器、一個程序計數器PC、一個標志寄存器FLAG,一個堆棧寄存器STACK。存儲器尋址粒度為字節(jié)。數據存儲以32位字對準。采用32位定長指令格式,采用Load/Store結構,ALU指令采用三地址格式。支持有符號和...
使用verilog作為CPU設計語言實現單數據通路五級流水線的CPU。具有32個通用寄存器、一個程序計數器PC、一個標志寄存器FLAG,一個堆棧寄存器STACK。存儲器尋址粒度為字節(jié)。數據存儲以32位字對準。采用32位定長指令格式,采用Load/Store結構,ALU指令采用三地址格式。支持有符號和...
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