該程序用事件管理器B的定時器4定時時間來觸發(fā)A/D采樣的啟動。采樣時采用級聯(lián)模式，一次做16個轉(zhuǎn)換，轉(zhuǎn)換通道分別是0~15。轉(zhuǎn)換完成后，在A/D中斷服務(wù)子程序中將轉(zhuǎn)換結(jié)果讀出。該程序做一次A/D采樣。
上傳時間： 2017-09-25
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實用電子技術(shù)專輯 385冊 3.609G電子連接器設(shè)計基礎(chǔ) 35頁 1.3M.ppt
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上傳時間： 2014-05-05
上傳用戶：時代將軍
隨著空間科學(xué)任務(wù)的增加,需要處理的空間科學(xué)數(shù)據(jù)量激增,要求建立一個高速的空間數(shù)據(jù)連接網(wǎng)絡(luò).高速復(fù)接器作為空間飛行器星上網(wǎng)絡(luò)的關(guān)鍵設(shè)備,其性能對整個空間數(shù)據(jù)網(wǎng)絡(luò)的性能起著重要影響.該文闡述了利用先入先出存儲器FIFO進行異步速率調(diào)整,應(yīng)用VHDL語言和可編程門陣列FPGA技術(shù),對多個信號源數(shù)據(jù)進行數(shù)據(jù)打包、信道選通調(diào)度和多路復(fù)接的方法.設(shè)計中,用VHDL語言對高速復(fù)接器進行行為級建模,為了驗證這個模型,首先使用軟件進行仿真,通過編寫testbench程序模擬FIFO的動作特點,對程序輸入信號進行仿真,在軟件邏輯仿真取得預(yù)期結(jié)果后,繼續(xù)設(shè)計硬件電路,設(shè)計出的實際電路實現(xiàn)了將來自兩個不同速率的信源數(shù)據(jù)(1394總線數(shù)據(jù)和1553B總線數(shù)據(jù))復(fù)接成一路符合CCSDS協(xié)議的位流業(yè)務(wù)數(shù)據(jù).在實驗調(diào)試中對FPGA的輸出數(shù)據(jù)進行檢驗,同時對設(shè)計方法進行驗證.驗證結(jié)果完全符合設(shè)計目標(biāo).應(yīng)用硬件可編程邏輯芯片F(xiàn)PGA設(shè)計高速復(fù)接器,大幅度提高了數(shù)據(jù)的復(fù)接速率,可應(yīng)用于未來的星載高速數(shù)據(jù)系統(tǒng)中,能夠完成在軌系統(tǒng)的數(shù)據(jù)復(fù)接任務(wù).
上傳時間： 2013-07-17
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一個橋接器87ch47仿真器的c的源程序
上傳時間： 2014-01-12
上傳用戶：ukuk
著名的開源鏈接器，可鏈接obj和lib文件，目標(biāo)格式可以是MSDOS COM、MSDOS EXE或Win32 PE文件
上傳時間： 2015-04-02
上傳用戶：siguazgb
國內(nèi)唯一一本介紹鏈接器和加載器的書籍. 講編譯原理的書很多,但是講linkerAndLoader的書籍卻只有這一本.缺6和10章,還未翻譯完成.
標(biāo)簽： linkerAndLoader 書籍 接器 編譯原理
上傳時間： 2015-06-17
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％直接型到并聯(lián)型的轉(zhuǎn)換 ％ ％[C,B,A]=dir2par(b,a) ％C為當(dāng)b的長度大于a時的多項式部分 ％B為包含各bk的K乘2維實系數(shù)矩陣 ％A為包含各ak的K乘3維實系數(shù)矩陣 ％b為直接型分子多項式系數(shù) ％a為直接型分母多項式系數(shù) ％
上傳時間： 2014-01-20
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直接型到級聯(lián)型的形式轉(zhuǎn)換 ％ [b0,B,A]=dir2cas(b,a) ％b 為直接型的分子多項式系數(shù) ％a 為直接型的分母多項式系數(shù) ％b0為增益系數(shù) ％B 為包含各bk的K乘3維實系數(shù)矩陣 ％A 為包含各ak的K乘3維實系數(shù)矩陣 ％
上傳時間： 2013-12-30
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B樹及其B+樹的實現(xiàn)代碼，支持模版（數(shù)據(jù)類型，M值）
上傳時間： 2016-02-22
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STL源碼剖析 本書內(nèi)容包括：STL概論與版本簡介、空間配置器、迭代器概念與traits編程技法、序列式容器、關(guān)聯(lián)式容器、算法、仿函數(shù)、配接器等。
上傳時間： 2016-04-06
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