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連續(xù)可調(diào)

  • HT49 MCU的可編程分頻器(PFD)使用指南

    HT49 MCU的可編程分頻器(PFD)使用指南 本文主要介紹 HT49 單片機(jī)可編程分頻器(PFD)的使用及注意事項(xiàng)。

    標(biāo)簽: MCU PFD HT 49

    上傳時(shí)間: 2013-11-03

    上傳用戶:crazyer

  • 可編程系統(tǒng)級(jí)芯片提供了最大設(shè)計(jì)的靈活性

    可編程系統(tǒng)級(jí)芯片提供了最大設(shè)計(jì)的靈活性 極端靈活且完全可編程的混合信號(hào)SOC 的基本原理是促使賽普拉斯微系統(tǒng)公司(Cypress MicroSystems)推出名為PSoCTM(Programmable System-On-ChipTM,可編程系統(tǒng)級(jí)芯片)的全新一代器件的動(dòng)力所在。

    標(biāo)簽: 可編程 系統(tǒng)級(jí)芯片

    上傳時(shí)間: 2013-10-22

    上傳用戶:playboys0

  • EDA技術(shù)課程設(shè)計(jì):可控計(jì)數(shù)器的設(shè)計(jì)

    EDA技術(shù)課程設(shè)計(jì):可控計(jì)數(shù)器的設(shè)計(jì) 設(shè)計(jì)要求:1.設(shè)計(jì)一個(gè)五進(jìn)制計(jì)數(shù)器,由兩個(gè)控制鍵sel控制不同的計(jì)數(shù)方式;2.當(dāng)sel=00時(shí),按0、1、2、3、4、0、1、2、3、4......順序計(jì)數(shù);3.當(dāng)sel=01時(shí),按0、2、4、6、8、0、2、4、6、8......順序計(jì)數(shù)4.當(dāng)sel=10時(shí),按1、3、5、7、9、1、3、5、7、9......順序計(jì)數(shù)5.當(dāng)sel=11時(shí),按5、4、3、2、1、5、4、3、2、1......順序計(jì)數(shù)6.由數(shù)碼管分別譯碼顯示控制信號(hào)和計(jì)數(shù)狀態(tài),分別用3位數(shù)碼管動(dòng)態(tài)顯示;7.給出VHDL設(shè)計(jì)的源程序。

    標(biāo)簽: EDA 計(jì)數(shù)器

    上傳時(shí)間: 2013-12-16

    上傳用戶:YYRR

  • 可編程計(jì)數(shù)器陳列PCA原理及應(yīng)用設(shè)計(jì)

    可編程計(jì)數(shù)器陳列PCA原理及應(yīng)用設(shè)計(jì)P89C51Rx2的可編程計(jì)數(shù)器陳列是由5個(gè)相同的、以計(jì)數(shù)器為主的模塊組成。每個(gè)模塊除為主的計(jì)數(shù)器外,還輔之以比較器/沿捕捉器。

    標(biāo)簽: PCA 可編程計(jì)數(shù)器 應(yīng)用設(shè)計(jì)

    上傳時(shí)間: 2013-10-12

    上傳用戶:youke111

  • 基于AT89C51單片機(jī)的微型可編程控崩器

    介招用AT8 9 c5 單片機(jī)構(gòu)成微型可鳊程控制器PLc的設(shè)計(jì)思路一系統(tǒng)硬件配置和軟件設(shè)計(jì)方法,最后給出此微型可鳊程控制器在水塔水位控制中應(yīng)用的實(shí)例。

    標(biāo)簽: 89C C51 AT 89

    上傳時(shí)間: 2013-11-19

    上傳用戶:adada

  • 基于單片機(jī)的現(xiàn)場(chǎng)可編程門陣列的配置

    本文介紹了基于SRAM 查找表的現(xiàn)場(chǎng)可重配置FPGA 的結(jié)構(gòu)和原理,及其配置方法,通過(guò)對(duì)多種配置方法的比較,提出了由單片機(jī)和EPROM 存儲(chǔ)器組成的串行配置方式。這種方式結(jié)構(gòu)簡(jiǎn)單,設(shè)計(jì)保密性好,易于升級(jí),降低設(shè)計(jì)成本。在大規(guī)模可編程邏輯器件出現(xiàn)以前,把器件焊接在電路板上是設(shè)計(jì)數(shù)字系統(tǒng)的最后一步。當(dāng)設(shè)計(jì)存在問(wèn)題并解決后,設(shè)計(jì)者往往不得不重新設(shè)計(jì)印制電路板。設(shè)計(jì)周期長(zhǎng),設(shè)計(jì)效率低。CPLD 、FPGA 出現(xiàn)后,利用其在系統(tǒng)可編程或可重配置功能,設(shè)計(jì)者可以在進(jìn)行邏輯設(shè)計(jì)而未進(jìn)行電路設(shè)計(jì)時(shí)就把CPLD、FPGA 焊接在電路板上,然后在設(shè)計(jì)調(diào)試時(shí)可一次次隨心所欲的改變電路的硬件邏輯關(guān)系,而不用改變電路板的結(jié)構(gòu)。

    標(biāo)簽: 單片機(jī) 現(xiàn)場(chǎng)可編程門陣列

    上傳時(shí)間: 2013-10-29

    上傳用戶:born2007

  • 可編程自動(dòng)控制控制跑馬燈

    這一顆,我們學(xué)習(xí)如何讓跑馬燈自動(dòng)按照我們預(yù)定的順序進(jìn)行。這種控制在工控場(chǎng)合經(jīng)常用到。這個(gè)程序里,我們預(yù)先定義了一個(gè)變化的順序speedcode,每跑一圈燈就根據(jù)預(yù)定設(shè)置的表格數(shù)據(jù)來(lái)決定下一圈的跑馬速度。這樣我們就實(shí)現(xiàn)了按照預(yù)定的順序自動(dòng)變化運(yùn)行。請(qǐng)看代碼:-----------------------------------#define uchar unsigned char //定義一下方便使用#define uint unsigned int#define ulong unsigned long#include <reg52.h> //包括一個(gè)52 標(biāo)準(zhǔn)內(nèi)核的頭文件sbit P10 = P1^0; //頭文件中沒(méi)有定義的IO 就要自己來(lái)定義了sbit P11 = P1^1;sbit P12 = P1^2;sbit P13 = P1^3;bit ldelay=0; //長(zhǎng)定時(shí)溢出標(biāo)記,預(yù)置是0uchar speed=10; //設(shè)置一個(gè)變量保存跑馬燈的移動(dòng)速度uchar code speedcode[10]={3,1,5,12,3,20,2,10,1,4}; //10 個(gè)預(yù)定義的速度char code dx516[3] _at_ 0x003b;//這是為了仿真設(shè)置的//可編程自動(dòng)控制跑馬燈void main(void) // 主程序{uchar code ledp[4]={0xfe,0xfd,0xfb,0xf7};//預(yù)定的寫入P1 的值uchar ledi; //用來(lái)指示顯示順序uchar i;RCAP2H =0x10; //賦T2 的預(yù)置值0x1000,溢出30 次就是1 秒鐘RCAP2L =0x00;TR2=1; //啟動(dòng)定時(shí)器ET2=1; //打開(kāi)定時(shí)器2 中斷EA=1; //打開(kāi)總中斷

    標(biāo)簽: 可編程 自動(dòng)控制 控制 跑馬燈

    上傳時(shí)間: 2013-11-20

    上傳用戶:ming529

  • 可編程中斷控制器82C59A-2

    82C59A-2是為簡(jiǎn)化微處理機(jī)系統(tǒng)中斷接口而實(shí)現(xiàn)的LSI外圍芯片。也叫做PIC(Programmable Interrupt Controller)。是高性能高速度芯片。在多級(jí)優(yōu)先級(jí)中斷系統(tǒng)內(nèi)82C59A-1402已經(jīng)把CPU從對(duì)任務(wù)的輪詢中解救出來(lái)。PCI可由軟件進(jìn)行控制,使用于各種不同的環(huán)境,聯(lián)級(jí)可接受8~64個(gè)中斷輸入。 管腳與NMOS8259A-2兼容單片8級(jí)優(yōu)先級(jí),級(jí)聯(lián)可擴(kuò)64級(jí)多種可編程中斷方式各自專用的請(qǐng)求屏蔽能力與Intel系列機(jī)兼容全部采用靜態(tài)設(shè)計(jì)低功耗5V的電源供電。

    標(biāo)簽: 82 59 可編程 中斷控制器

    上傳時(shí)間: 2013-10-30

    上傳用戶:zhliu007

  • 高性能可編程DMA控制接口82C37A-5

    高性能可編程DMA控制接口82C37A-54.1  概述對(duì)象實(shí)體:直接存儲(chǔ)器訪問(wèn)(DMA)控制接口芯片82C37A-5芯片的特點(diǎn):1、管腳引線與NMOS  8237A-5兼容。2、允許/禁止單獨(dú)DMA請(qǐng)求控制。3、頻率從0~5MHz區(qū)間全靜態(tài)設(shè)計(jì)。4、低電平操作。 5、4個(gè)各自獨(dú)立的DMA通道并獨(dú)立的進(jìn)行初始化。6、存儲(chǔ)器到存儲(chǔ)器之間傳送。7、存儲(chǔ)器模塊初始化處理。8、地址的增量和減量。9、傳送速率可達(dá)1.6MB/s.10、可直接擴(kuò)展成任意數(shù)量的通道。11 、終止傳送的過(guò)程即輸入結(jié)束。12、軟件請(qǐng)求。13、獨(dú)立信號(hào)DREQ和信號(hào)DACK的極性控制。4.2 82C37A-5的體系結(jié)構(gòu)4.2.1   基本結(jié)構(gòu)描述1.   82C37A-5內(nèi)部配備了規(guī)模為344位的內(nèi)部存儲(chǔ)器,它是以寄存器的形式出現(xiàn)的。2.   配有3個(gè)基本的控制模塊: (1)定時(shí)及控制模塊; (2)優(yōu)先級(jí)編碼及循環(huán)優(yōu)先級(jí)控制模塊;(3)命令控制模塊; 3.   12個(gè)不同類型的寄存器 。圖 4-1  82C37A-5結(jié)構(gòu)圖EOP#                                                                                                                                                 A0~A3RESETCS#.                                                                                                                    IOW# DREQ0~DREQ3HLDAHRQ                                                                                                                                            DB0~DB7DACK0~DACK3

    標(biāo)簽: DMA 82 37 性能

    上傳時(shí)間: 2013-10-21

    上傳用戶:ming52900

  • CHMOS可編程時(shí)間間隔定時(shí)器芯片82C54

    82C54是專為Intel系列微處理機(jī)而設(shè)計(jì)的一種可編程時(shí)間間隔定時(shí)器/計(jì)數(shù)器,它是一種通用芯片,在系統(tǒng)軟件中可以把多級(jí)定時(shí)元素當(dāng)成輸入/輸出端口中的一個(gè)陣列看待。1.  與所有Intel系列兼容2.  操作速度高,與8MHz的8086、80186一起可實(shí)現(xiàn)“零等待狀態(tài)”的操作。3.  可處理從直流到10M頻率的輸入。4.  適應(yīng)性強(qiáng)5.  三個(gè)獨(dú)立的16位計(jì)數(shù)器6.  低功耗的CHMOS7.  與TTL完全兼容8.  6 種可編程的計(jì)數(shù)模式9.  以二進(jìn)制或BCD計(jì)數(shù)10. 狀態(tài)讀返回命令

    標(biāo)簽: CHMOS 82C54 可編程 時(shí)間間隔

    上傳時(shí)間: 2013-11-16

    上傳用戶:elinuxzj

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