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運(yùn)動小目標(biāo)

  • ARM開發(fā)流程、最小系統(tǒng)、啟動文件詳解.rar

    ARM的開發(fā)流程、最小系統(tǒng)、啟動文件詳解:包括最小系統(tǒng)實例詳解和軟件環(huán)境介紹

    標簽: ARM 開發(fā)流程 最小系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:330402686

  • 魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例.part1.rar

    魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例 缺頁部分補上了,不得不分4卷,上傳不上

    標簽: part MSP 430

    上傳時間: 2013-07-13

    上傳用戶:wsx123

  • 魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例.part2.rar

    魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例 缺頁部分補上了,不得不分4卷,上傳不上

    標簽: part MSP 430

    上傳時間: 2013-04-24

    上傳用戶:王楚楚

  • 魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例.part3.rar

    魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例 缺頁部分補上了,不得不分4卷,上傳不上

    標簽: part MSP 430

    上傳時間: 2013-07-09

    上傳用戶:heart520beat

  • 魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例.part4.rar

    魏小龍MSP430系列單片機接口技術(shù)及系統(tǒng)設(shè)計實例 缺頁部分補上了,不得不分4卷,上傳不上

    標簽: part MSP 430

    上傳時間: 2013-08-05

    上傳用戶:aig85

  • 基于ARM7最小系統(tǒng)的設(shè)計.rar

    本文主要研究的是一個基于ARM7最小系統(tǒng)的研究設(shè)計,本系統(tǒng)主要由LPC2210,以及復位電路、晶振電路、程序存儲器、蜂鳴器等部分組成。本系統(tǒng)的特點是性能高、成本低并且耗能小等特點。 主要研究內(nèi)容: ? 1 以高速低功耗的ARM作為控制核心,設(shè)計ARM最小系統(tǒng)的有關(guān)軟硬件; ? 2 MCU與存儲器和串行通信的接口設(shè)計; ? 3 與計算機進行通信的軟硬件設(shè)計

    標簽: ARM7 最小系統(tǒng)

    上傳時間: 2013-04-24

    上傳用戶:qoovoop

  • 基于TMS320F2808的高效雙向DCDC變換器.rar

    雙向DC/DC變換器(Bi-directionalDC/DCconverters)是能夠根據(jù)需要調(diào)節(jié)能量雙向傳輸?shù)闹绷?直流變換器。隨著科技的發(fā)展,雙向DC/DC變換器的應用需求越來越多,正逐步應用到無軌電車、地鐵、列車、電動車等直流電機驅(qū)動系統(tǒng),直流不間斷電源系統(tǒng),航天電源等場合。一方面,雙向DC/DC變換器為這些系統(tǒng)提供能量,另一方面,又使可回收能量反向給供電端充電,從而節(jié)約能量。 大多數(shù)雙向DC/DC變換器采用復雜的輔助網(wǎng)絡(luò)來實現(xiàn)軟開關(guān)技術(shù),本文所研究的Buck/Boost雙向的DC/DC變換器從拓撲上解決器件軟開關(guān)的問題;由于Buck/Boost雙向DC/DC變換器的電流紋波較大,這會帶來嚴重的電磁干擾,本文結(jié)合Buck/Boost雙向DC/DC變換器拓撲與磁耦合技術(shù)使電感電流紋波減??;由于在同一頻率下不同負載時電流紋波不同,本文在控制時根據(jù)負載改變PWM頻率,從而使輕載時的電流紋波均較小。 本文所研究的雙向DC/DC變換器采用DSP處理器進行控制,其原因在于:目前沒有專門用于控制該Buck/Boost雙向DC/DC變換器的控制芯片,而DSP具有多路的高分辨率PWM,通過對DSP寄存器的配置可以實現(xiàn)Buck/Boost雙向DC/DC變換器的控制PWM;DSP具有多路高速的A/D轉(zhuǎn)換接口,并可以通過配合PWM完成對反饋采樣,具備一定的濾波功能。 本文所研究的數(shù)字雙向DC/DC變換器實現(xiàn)了在Buck模式下功率MOSFET的零電壓開通及零電壓關(guān)斷,電感電流的交迭使其電感輸出端電流紋波明顯變小,輕載時PWM頻率的提升也使得電流紋波變小。

    標簽: F2808 2808 320F DCDC

    上傳時間: 2013-06-08

    上傳用戶:cy_ewhat

  • 小波分析在信號去噪中的應用研究.rar

    目前,小波分析在信息技術(shù)和其他學科方面的應用是眾多科技工作者關(guān)心的課題。在理論方面,新觀點、新方法不斷涌現(xiàn)。本文旨在完善小波的基本理論,對原有的小波去噪方法作進一步的改進。 經(jīng)典的信號處理方法,例如傅立葉變換、短時傅立葉變換等具有局限性,因而限定了它們的應用范圍。小波分析作為一種全新的信號處理方法,它將信號中各種不同的頻率成分分解到互不重疊的頻帶上,為信號濾波、信噪分離和特征提取提供了有效途徑,特別在信號去噪方面顯出了獨特的優(yōu)勢。本文介紹了經(jīng)典的去噪方法,并對其適用范圍和效果進行了分析和比較。并且,討論了小波分析的基本理論,介紹了連續(xù)小波變換、離散小波變換和小波變換的快速分解與重構(gòu)算法,最后研究了小波基的數(shù)學特性,分析了它們對實際應用的影響和作用。進而,介紹了小波的幾種去噪方法:小波變換高頻系數(shù)置零去噪方法、小波變換模極大值去噪方法、小波閾值去噪方法、小波空域相關(guān)性去噪方法。用小波變換將高頻系數(shù)強制置零去噪的方法是比較方便的,但它的不足之處是經(jīng)將高頻系數(shù)強制置零去噪后重構(gòu)的信號會使信號丟失一些細節(jié),且小波基的選擇亦有相當?shù)碾y度,只有靠經(jīng)驗來確定,不過比傳統(tǒng)的濾波方法所得的效果還是要好。對于小波變換模極大值去噪的原理,分析了去噪過程中幾個參數(shù)的選取問題,并給出了一些選取依據(jù);對小波閾值去噪方法的幾個關(guān)鍵問題進行了詳細討論。對閾值去噪進行了改進,利用均值逼近與閾值去噪相結(jié)合的方法來實現(xiàn)信號的處理,并通過實驗仿真實現(xiàn)。實驗結(jié)果表明該方法提高了信噪比,去噪效果優(yōu)于單獨應用閾值去噪的方法。 在空域相關(guān)去噪算法的基礎(chǔ)上,進行了改進,利用閾值濾波與相關(guān)去噪算法相結(jié)合的一種組合去噪算法,仿真試驗結(jié)果表明,由該算法濾波之后得到的小波系數(shù)不僅連續(xù)性好,準確率高,而且易于重構(gòu)信號。 本文分別對這四種方法進行了算法分析比較,通過實驗仿真來實現(xiàn),并對實驗結(jié)果進行了分析。實驗仿真結(jié)果表明了利用小波分析理論對信號去噪的可行性和有效性。 關(guān)鍵詞:小波分析,信號去噪,閾值,均值逼近,空域相關(guān)

    標簽: 小波分析 信號去噪 中的應用

    上傳時間: 2013-07-19

    上傳用戶:啊颯颯大師的

  • 1、51單片機最小系統(tǒng).rar

    51單片機最最小系統(tǒng),作為學習參考,對大家有幫助

    標簽: 51單片機 最小系統(tǒng)

    上傳時間: 2013-07-28

    上傳用戶:dba1592201

  • FPGA中多標準可編程IO端口的設(shè)計.rar

    現(xiàn)場可編程門陣列(FPGA,F(xiàn)ield Programmable Gate Array)是可編程邏輯器件的一種,它的出現(xiàn)是隨著微電子技術(shù)的發(fā)展,設(shè)計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統(tǒng)設(shè)計師們更愿意自己設(shè)計專用集成電路(ASIC,Application Specific Integrated Circuit).芯片,而且希望ASIC的設(shè)計周期盡可能短,最好是在實驗室里就能設(shè)計出合適的ASIC芯片,并且立即投入實際應用之中?,F(xiàn)在,F(xiàn)PGA已廣泛地運用于通信領(lǐng)域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一,它的主要作用是提供封裝引腳到CLB之間的接口,將外部信號引入FPGA內(nèi)部進行邏輯功能的實現(xiàn)并把結(jié)果輸出給外部電路,并且根據(jù)需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現(xiàn)各種邏輯功能,在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路??傮w而言,可選的I/O資源的特性包括:IO標準的選擇、輸出驅(qū)動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關(guān)于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設(shè)計和實現(xiàn),該課題是成都華微電子系統(tǒng)有限公司FPGA大項目中的一子項,目的為在更新的工藝水平上設(shè)計出能夠兼容單端標準的I/O電路模塊;同時針對以前設(shè)計的I/O模塊不支持雙端標準的缺點,要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構(gòu)建雙端標準收發(fā)轉(zhuǎn)換電路,與單端標準比較,LVDS具有很多優(yōu)點: (1)LVDS傳輸?shù)男盘枖[幅小,從而功耗低,一般差分線上電流不超過4mA,負載阻抗為100Ω。這一特征使它適合做并行數(shù)據(jù)傳輸。 (2)LVDS信號擺幅小,從而使得該結(jié)構(gòu)可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化,單端信號擺幅為400mV,這樣允許輸入共模電壓從0.2V到2.2V范圍內(nèi)變化,也就是說LVDS允許收發(fā)兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝,輔助Xilinx公司FPGA開發(fā)軟件ISE,設(shè)計完成了可以用于Virtex系列各低端型號FPGA的IOB結(jié)構(gòu),它有靈活的可配置性和出色的適應能力,能支持大量的I/O標準,其中包括單端標準,也包括雙端標準如LVDS等。它具有適應性的優(yōu)點、可選的特性和考慮到被文件描述的硬件結(jié)構(gòu)特征,這些特點可以改進和簡化系統(tǒng)級的設(shè)計,為最終的產(chǎn)品設(shè)計和生產(chǎn)打下基礎(chǔ)。設(shè)計中對包括20種IO標準在內(nèi)的各電器參數(shù)按照用戶手冊描述進行仿真驗證,性能參數(shù)已達到預期標準。

    標簽: FPGA 標準 可編程

    上傳時間: 2013-05-15

    上傳用戶:shawvi

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