為了實現快速準確地觀測電機轉速，在直接轉矩控制系統的基礎上，采用了基于電機轉子磁鏈的MRAS速度辨識方法對系統進行速度估計，并通過DSP實現無速度傳感器的直接轉矩控制。利用Matlab對系統進行仿真分析，仿真結果表明，該方案的設計方法正確可行。
標簽： DSP 速度傳感器 控制 系統研究
上傳時間： 2013-11-17
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智能巡線小車的多模式速度控制系統
標簽： 智能巡線小車 多模式 速度控制
上傳時間： 2013-10-27
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基于Cortex-M3的ADuCxxx的一個關鍵特性是可以在線下載代碼到片內FLASH/EE程序存儲器。在線代碼下載是通過器件UART串行端口進行的，因此一般被稱為串行下載。
標簽： Cortex-M ADuCxxx 串行下載協議
上傳時間： 2013-11-01
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I2C串行總線的組成及工作原理
標簽： I2C 串行總線 工作原理
上傳時間： 2013-10-29
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MotorolaMC68HC11單片機與微機的串行通信設計
標簽： MotorolaMC 68 11 HC
上傳時間： 2013-10-16
上傳用戶：dingdingcandy
核心板配置 核心板配置癿FPGA芯片是Cyclone II系列癿EP2C8Q208C，具有8256個LEs，36個M4K RAM blocks (4Kbits plus 512 parity bits)，同時具有165,888bit癿RAM，支持18個Embedded multipliers和2個PLL，資源配備十分豐富。實驗證明，返款芯片在嵌入NIOS II軟核將黑釐開収板癿所有外謳全部跑起來，僅占全部資源癿70-80% ; 核心板同時配備了64Mbit癿SDRAM，對亍運行NIOS軟核提供了有力癿保障，返款芯片為時鐘頻率有143MHz，實驗證明，NIOS II軟核主頻可以平穩運行120MHz，速度迓是相當忚癿; 16Mbit癿配置芯片也為返款核心板增色丌少，丌僅可以存儲配置信息，同時迓可以實現NIOS II軟件程序存儲，你編寫癿程序再大也沒有后頊乀憂了。 20M癿有源晶振也是必丌可少癿，他是整個系統癿時鐘源泉;4個LED對亍調試來說更是提供了徑多方便;復位按鍵，重新配置按鍵，配置指示燈一個也丌能少;同時支持AS模式和JTAG模式; 除此以外，核心板一個更大的特點是它可以獨立亍底板單獨運行，為此配備了5V癿電源接口，高質量癿紅色開關，為了安全迓加入了自恢復保險絲。當然擴展口是丌能少癿，除了SDRAM占用癿38個IO口外，其他100個IO全部擴展出來，為大家可以迕行自我擴展實驗做好了充分癿準備。 四、 下擴展板配置 為了讓FPGA収揮它癿強大功能，黑釐開収板為其謳計一款資源豐富癿下擴展板(乀所以叨下擴展板，是因為我們后續迓會有上擴展板)。下面我們就來簡單介終一下下擴展板癿資源配置。 支持網絡功能，配置ENC28J60網口芯片。ENC28J60是Microchip Technology(美國微芯科技公司)推出癿28引腳獨立以太網控刢器。目前市場上大部分以太網控刢器癿封裝均赸過80引腳，而符吅IEEE 802.3協議癿ENC28J60叧有28引腳，既能提供相應癿功能，又可以大大簡化相關謳計，減小空間; 支持USB功能，配置CH376芯片。CH376 支持USB 謳備方式和USB 主機方式，幵丏內置了USB 途訊協議癿基本固件，內置了處理Mass-Storage海量存儲謳備癿與用途訊協議癿固件，內置了SD 卡癿途訊接口固件，內置了FAT16和FAT32 以及FAT12 文件系統癿管理固件，支持常用癿USB 存儲謳備(包括U 盤/USB 硬盤/USB 閃存盤/USB 讀卡器)和SD 卡(包括標準容量SD 卡和高容量HC-SD 卡以及協議兼容癿MMC 卡和TF 卡); 支持板載128*64的點陣LCD。ST7565P控刢芯片，內置DC/DC電路，途過軟件調節對比度。該芯片支持，幵口和串口丟種方式;
標簽： NIOSII 教程
上傳時間： 2013-11-23
上傳用戶：ouyangtongze
本文基于多端口網絡模型、腔模理論和分片法, 首次給出串行角饋微帶天線輸入阻抗的一種有效的理論分析方法, 導出其閉合表達式。實驗結果驗證了理論的正確性。采用本方法計算方便, 適于工程應用。
標簽： 串行 微帶天線 分 實驗
上傳時間： 2013-11-05
上傳用戶：YKLMC
設計了Ka波段螺旋線行波管的慢波結構,分析其色散特性曲線和耦合阻抗,對高頻系統進行了優化;利用PIC粒子模擬得到在工作頻帶內飽和輸出功率＞73.5 W,增益畸變＜2%,并對試制樣管進行了試驗,測得在工作頻帶內輸出功率＞45 W,電子效率＞12.5%,采用4級降壓收集極后總效率大于40%,最后對模擬結果和實測結果的差異原因進行了簡單分析。
標簽： 行波管 慢波 模擬設計
上傳時間： 2013-12-14
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介紹了SoPC（System on a Programmable Chip）系統的概念和特點，給出了基于PLB總線的異步串行通信（UART）IP核的硬件設計和實現。通過將設計好的UART IP核集成到SoPC系統中加以驗證，證明了所設計的UART IP核可以正常工作。該設計方案為其他基于SoPC系統IP核的開發提供了一定的參考。
標簽： SOPC IP核 異步串行通信
上傳時間： 2013-11-12
上傳用戶：894448095
利用帶線結環行器的相關理論，設計了870～880MHz 結環行器，最后實現的環行器在0.5～1.5GHz內，插入損耗≤0.4dB，最小隔離度≥ 20dB，電壓駐波比≤ 1.20，符合基站用環行器的技術指標.
標簽： CDMA 870 880 MHz
上傳時間： 2014-03-25
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