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遠(yuǎn)(yuǎn)程視頻監(jiān)(jiān)控系統(tǒng)(tǒng)

  • C語言生成1-n的序列

    輸入整數(shù)n,生成1,2,3...n這n個(gè)數(shù)字任意排列組合的所有序列

    標(biāo)簽: C語言 序列

    上傳時(shí)間: 2020-10-18

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  • TCPIP詳解 卷2實(shí)現(xiàn)

    1.2 源代碼表示不考慮主題,列舉 15 000行源代碼本身就是一件難事。下面是所有源代碼都使用的文本格式:1.2.1 將擁塞窗口設(shè)置為13 8 7 - 3 8 8 這是文件t c p _ s u b r . c中的函數(shù)t c p _ q u e n c h。這些源文件名引用4 . 4 B S D - L i t e發(fā)布的文件。4 . 4 B S D在1 . 1 3節(jié)中討論。每個(gè)非空白行都有編號(hào)。正文所描述的代碼的起始和結(jié)束位置的行號(hào)記于行開始處,如本段所示。有時(shí)在段前有一個(gè)簡(jiǎn)短的描述性題頭,對(duì)所描述的代碼提供一個(gè)概述。這些源代碼同4 . 4 B S D - L i t e發(fā)行版一樣,偶爾也包含一些錯(cuò)誤,在遇到時(shí)我們會(huì)提出來并加以討論,偶爾還包括一些原作者的編者評(píng)論。這些代碼已通過了 G N U縮進(jìn)程序的運(yùn)行,使它們從版面上看起來具有一致性。制表符的位置被設(shè)置成 4個(gè)欄的界線使得這些行在一個(gè)頁面中顯示得很合適。在定義常量時(shí),有些 # i f d e f語句和它們的對(duì)應(yīng)語句 # e n d i f被刪去(如:G A T E W A Y和M R O U T I N G,因?yàn)槲覀兗僭O(shè)系統(tǒng)被作為一個(gè)路由器或多播路由器 )。所有r e g i s t e r說明符被刪去。有些地方加了一些注釋,并且一些注釋中的印刷錯(cuò)誤被修改了,但代碼的其他部分被保留下來。這些函數(shù)大小不一,從幾行 (如前面的t c p _ q u e n c h)到最大11 0 0行(t c p _ i n p u t)。超過大約4 0行的函數(shù)一般被分成段,一段一段地顯示。雖然盡量使代碼和相應(yīng)的描述文字放在同一頁或?qū)﹂_的兩頁上,但為了節(jié)約版面,不可能完全做到。本書中有很多對(duì)其他函數(shù)的交叉引用。為了避免給每個(gè)引用都添加一個(gè)圖號(hào)和頁碼,書封底內(nèi)頁中有一個(gè)本書中描述的所有函數(shù)和宏的字母交叉引用表和描述的起始頁碼。因?yàn)楸緯脑创a來自公開的 4 . 4 B S D _ L i t e版,因此很容易獲得它的一個(gè)拷貝:附錄 B詳細(xì)說明了各種方法。當(dāng)你閱讀文章時(shí),有時(shí)它會(huì)幫助你搜索一個(gè)在線拷貝 [例如U n i x程序grep ( 1 )]。描述一個(gè)源代碼模塊的各章通常以所討論的源文件的列表開始,接著是全局變量、代碼維護(hù)的相關(guān)統(tǒng)計(jì)以及一個(gè)實(shí)際系統(tǒng)的一些例子統(tǒng)計(jì),最后是與所描述協(xié)議相關(guān)的 S N M P變量。全局變量的定義通常跨越各種源文件和頭文件,因此我們將它們集中到的一個(gè)表中以便于參考。這樣顯示所有的統(tǒng)計(jì),簡(jiǎn)化了后面當(dāng)統(tǒng)計(jì)更新時(shí)對(duì)代碼的討論。卷 1的第2 5章提供了S N M P的所有細(xì)節(jié)。我們?cè)诒疚闹嘘P(guān)心的是由內(nèi)核中的 T C P / I P例程維護(hù)的、支持在系統(tǒng)上運(yùn)行的S N M P代理的信息。TCP IP詳解 卷1協(xié)議 :http://dl.21ic.com/download/tcpip-288223.html TCP IP詳解 卷2實(shí)現(xiàn) :http://dl.21ic.com/download/tcpip-288224.html TCPIP詳解卷三:TCP事務(wù)協(xié)議,HTTP,NNTP和UNIX域協(xié)議 :http://dl.21ic.com/download/tcpip-288225.html 

    標(biāo)簽: tcp-ip 實(shí)現(xiàn)

    上傳時(shí)間: 2022-07-27

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  • 基于FPGA的FFT數(shù)字處理器的硬件實(shí)現(xiàn)

    DFT(Discrete Fourier Transformation)是數(shù)字信號(hào)分析與處理如圖形、語音及圖像等領(lǐng)域的重要變換工具,直接計(jì)算DFT的計(jì)算量與變換區(qū)間長(zhǎng)度N的平方成正比.當(dāng)N較大時(shí),因計(jì)算量太大,直接用DFT算法進(jìn)行譜分析和喜好的實(shí)時(shí)處理是不切實(shí)際的.快速傅里葉變換(Fast Fourier Transformation,簡(jiǎn)稱FFT)使DFT運(yùn)算效率提高1~2個(gè)數(shù)量級(jí).本文的目的就是研究如何應(yīng)用FPGA這種大規(guī)模可編程邏輯器件實(shí)現(xiàn)FFT的算法.本設(shè)計(jì)主要采用先進(jìn)的基-4DIT算法研制一個(gè)具有實(shí)用價(jià)值的FFT實(shí)時(shí)硬件處理器.在FFT實(shí)時(shí)硬件處理器的設(shè)計(jì)實(shí)現(xiàn)過程中,利用遞歸結(jié)構(gòu)以及成組浮點(diǎn)制運(yùn)算方式,解決了蝶形計(jì)算、數(shù)據(jù)傳輸和存儲(chǔ)操作協(xié)調(diào)一致問題.合理地解決了位增長(zhǎng)問題.同時(shí),采用并行高密度乘法器和流水線(pipeline)工作方式,并將雙端口RAM、只讀ROM全部?jī)?nèi)置在FPGA芯片內(nèi)部,使整個(gè)系統(tǒng)的數(shù)據(jù)交換和處理速度得以很大提高,實(shí)際合理地解決了資源和速度之間相互制約的問題.本設(shè)計(jì)采用Verilog HDL硬件描述語言進(jìn)行設(shè)計(jì),由于在設(shè)計(jì)中采用Xilinx公司提供的稱為Core的IP功能塊極大地提高了設(shè)計(jì)效率.

    標(biāo)簽: FPGA FFT 數(shù)字處理器 硬件實(shí)現(xiàn)

    上傳時(shí)間: 2013-06-20

    上傳用戶:小碼農(nóng)lz

  • proteus 實(shí)驗(yàn)程序例子3

    為優(yōu)秀的單片機(jī)仿真軟件proteus寫的實(shí)驗(yàn)程序例子\r\n不但可以仿真mcu,外圍器件也可以仿真\r\n閃爍燈的實(shí)驗(yàn)\r\n

    標(biāo)簽: proteus 實(shí)驗(yàn) 程序

    上傳時(shí)間: 2013-08-08

    上傳用戶:愛死愛死

  • proteus寫的實(shí)驗(yàn)程序例子集合4

    為優(yōu)秀的單片機(jī)仿真軟件proteus寫的實(shí)驗(yàn)程序例子\r\n不但可以仿真mcu,外圍器件也可以仿真\r\n跑馬燈的實(shí)驗(yàn)\r\n

    標(biāo)簽: proteus 實(shí)驗(yàn) 程序

    上傳時(shí)間: 2013-08-10

    上傳用戶:1427796291

  • FSK/PSK調(diào)制頂層文件

    FSK/PSK調(diào)制頂層文件\r\n,正弦波模塊 \r\n,正弦波模塊初始化文件\r\n,振幅調(diào)整及波形選擇模塊\r\n,頻率顯示值地址產(chǎn)生模塊\r\n,頻率步進(jìn)鍵核心模塊\r\n,彈跳消除電路

    標(biāo)簽: FSK PSK 調(diào)制

    上傳時(shí)間: 2013-08-14

    上傳用戶:sdq_123

  • 電子書:CPLD_pkg_IO_Matrix pdf

    CPLD_pkg_IO_Matrix.pdf\r\n一本入門實(shí)踐的好書\r\n值得一看的\r\n希望對(duì)大家有所幫助

    標(biāo)簽: CPLD_pkg_IO_Matrix 電子書

    上傳時(shí)間: 2013-08-30

    上傳用戶:yepeng139

  • CPLD源碼 達(dá)芬奇開發(fā)套件

    CPLD源碼 達(dá)芬奇開發(fā)套件 很好 \r\n查詢更多詞典\r\n搜索因特網(wǎng)

    標(biāo)簽: CPLD 源碼 開發(fā)套件 達(dá)芬奇

    上傳時(shí)間: 2013-09-01

    上傳用戶:pei5

  • 制作CPLD電路實(shí)驗(yàn)板的方法及步驟

    本文詳細(xì)介紹了制作電路板的方法及步驟.\r\n實(shí)驗(yàn)板的功能\r\n這個(gè)實(shí)驗(yàn)板可以做如下實(shí)驗(yàn):\r\n1.可以進(jìn)行運(yùn)算器(加、減、乘和除法)、比較器、譯碼器、編碼器、選擇器、分配器和一般組合電路的實(shí)驗(yàn)\r\n2.可以進(jìn)行觸發(fā)器、寄存器、計(jì)數(shù)器和一般時(shí)序電路的實(shí)驗(yàn)\r\n3.可以進(jìn)行頻率計(jì)電路、時(shí)鐘電路、計(jì)時(shí)電路、交通燈等復(fù)雜數(shù)字系統(tǒng)的實(shí)驗(yàn)\r\n4.加擴(kuò)展板可以進(jìn)行A/D、D/A、串行E2ROM和8031單片機(jī)等方面的實(shí)驗(yàn)\r\n

    標(biāo)簽: CPLD 電路 實(shí)驗(yàn)板

    上傳時(shí)間: 2013-09-01

    上傳用戶:吾學(xué)吾舞

  • viterbi譯碼器的一種fpga實(shí)現(xiàn)

    viterbi譯碼器的一種fpga實(shí)現(xiàn).是一個(gè)cs252\r\n的project的result\r\n供大家研究用

    標(biāo)簽: viterbi fpga 譯碼器

    上傳時(shí)間: 2013-09-06

    上傳用戶:dsgkjgkjg

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