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2812例程以及 控制直流無(wú)刷電機(jī)程序

2812例程以及控制直流無(wú)刷電機(jī)程序ICETEK-F2812-BCM：該文件夾里有個(gè)在DSP_F2812平臺(tái)下建立起來(lái)的無(wú)刷直流電機(jī)顯式模型預(yù)測(cè)控制的實(shí)驗(yàn)工程，路徑是\ICETEK-F2812-BCM\DMC31\c28\v32x\sys\Lab4-SpeedPID，可以作為學(xué)習(xí)和參考。

標(biāo)簽： 2812 控制 直流無(wú)刷電機(jī) 程序

上傳時(shí)間： 2013-04-24

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51單片機(jī)實(shí)驗(yàn)例程

51單片機(jī)開(kāi)發(fā)例程，有圖片和文字說(shuō)明，配合hc6800開(kāi)發(fā)板使用更佳

標(biāo)簽： 51單片機(jī)實(shí)驗(yàn)

上傳時(shí)間： 2013-04-24

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用于FPGA的N+0.5分頻代碼

用于FPGA的N+0.5分頻代碼，可以用來(lái)進(jìn)行非整數(shù)分頻！

標(biāo)簽： FPGA 0.5 分頻 代碼

上傳時(shí)間： 2013-08-06

上傳用戶(hù)：weixiao99

基于FPGA 的出租車(chē)計(jì)價(jià)器系統(tǒng)設(shè)計(jì)

摘要: 本文介紹了基于FPGA 的出租車(chē)計(jì)價(jià)器系統(tǒng)的功能、設(shè)計(jì)思想和實(shí)現(xiàn), 該設(shè)計(jì)采用模塊化自上而下的層次化設(shè)計(jì),頂\r\n層設(shè)計(jì)有5 個(gè)模塊,各模塊中子模塊采用VHDL 或圖形法設(shè)計(jì)。在Max+plusⅡ下實(shí)現(xiàn)編譯、仿真等,最后成功下載到FPGA 芯\r\n片中。完成了可預(yù)置自動(dòng)計(jì)費(fèi)、自動(dòng)計(jì)程、計(jì)時(shí)、空車(chē)顯示等多功能計(jì)價(jià)器。由于FPGA 具有高密度、可編程及有強(qiáng)大的軟件\r\n支持等特點(diǎn),所以該設(shè)計(jì)具有功能強(qiáng)、靈活和可靠性高等特點(diǎn),具有一定的實(shí)用價(jià)值。

標(biāo)簽： FPGA 出租車(chē)計(jì)價(jià)器 系統(tǒng)設(shè)計(jì)

上傳時(shí)間： 2013-08-09

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FPGA開(kāi)發(fā)板上自帶的LED測(cè)試?yán)?/a>

標(biāo)簽： FPGA LED 開(kāi)發(fā)板 測(cè)試

上傳時(shí)間： 2013-08-13

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LCD CPLD(復(fù)雜可編程邏輯器件)

LCD 因其輕薄短小,低功耗,無(wú)輻射,平面直角顯示,以及影像穩(wěn)定等特點(diǎn),當(dāng)今應(yīng)用非常廣泛。CPLD(復(fù)雜可編程邏輯器件) 是一種具有豐富可編程功能引腳的可編程邏輯器件,不僅可實(shí)現(xiàn)常規(guī)的邏輯器件功能,還可以實(shí)現(xiàn)復(fù)雜而獨(dú)特的時(shí)序邏輯功能。并且具有ISP (在線(xiàn)可編\\r\\n程) [1 ] 功能,便于進(jìn)行系統(tǒng)設(shè)計(jì)和現(xiàn)場(chǎng)對(duì)系統(tǒng)進(jìn)行功能修改、調(diào)試、升級(jí)。通常CPLD 芯片都有著上萬(wàn)次的重寫(xiě)次數(shù),即用CPLD[ 2 ] 進(jìn)行硬件設(shè)計(jì),就像軟件設(shè)計(jì)一樣靈活、方便。而現(xiàn)今LCD的控制大都采用

標(biāo)簽： CPLD LCD 可編程邏輯器件

上傳時(shí)間： 2013-08-16

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arm7例程：proteus的ARM學(xué)習(xí)歷程

arm7例程：proteus的ARM學(xué)習(xí)歷程，有相關(guān)的電路和仿真程序，方便初學(xué)者的仿真學(xué)習(xí)。

標(biāo)簽： proteus arm7 ARM

上傳時(shí)間： 2013-08-17

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多路18b20測(cè)溫顯示系統(tǒng),可同時(shí)測(cè)量n個(gè)第三18b20

多路18b20測(cè)溫顯示系統(tǒng),可同時(shí)測(cè)量n個(gè)第三18b20

標(biāo)簽： 18b20 多路 測(cè)溫 顯示系統(tǒng)

上傳時(shí)間： 2013-08-21

上傳用戶(hù)：zhangchu0807

使8051能訪問(wèn)整個(gè)128KB的RAM空間和128KB的FlashRom空間,在CPLD內(nèi)建兩個(gè)寄存器\r\n

8051工作于11.0592MHZ,RAM擴(kuò)展為128KB的628128,FlashRom擴(kuò)展為128KB的AT29C010A\r\n 128KB的RAM分成4個(gè)區(qū)(Bank) 地址分配為0x0000-0x7FFF\r\n 128KB的FlashRom分成8個(gè)區(qū)(Bank) 地址分配為0x8000-0xBFFF\r\n 為了使8051能訪問(wèn)整個(gè)128KB的RAM空間和128KB的FlashRom空間,在CPLD內(nèi)建兩個(gè)寄存器\r\n RamBankReg和FlashRomBankReg用于存放高位地址

標(biāo)簽： 128 FlashRom 8051 KB

上傳時(shí)間： 2013-08-30

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Altera FPGA開(kāi)發(fā)工具的詳細(xì)教程

Altera FPGA \r\n的開(kāi)發(fā)工具的詳細(xì)教程，有例程與步奏

標(biāo)簽： Altera FPGA 開(kāi)發(fā)工具 教程

上傳時(shí)間： 2013-08-31

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