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邏輯設(shè)(shè)計(jì)

  • CAN波特率計算

    CAN波特率計算軟件 為了方便計算出 NXP 系列CAN 控制器(不包括NXP ARM 內(nèi)嵌的CAN 控制器)的波特率

    標(biāo)簽： CAN 波特率

    上傳時間： 2016-11-24

    上傳用戶：test1111

  • 超級兔子魔法設(shè)定 v5.88

    超級兔子魔法設(shè)定 v5.88 繁體中文版 含序號

    標(biāo)簽： v5 88

    上傳時間： 2017-05-05

    上傳用戶：kiili2

  • J.K. Rowling Harry Potter Prequel

    J.K. Rowling - HP 0 - Harry Potter Prequel.pdf

    標(biāo)簽： J.K. Rowling Prequel Potter Harry

    上傳時間： 2020-01-03

    上傳用戶：nothingtiger

  • j-link V466

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    標(biāo)簽： j-link V466

    上傳時間： 2021-03-23

    上傳用戶：koko440

  • 高速電路設(shè)計 詳細(xì)基礎(chǔ)理論知識

    設(shè)計高速電路必須考慮高速訊 號所引發(fā)的電磁干擾、阻抗匹配及串音等效應(yīng)，所以訊號完整性 (signal  integrity)將是考量設(shè)計電路優(yōu)劣的一項重要指標(biāo)，電路日異複雜必須仰賴可 靠的軟體來幫忙分析這些複雜的效應(yīng)，才比較可能獲得高品質(zhì)且可靠的設(shè)計， 因此熟悉軟體的使用也將是重要的研究項目之一。另外了解高速訊號所引發(fā)之 各種效應(yīng)(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設(shè)計的重點之一。目前高速示波器的功能越來越多，使用上很複雜，必須事先 進(jìn)修學(xué)習(xí)，否則無法全盤了解儀器之功能，因而無法有效發(fā)揮儀器的量測功能。 其次就是高速訊號量測與介面的一些測試規(guī)範(fàn)也必須熟悉，像眼圖分析，探針 效應(yīng)，抖動(jitter)測量規(guī)範(fàn)及高速串列介面量測規(guī)範(fàn)等實務(wù)技術(shù)，必須充分 了解研究學(xué)習(xí)，進(jìn)而才可設(shè)計出優(yōu)良之教學(xué)教材及教具。

    標(biāo)簽： 高速電路

    上傳時間： 2021-11-02

    上傳用戶：jiabin

  • 華為開關(guān)電源電感器設(shè)計.pdf

    華為開關(guān)電源電感器設(shè)計 正激式開關(guān)電源變壓器設(shè)計步驟

    標(biāo)簽： 華為 開關(guān)電源

    上傳時間： 2021-12-03

    上傳用戶：fliang

  • SAE-J-協(xié)議培訓(xùn)教程-中文

    SAE-J-協(xié)議培訓(xùn)教程-中文，有需要的可以參考！

    標(biāo)簽： SAE-J-協(xié)議

    上傳時間： 2022-02-04

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  • J-LINK下載器

    首先下載軟件，解壓軟件，安裝在程序中找到SEGGER,選里面的J-FLASH，進(jìn)入界面，剛開始的那個界面可以忽略，不用建project也可以；單擊菜單欄的“Options---Project settings”打開設(shè)置，進(jìn)行jlink配置;正在General選項，選擇“USB”，一般都是默認(rèn)配置，確認(rèn)一下即可;然后在CPU選項，選擇芯片型號，先選擇“Device”才能選擇芯片型號，芯片型號，要根據(jù)你使用的芯片進(jìn)行選擇;在Target interface選項 里面選擇SWD模式;首先Target里面選“Connection”連接目標(biāo)芯片，然后 Target--Auto進(jìn)行程序燒寫;首先Target里面選擇“Connection”連接目標(biāo)芯片，然后 Target--Auto進(jìn)行程序燒寫.SEGGER J-Links are the most widely used line of debug probes available today. They've proven their value for more than 10 years in embedded development. This popularity stems from the unparalleled performance, extensive feature set, large number of supported CPUs, and compatibility with all popular development environments.

    標(biāo)簽： JLINK

    上傳時間： 2022-03-22

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  • cadence-allegro16.6高級教程

    主要內(nèi)容介紹 Allegro 如何載入 Netlist，進(jìn)而認(rèn)識新式轉(zhuǎn)法和舊式轉(zhuǎn)法有何不同及優(yōu)缺點的分析，透過本章學(xué)習(xí)可以對 Allegro 和 Capture 之間的互動關(guān)係，同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉(zhuǎn)入動作只是針對由 Capture（線路圖部分）產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro（Layout部分）1． 在 OrCAD Capture 中設(shè)計好線路圖。2． 然後由 OrCAD Capture 產(chǎn)生 Netlist（annotate 是在進(jìn)行線路圖根據(jù)第五步產(chǎn)生的資料進(jìn)行編改）。 3． 把產(chǎn)生的 Netlist 轉(zhuǎn)入 Allegro（layout 工作系統(tǒng)）。 4． 在 Allegro 中進(jìn)行 PCB 的 layout。 5． 把在 Allegro 中產(chǎn)生的 back annotate（Logic）轉(zhuǎn)出（在實際 layout 時可能對原有的 Netlist 有改動過），並轉(zhuǎn)入 OrCAD Capture 裏進(jìn)行回編。

    標(biāo)簽： cadence allegro

    上傳時間： 2022-04-28

    上傳用戶：kingwide

  • 芯達(dá)STM32入門系列教程之二《如何安裝J-Link驅(qū)動軟件》總結(jié)

    該文檔為芯達(dá)STM32入門系列教程之二《如何安裝J-Link驅(qū)動軟件》總結(jié)文檔，是一份很不錯的參考資料，具有較高參考價值，感興趣的可以下載看看………………

    標(biāo)簽： stm32

    上傳時間： 2022-05-01

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