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  • ZigBee開(kāi)發(fā)套件內(nèi)容

    ZigBee開(kāi)發(fā)套件內(nèi)容開(kāi)發(fā)套件

    標(biāo)簽: ZigBee 開(kāi)發(fā)套件

    上傳時(shí)間: 2013-11-04

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  • SF-CY3 FPGA套件開(kāi)發(fā)指南Ver6.00 (by特權(quán)同學(xué))

    SF-CY3 FPGA套件開(kāi)發(fā)指南Ver6.00 (by特權(quán)同學(xué))

    標(biāo)簽: SF-CY FPGA 6.00 Ver

    上傳時(shí)間: 2014-01-25

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  • EDA技術(shù)實(shí)用教程VHDL版本課件

    EDA技術(shù)實(shí)用教程VHDL版本課件

    標(biāo)簽: VHDL EDA 實(shí)用教程 版本

    上傳時(shí)間: 2013-10-10

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  • 夏宇聞老師優(yōu)秀的verilog教程課件

          本資料是關(guān)于夏宇聞老師優(yōu)秀的verilog教程課件,其中包括verilog講稿PPT、verilog課件、verilog例題等。

    標(biāo)簽: verilog 教程

    上傳時(shí)間: 2013-11-21

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  • 《EDA原理及應(yīng)用》(何賓教授)實(shí)驗(yàn)課件

          本資料是《EDA原理及應(yīng)用》一書(shū)的配套實(shí)驗(yàn)課件,一共有18個(gè)實(shí)驗(yàn)。大家可以參考著自己做!當(dāng)然做完后也可以到電子發(fā)燒友網(wǎng)站FPGA技術(shù)聯(lián)盟QQ群(263281510)討論討論...

    標(biāo)簽: EDA 實(shí)驗(yàn)

    上傳時(shí)間: 2013-11-10

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  • 《EDA原理及應(yīng)用》(何賓教授)課件 PPT

      第1章-EDA設(shè)計(jì)導(dǎo)論   第2章-可編程邏輯器件設(shè)計(jì)方法   第3章-VHDL語(yǔ)言基礎(chǔ)   第4章-數(shù)字邏輯單元設(shè)計(jì)   第5章-VHDL高級(jí)設(shè)計(jì)技術(shù)   第6章-基于HDL和原理圖的設(shè)計(jì)輸入   第7章-設(shè)計(jì)綜合和行為仿真   第8章-設(shè)計(jì)實(shí)現(xiàn)和時(shí)序仿真   第9章-設(shè)計(jì)下載和調(diào)試   第10章-設(shè)計(jì)示例(數(shù)字鐘、UART、數(shù)字電壓表)     點(diǎn)擊鏈接,【《EDA原理及應(yīng)用》(何賓教授)實(shí)驗(yàn)課件下載 】

    標(biāo)簽: EDA

    上傳時(shí)間: 2013-11-10

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  • cpld開(kāi)發(fā)套件光盤(pán)說(shuō)明

    cpld開(kāi)發(fā)套件光盤(pán)說(shuō)明

    標(biāo)簽: cpld 開(kāi)發(fā)套件 光盤(pán)

    上傳時(shí)間: 2013-10-24

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  • FPGA電子課件_共8課

    學(xué)習(xí)FPGA的課件,內(nèi)容含有軟件的介紹,Altera和Xilinx芯片的介紹,以及VHDL的編程風(fēng)格。和一些實(shí)例講解。

    標(biāo)簽: FPGA 電子課件

    上傳時(shí)間: 2013-11-10

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  • PCB LAYOUT設(shè)計(jì)規(guī)范手冊(cè)

      PCB Layout Rule Rev1.70, 規(guī)範(fàn)內(nèi)容如附件所示, 其中分為:   (1) ”P(pán)CB LAYOUT 基本規(guī)範(fàn)”:為R&D Layout時(shí)必須遵守的事項(xiàng), 否則SMT,DIP,裁板時(shí)無(wú)法生產(chǎn).   (2) “錫偷LAYOUT RULE建議規(guī)範(fàn)”: 加適合的錫偷可降低短路及錫球.   (3) “PCB LAYOUT 建議規(guī)範(fàn)”:為製造單位為提高量產(chǎn)良率,建議R&D在design階段即加入PCB Layout.   (4) ”零件選用建議規(guī)範(fàn)”: Connector零件在未來(lái)應(yīng)用逐漸廣泛, 又是SMT生產(chǎn)時(shí)是偏移及置件不良的主因,故製造希望R&D及採(cǎi)購(gòu)在購(gòu)買異形零件時(shí)能顧慮製造的需求, 提高自動(dòng)置件的比例.

    標(biāo)簽: LAYOUT PCB 設(shè)計(jì)規(guī)范

    上傳時(shí)間: 2013-11-03

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  • VC控制LabVIEW的控件

    VC控制LabVIEW的控件

    標(biāo)簽: LabVIEW 控制 控件

    上傳時(shí)間: 2013-10-27

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