采用Altera公司的FPGA芯片,在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路
采用Altera公司的FPGA芯片,在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路...
采用Altera公司的FPGA芯片,在MAX+plus II軟件平臺(tái)上實(shí)現(xiàn)多路HDLC電路...
實(shí)現(xiàn)8通道模擬/數(shù)字轉(zhuǎn)換和數(shù)字/模擬轉(zhuǎn)換的例子,采用ISA總線控制邏輯....
基于cpld的pwm控制設(shè)計(jì)\r\n采用vhdl.verilog語言設(shè)計(jì)\r\n對(duì)大家比較有用...
介紹了3DES加密算法的原理并詳盡描述了該算法的FPGA設(shè)計(jì)實(shí)現(xiàn)。采用了狀態(tài)機(jī)和流水線技術(shù),使得在面積和速度上達(dá)到最佳優(yōu)化;添加了輸入和輸出接口的設(shè)計(jì)以增強(qiáng)該算法應(yīng)用的靈活性。各模塊均用硬件描述語言實(shí)現(xiàn),最終下載到FPGA芯片Stratix EP1S25F780C5中。...
fpga 實(shí)現(xiàn)電機(jī)控制。采用xilinx 的microblaze...