本文以符號多項式理論為基礎，從理論上論證了任意長度比特組合的CRC校驗碼的并行算法，提出了并行CRC計算的數學模型，并且以8位二進制序列(即一個字節)為例，介紹了利用此數學模型計算校驗碼的方法，最后給出了與此算法相對應的VHDL模型。經過對實驗數據的對比分析，表明文中所提并行CRC算法的關鍵路徑延遲和硬件面積都得到了優化，以Top-Down設計方法給出了一種HDLC協議控制器的設計方案，用VHDL語言進行了行為級描述，采用Xilinx公司的FPGA產品進行實現。
標簽： FPGA HDLC 協議控制器
上傳時間： 2013-06-09
上傳用戶：s363994250
基于FPGA技術的HDLC幀收發器的設計與實現
標簽： FPGA HDLC 幀 收發器
上傳時間： 2013-05-24
上傳用戶：lindor
采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺上實現多路HDLC電路
標簽： Altera FPGA HDLC plus
上傳時間： 2013-08-16
上傳用戶：ommshaggar
介紹了HDLC協議RS485總線控制器的FPGA實現
標簽： HDLC FPGA 485 RS
上傳時間： 2013-11-04
上傳用戶：heart_2007
為了滿足某測控平臺的設計要求，設計并實現了基于FPGA的六通道HDLC并行通信系統。該系統以FPGA為核心，包括FPGA、DSP、485轉換接口等部分。給出了系統的電路設計、關鍵模塊及軟件流程圖。測試結果表明，系統通訊速度為1 Mb/s，并且工作穩定，目前該設計已經成功應用于某樣機中。
標簽： FPGA HDLC 多通道 通信
上傳時間： 2013-11-25
上傳用戶：王成林。
上傳時間： 2013-10-18
上傳用戶：zhengjian
上傳時間： 2013-10-12
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一個HDLC的接受模塊代碼
標簽： HDLC 模塊 代碼
上傳時間： 2013-12-19
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一個HDLC發送模塊的編碼
標簽： HDLC 發送 模塊 編碼
上傳時間： 2013-12-11
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MPC860的SCC2配置HDLC示例代碼
標簽： HDLC SCC2 MPC 860
上傳時間： 2015-01-21
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