利用計算機編程實現加性干擾信號的維納濾波。將計算機模擬實驗結果與理論分析結果相比較，分析影響維納濾波效果的各種因素，從而加深對維納濾波的理解。
標簽： 計算機 編程實現 干擾信號 實驗結果
上傳時間： 2014-12-07
上傳用戶：xc216
Volterra自適應預測的 matlab 程序,用于自適應預測測試和混沌序列的相空間重構（轉）
標簽： Volterra matlab 程序 測試
上傳時間： 2013-12-10
上傳用戶：gaome
C-C法重構相空間，源自研學論壇
標簽： C-C
上傳時間： 2015-05-19
上傳用戶：epson850
數字瑣相環DPLL的VERLOG代碼，MODELSIM下的工程，有測試文件
標簽： VERLOG DPLL 數字 代碼
上傳時間： 2014-01-13
上傳用戶：Thuan
GSMGPRSRFORUM相關信息測試與結過
標簽： GSMGPRSRFORUM
上傳時間： 2015-05-20
上傳用戶：jqy_china
PCB Layout Rule Rev1.70, 規範內容如附件所示, 其中分為: 為確保產品之製造性, R&D在設計階段必須遵循Layout相關規範, 以利製造單位能順利生產, 確保產品良率, 降低因設計而重工之浪費.
標簽： Layout 1.70 Rule PCB
上傳時間： 2015-05-23
上傳用戶：it男一枚
7400 2輸入端四與非門 7401 集電極開路2輸入端四與非門 7402 2輸入端四或非門 7403 集電極開路2輸入端四與非門 7404 六反相器 7405 集電極開路六反相器 7406 集電極開路六反相高壓驅動器 7407 集電極開路六正相高壓驅動器 7408 2輸入端四與門 7409 集電極開路2輸入端四與門 7410 3輸入端3與非門 74107 帶清除主從雙J-K觸發器 74109 帶預置清除正觸發雙J-K觸發器 7411 3輸入端3與門 74112 帶預置清除負觸發雙J-K觸發器 7412 開路輸出3輸入端三與非門 74121 單穩態多諧振蕩器 74122 可再觸發單穩態多諧振蕩器 74123 雙可再觸發單穩態多諧振蕩器 74125 三態輸出高有效四總線緩沖門 74126 三態輸出低有效四總線緩沖門 7413 4輸入端雙與非施密特觸發器 74132 2輸入端四與非施密特觸發器 74133 13輸入端與非門 74136 四異或門 74138 3-8線譯碼器/復工器 74139 雙2-4線譯碼器/復工器 7414 六反相施密特觸發器 74145 BCD—十進制譯碼/驅動器 7415 開路輸出3輸入端三與門 74150 16選1數據選擇/多路開關 74151 8選1數據選擇器 74153 雙4選1數據選擇器 74154 4線—16線譯碼器
標簽： 輸入端 7400 7401 7402
上傳時間： 2014-01-10
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這是一個用匯編實現的在文件中查找相匹配的字符串的程序
標簽： 匯編 字符串 程序
上傳時間： 2015-05-27
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FPGA數字移相器,編程環境為QUIRTE2,編程語言采用硬件描述語言vhdl
標簽： QUIRTE FPGA vhdl 數字移相器
上傳時間： 2013-12-19
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轉子動平衡的幾個優化算法 影響系數法 定位相角最佳算法
標簽： 轉子 動平衡 優化算法 系數
上傳時間： 2015-05-29
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