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門電路邏輯

簡單的串列埠自我測試持式測試硬體電路是否正確

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組合語言的大數(shù)加減乘除適合組語初學(xué)者訓(xùn)練計算機科學(xué)的運算邏輯

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完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實現(xiàn)精簡電路

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ALTERA PWM電路這是一個ALTERA的PWM電路

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使用FPGA設(shè)計WiMax接收機之OFDM同步硬體電路(內(nèi)附VHDL code)

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一個可以計算分壓電路的源碼。可透過輸出與輸入電壓

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是一個用verilog寫成的加法器電路,可把七個元件加起來

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使用硬體描述語言HDL 設(shè)計硬體電路

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5 bits 的加法器與減法器合併電路之原始程式製作

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verilog除頻器可用於編碼段運用可以穩(wěn)定電路設(shè)計

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