隨著電力電子技術的迅速發展，雙向DC/DC變換器的應用日益廣泛。尤其是軟開關技術的出現，使雙向DC/DC變換器不斷朝著高效化、小型化、高頻化和高性能化的方向發展，軟開關技術的應用可以降低雙向DC/DC變換器的開關損耗，提高變換器的工作效率，為變換器的高頻化提供可能性，從而減小變換器的體積，提高變換器的動態性能。雙向DC/DC變換器在直流不停電電源系統、航空電源系統、電動汽車等車載電源系統、直流功率放大器以及蓄電池儲能等場合都得到了廣泛的應用。 本論文首先在研究硬開關的缺陷上，提出軟開關技術；然后在研究雙向DC/DC變換器的基本工作原理的基礎上，對雙向DC/DC變換器的應用及軟開關雙向DC/DC變換器的幾種拓撲結構進一步闡述；把軟開關技術和雙向DC/DC變換器技術有機地結合在一起，提出一種新型的雙向DC/DC變換器的拓撲結構。該雙向DC/DC變換器的降壓變換電路采用移相控制ZVSPWMDC/DC變換器；升壓變換電路采用Boost升壓和推挽式升壓兩種變換器相結合的兩級升壓的新型變換器。 在分別對移相控制ZVSPWMDC/DC變換器和Boost推挽式DC/DC變換器的工作原理進行分析研究的基礎上，使用PSpice9.2計算機仿真軟件對變換器的主電路進行仿真和分析，驗證該新型雙向DC/DC變換器的拓撲結構設計的正確性和可行性。
上傳時間： 2013-04-24
上傳用戶：2525775
本課題是應北京奔馳--戴姆勒克萊斯勒汽車制造有限公司的要求而研究的一種射頻信號源。要求能產生并發射音樂調制的射頻信號，用于其車載收音機的性能和接收效果的測試，能使收音機連續搜臺，并且要分多個頻段對其收音機的中波段進行逐臺測試。因為以前的車載收音機都是通過電纜有線連接到其收音機上，但這樣往往得不到實際效果，而且使用麻煩，所以在設計系統時選擇使用無線射頻(調幅)信號源，這樣更容易讓該公司方便使用，系統中還設計了很簡潔的鍵盤和LCD交互界面，使工人操作時很容易上手。 在考慮系統方案的過程中，我們選擇了少有人涉及的丁類放大器作為首選的放大電路，并使用單片機作為控制器。單片機已經是一種很成熟的微處理器，能很方便的產生數字音樂信號。 本論文的安排如下： 首先概述數字功率放大器和射頻的發展及國內外發展情況。 第2章對論文的來源及整體方案做了簡要的介紹。 第3章對單片機數字部分做了詳細的論述，講述了數字信號的產生原理，分頻系數的確定，以及各個硬件的具體功能。 第4章將是本文的重點，論述了數字功率放大部分的數學原理，并詳細介紹了數字功放的原理。現在，數字功率放大器雖然在射頻領域少有具體應用，但數字世界的發展步伐將無法停止，這就要求對原有的傳統意義上的放大電路進行改進，具有一定的創新意義。 第5章對濾波網絡和輸出匹配網絡進行了深入的理論分析和研究，并將研究應用于實際，最終得到了比較滿意的現場效果。 最后一章總結了在實際研究中遇到的問題和解決方法，并對本課題的發展做了總結。
上傳時間： 2013-06-18
上傳用戶：moonkoo7
lm386小功率音頻放大器pdf文件，原理圖，電路圖。
上傳時間： 2013-06-29
上傳用戶：guh000
近年來隨著用電設備對供電電源的性能和可靠性要求越來越高，不間斷供電系統(UPS)得到了廣泛應用。UPS模塊化并聯可實現大容量供電和冗余供電，是提高UPS容量和可靠性的一條重要途徑，因而被公認為當今逆變技術發展的重要方向之一。 本文主要致力于無輸出隔離變壓器的逆變器并聯系統環流特性及其并聯控制實現的研究。首先探討了基于電壓電流雙閉環控制的逆變器控制設計方法，在確定雙閉環控制逆變器閉環傳遞函數并了解其等效輸出阻抗特性的基礎上，建立了基于等效輸出阻抗的并聯系統模型分析其環流特性，并提出了一種新的基于有功功率和無功功率的逆變器并聯控制方案，包括：基準電壓相位和幅值的調整，PI控制參數設計，有功和無功功率計算，逆變輸出電壓同步鎖相等。此外本文還特別討論了雙閉環控制逆變器輸出電壓直流分量產生原因，提出了逆變器輸出電壓直流分量檢測與高精度數字調節方法，研究了雙閉環控制逆變器并聯系統直流環流產生原因及其檢測與抑制方法。最后通過實驗和實驗波形驗證本文所介紹的逆變器并聯控制方案的可行性。
上傳時間： 2013-04-24
上傳用戶：ljthhhhhh123
隨著圖像處理技術的不斷發展，圖像處理技術在國民經濟和社會生活的各個方面都得到了廣泛的運用。與此同時，人們對圖像處理的要求也越來越高。傳統的數字圖像處理器件主要有專用集成芯片（Application Specific Integrated Circuit）和數字信號處理器（Digital Signal Process）。進入20世紀以來，伴隨著半導體技術的發展，現場可編程門陣列FPGA以其應用靈活、集成度高、功能強大、設計周期短、開發成本低的特點，越來越多地被應用在圖像處理領域。大量實踐證明，FPGA的并行處理能力與流水線作業能顯著地提高圖像處理的速度，因此基于FPGA的圖像處理系統有著廣闊的發展前景。 本文研究的是一個在嵌入式視頻監控系統下的圖像預處理子系統。首先實現了一個通用可重復配置的圖像處理算法研究硬件平臺，完成圖像的采集、接收、處理、存儲、輸出等功能。由于FPGA本身具有完全的可重復配置性，所以該架構的硬件平臺可以很方便的升級和重復配置。其次在該平臺上，本文使用Verilog HDL硬件語言在FPGA芯片上實現了多種圖像預處理算法。在實現過程中，為了充分發揮FPGA在并行處理方面的強大功能，本文對算法做了一定的改進，使其盡量能使用并行處理的方式來完成。實驗結果表明，本圖像預處理系統能在毫秒級高速地完成多種圖像算法，完全能夠滿足視頻監控系統50幀/秒的輸出要求。 最后根據視頻監控系統在實際運用中出現的噪聲類型多樣化的情況，我們設計了一種基于反饋理論的圖像處理效果控制模塊。該模塊能通過對處理后圖像峰值信噪比（PSNR）的分析，控制FPGA對下一幅圖像的噪聲采用更有針對性的圖像處理方法。
上傳時間： 2013-05-20
上傳用戶：gundamwzc
隨著無線通信技術的不斷發展和社會需求的日益增長，對通信系統的傳輸質量和容量的要求也越來越大。現代通信系統為了追求更高的數據速率和頻譜效率，更趨向于采用非恒定包絡的調制方式，而非恒定包絡調制方式對功率放大器的非線性非常敏感，加上現代通信系統對功率放大器的效率提出了更高的要求，以及功率放大器本身有限的線性度，這就使功率放大器線性化技術成為無線通信系統的關鍵技術之一。 本文對功率放大器的線性化技術進行了系統的研究。首先，介紹功率放大器的非線性特性、記憶效應產生原理和常見的各種線性化技術，重點研究了目前流行的自適應數字預失真技術原理。其次，介紹了功率放大器的無記憶模型和有記憶模型，以及兩種實用的預失真實現方法--查表法和多項式法，在此基礎上重點研究了基于QRD_RLS自適應算法的記憶多項式法預失真技術，對該算法進行了Matlab仿真分析，為后面的FPGA實現奠定基礎。最后，確定了數字預失真實現的架構，介紹了與QRD_RLS算法實現相關的CORDIC技術、復數Givens旋轉及Systolic陣等原理，詳細闡述了基于CORDIC技術的復數QRD_RLS算法的Systolic實現，從而在FPGA上實現了數字預失真。 在軟件無線電思想的指導下，本文利用System Generator軟件完成了基于QRD_RLS算法的記憶多項式法的數字預失真的FPGA設計，并且在硬件平臺上檢驗了預失真效果。
上傳時間： 2013-04-24
上傳用戶：84425894
GSM是全球使用最為廣泛的一種無線通信標準，不僅在民用領域，也在鐵路GSM-R等專用領域發揮著極為重要的作用。由于無線信道具有瑞利衰落和延時效應，在通信系統的收發兩端也存在不完全匹配等未知因素，因此接收的信號疊加有各種誤差因素的影響。GSM接收機的實現離不開系統的同步，為了得到更好的同步質量，就必須對GSM基帶同步技術進行研究，選擇一種最合適的同步算法。GSM的同步既有時間同步，也有頻率同步。 @@ 軟件無線電是當前通信領域引入注目的熱點之一。長期以來，GSM的接收和解調都是由專用的ASIC芯片來完成的，通過軟件來實現GSM接收機的基帶算法，體現了軟件無線電技術的思想，選擇用它們來實現的GSM接收機具有靈活、可靠、擴展性好的優點。 @@ 論文主要討論GSM接收機同步算法與基于FPGA和DSP的GSM接收機設計， @@ 主要內容包括： @@ 通過相關理論知識的學習，設計驗證了GSM基帶同步算法。對FB時間同步，討論了包絡檢測和FFT變換兩種不同的方法；對SB時間同步，介紹實相關和復相關兩種方法；對頻率同步，給出了一種對FB運用相關運算來精確估計頻率誤差的算法。 @@ 設計了使用GSM射頻收發芯片RDA6210并通過實驗室的ALTERA EP3C25FPGA開發板進行控制的GSM射頻端的解決方案，論文對RDA6210的性能和控制方式進行了詳細的介紹，設計了芯片的控制模塊，得到了下變頻后的GSM基帶信號。 @@ 設計了基于RF前端+FPGA的GSM接收機方案。利用ALTERA EP2S180開發平臺來完成基帶數據的處理。針對ALTERA EP2S180開發平臺模數轉換器AD9433的特點使用THS4501設計了單獨的差分運算放大器模塊；設計了平臺的數據存儲方案并將該平臺得到的基帶采樣數據用于同步算法的仿真。 @@ 設計了基于RF前端+DSP的GSM接收機方案。利用模數轉換器AD9243、FPGA芯片和TMS320C6416TDSP芯片來完成基帶數據的處理。設計了McBSP+EDMA傳輸的數據存儲方案。 @@ 給出了接收機硬件測試的結果，從多方面驗證了所設計硬件平臺的可靠性。 @@關鍵詞：GSM接收機；同步；RF； FPGA；DSP；
上傳時間： 2013-07-01
上傳用戶：sh19831212
現場可編程門陣列(FPGA，Field Programmable Gate Array)是可編程邏輯器件的一種，它的出現是隨著微電子技術的發展，設計與制造集成電路的任務已不完全由半導體廠商來獨立承擔。系統設計師們更愿意自己設計專用集成電路(ASIC，Application Specific Integrated Circuit)．芯片，而且希望ASIC的設計周期盡可能短，最好是在實驗室里就能設計出合適的ASIC芯片，并且立即投入實際應用之中。現在，FPGA已廣泛地運用于通信領域、消費類電子和車用電子。 本文中涉及的I/O端口模塊是FPGA中最主要的幾個大模塊之一，它的主要作用是提供封裝引腳到CLB之間的接口，將外部信號引入FPGA內部進行邏輯功能的實現并把結果輸出給外部電路，并且根據需要可以進行配置來支持多種不同的接口標準。FPGA允許使用者通過不同編程來配置實現各種邏輯功能，在IO端口中它可以通過選擇配置方式來兼容不同信號標準的I/O緩沖器電路。總體而言，可選的I/O資源的特性包括：IO標準的選擇、輸出驅動能力的編程控制、擺率選擇、輸入延遲和維持時間控制等。 本文是關于FPGA中多標準兼容可編程輸入輸出電路(Input/Output Block)的設計和實現，該課題是成都華微電子系統有限公司FPGA大項目中的一子項，目的為在更新的工藝水平上設計出能夠兼容單端標準的I/O電路模塊；同時針對以前設計的I/O模塊不支持雙端標準的缺點，要求新的電路模塊中擴展出雙端標準的部分。文中以低壓雙端差分標準(LVDS)為代表構建雙端標準收發轉換電路，與單端標準比較，LVDS具有很多優點： (1)LVDS傳輸的信號擺幅小，從而功耗低，一般差分線上電流不超過4mA，負載阻抗為100Ω。這一特征使它適合做并行數據傳輸。 (2)LVDS信號擺幅小，從而使得該結構可以在2.5V的低電壓下工作。 (3)LVDS輸入單端信號電壓可以從0V到2.4V變化，單端信號擺幅為400mV，這樣允許輸入共模電壓從0.2V到2.2V范圍內變化，也就是說LVDS允許收發兩端地電勢有±1V的落差。 本文采用0.18μm1.8V/3.3V混合工藝，輔助Xilinx公司FPGA開發軟件ISE，設計完成了可以用于Virtex系列各低端型號FPGA的IOB結構，它有靈活的可配置性和出色的適應能力，能支持大量的I/O標準，其中包括單端標準，也包括雙端標準如LVDS等。它具有適應性的優點、可選的特性和考慮到被文件描述的硬件結構特征，這些特點可以改進和簡化系統級的設計，為最終的產品設計和生產打下基礎。設計中對包括20種IO標準在內的各電器參數按照用戶手冊描述進行仿真驗證，性能參數已達到預期標準。
上傳時間： 2013-05-15
上傳用戶：shawvi
隨著圖像聲納技術的發展，對于大數據量圖像數據的壓縮成為必須要解決的一個課題。本文結合水聲圖像特點，應用VerilogHDL 語言在Quartus Ⅱ軟件環境下設計實現了JPEG基本模式編解碼器。 JPEG是國際標準化組織(ISO)和CCITT 聯合制定的靜態圖像的壓縮標準，是目前最常使用的圖像存儲格式。 論文首先介紹了JPEG編碼的基本原理，然后根據編碼的流程從總體結構上對JPEG編碼器進行了模塊劃分。對于2D—DCT變換采用了行列分離的快速算法；針對水聲圖像特點采用了DC系數直接編碼。以一幅真實的水聲圖像作為JPEG編碼器的測試輸入，對編碼器輸出的碼流經過軟件編程后正確顯示出了JPEG圖片，并分析了壓縮圖像效果和質量。 JPEG解碼器采用了和JPEG編碼器對稱的模塊劃分，2D—IDCT變換同樣采用了行列分離的快速算法；根據JPEG標準中哈夫曼編碼的特點，哈夫曼解碼采用了濃縮哈夫曼表法，降低了存儲資源，提高了解碼速度。對經本文設計的JPEG解碼器解碼后的圖片和原圖片進行了比較分析，結果表明本設計滿足要求。
上傳時間： 2013-05-25
上傳用戶：sn2080395
低密度校驗碼(LDPC)是一種能逼近Shannon容量限的漸進好碼，其長碼性能甚至超過了Turbo碼。低密度校驗碼以其迭代譯碼復雜度低，沒有錯誤平層，碼率和碼長可靈活改變的優點成為Turbo碼強有力的競爭對手。目前，LDPC碼已廣泛應用于深空通信、光纖通信、衛星數字視頻和音頻廣播等領域，因此LDPC碼編譯碼器的硬件實現已成為糾錯編碼領域的研究熱點之一。 本文在分析LDPC碼的基本編碼結構基礎上，首先研究了LDPC碼的隨機構造方法，并給出了有效的PEG算法實現方法，重點分析了用環消除(cycle elimination)算法實現的準循環LDPC碼的構造。然后對LDPC碼的幾種不同譯碼算法進行分析比較，討論了一種適合硬件實現的譯碼算法-TDMP算法，并對易于硬件實現的TDMP算法進行了性能仿真，仿真結果表明TDMP算法作為硬件實現的譯碼算法具有優異的性能優勢。最后針對Altera公司的StratixEPIS25 FPGA芯片設計了一個基于TDMP算法的(4096，2048)非規則LDPC碼譯碼器，內部用了4個單校驗碼譯碼器并行譯1幀數據，3幀同時譯碼，作者詳細介紹了該譯碼器芯片的設計過程和內部結構和工作流程。
上傳時間： 2013-05-23
上傳用戶：fujun35303
