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雅思寫作

  • 賽靈思ZYNQ-7000EPP系列開辟新型器件先河

    賽靈思ZYNQ-7000EPP系列開辟新型器件先河

    標簽: ZYNQ 7000 EPP 賽靈思

    上傳時間: 2013-10-17

    上傳用戶:wangzhen1990

  • 賽靈思如何讓7系列FPGA的功耗減半

    賽靈思采用專為 FPGA 定制的芯片制造工藝和創新型統一架構,讓 7 系列 FPGA 的功耗較前一代器件降低一半以上。

    標簽: FPGA 賽靈思 功耗

    上傳時間: 2013-10-10

    上傳用戶:sklzzy

  • 降低賽靈思28nm 7系列FPGA的功耗

    本白皮書介紹了有關賽靈思 28 nm 7 系列 FPGA 功耗的幾個方面,其中包括臺積電 28nm高介電層金屬閘 (HKMG) 高性能低功耗(28nm HPL 或 28 HPL)工藝的選擇。

    標簽: FPGA 28 nm 賽靈思

    上傳時間: 2013-10-24

    上傳用戶:wcl168881111111

  • 堆疊與載入賽靈思打造令人驚嘆的FPGA

    堆疊與載入賽靈思打造令人驚嘆的FPGA

    標簽: FPGA 堆疊 賽靈思

    上傳時間: 2013-11-03

    上傳用戶:lizhizheng88

  • WP312 - 賽靈思新一代28nm FPGA技術概覽

        賽靈思選用 28nm 高介電層金屬閘 (HKMG) 高性能低 功耗技術,并將該技術與新型一體化 ASMBLTM 架構相結合,從而推出能降低功耗、提高性能的新一代FPGA。這些器件實現了前所未有的高集成度和高帶寬,為系統架構師和設計人員提供了一種可替代 ASSP和 ASIC 的全面可編程解決方案。

    標簽: FPGA 312 WP 28

    上傳時間: 2013-11-07

    上傳用戶:zengduo

  • WP380 -賽靈思堆疊硅片互聯技術

        可編程技術勢在必行 — 用更少的資源實現更多功能 隨時隨地降低風險、使用可編程硬件設計平臺快速開發差異化產品 — 驅使人們不斷探索能夠提供更大容量、更低功耗和更高帶寬的 FPGA 解決方案,用來創建目前 ASIC 和 ASSP 所能提供的系統級功能。賽靈思已經開發出一種創新型 FPGA 設計和制造方法,能夠滿足“可編程技術勢在必行”的兩大關鍵要求。堆疊硅片互聯技術是新一代 FPGA 的基礎,不僅超越了摩爾定律,而且實現的功能能夠滿足最嚴格的設計要求。利用該技術,賽靈思縮短了批量交付最大型 FPGA 所需的時間,從而可以滿足最終客戶的批量生產需求。本白皮書將探討促使賽靈思開發堆疊硅片互聯技術的技術及經濟原因,以及使之實現的創新方法。

    標簽: 380 WP 賽靈思 堆疊硅片

    上傳時間: 2013-10-24

    上傳用戶:Yue Zhong

  • WP373-賽靈思推出Virtex-7,Kintex-7,Artix-7三大全新系列FPGA

        賽靈思推出的三款全新產品系列不僅發揮了臺積電28nm 高介電層金屬閘 (HKMG) 高性能低功耗 (HPL) 工藝技術前所未有的功耗、性能和容量優勢,而且還充分利用 FPGA 業界首款統一芯片架構無與倫比的可擴展性,為新一代系統提供了綜合而全面的平臺基礎。目前,隨著賽靈思 7 系列 (Virtex®-7、Kintex™-7 和Artix™-7 系列) 的推出,賽靈思將系統功耗、性價比和容量推到了全新的水平,這在很大程度上要歸功于臺積電 28nm HKMG 工藝出色的性價比優勢以及芯片和軟件層面上的設計創新。結合業經驗證的 EasyPath™成本降低技術,上述新系列產品將為新一代系統設計人員帶來無與倫比的價值

    標簽: Virtex Kintex Artix FPGA

    上傳時間: 2015-01-02

    上傳用戶:shuizhibai

  • 磁芯電感器的諧波失真分析

    磁芯電感器的諧波失真分析 摘  要:簡述了改進鐵氧體軟磁材料比損耗系數和磁滯常數ηB,從而降低總諧波失真THD的歷史過程,分析了諸多因數對諧波測量的影響,提出了磁心性能的調控方向。 關鍵詞:比損耗系數, 磁滯常數ηB ,直流偏置特性DC-Bias,總諧波失真THD  Analysis on THD of the fer rite co res u se d i n i nductancShi Yan Nanjing Finemag Technology Co. Ltd., Nanjing 210033   Abstract:    Histrory of decreasing THD by improving the ratio loss coefficient and hysteresis constant of soft magnetic ferrite is briefly narrated. The effect of many factors which affect the harmonic wave testing is analysed. The way of improving the performance of ferrite cores is put forward.  Key words: ratio loss coefficient,hysteresis constant,DC-Bias,THD  近年來,變壓器生產廠家和軟磁鐵氧體生產廠家,在電感器和變壓器產品的總諧波失真指標控制上,進行了深入的探討和廣泛的合作,逐步弄清了一些似是而非的問題。從工藝技術上采取了不少有效措施,促進了質量問題的迅速解決。本文將就此熱門話題作一些粗淺探討。  一、 歷史回顧 總諧波失真(Total harmonic distortion) ,簡稱THD,并不是什么新的概念,早在幾十年前的載波通信技術中就已有嚴格要求<1>。1978年郵電部公布的標準YD/Z17-78“載波用鐵氧體罐形磁心”中,規定了高μQ材料制作的無中心柱配對罐形磁心詳細的測試電路和方法。如圖一電路所示,利用LC組成的150KHz低通濾波器在高電平輸入的情況下測量磁心產生的非線性失真。這種相對比較的實用方法,專用于無中心柱配對罐形磁心的諧波衰耗測試。 這種磁心主要用于載波電報、電話設備的遙測振蕩器和線路放大器系統,其非線性失真有很嚴格的要求。  圖中  ZD   —— QF867 型阻容式載頻振蕩器,輸出阻抗 150Ω, Ld47 —— 47KHz 低通濾波器,阻抗 150Ω,阻帶衰耗大于61dB,       Lg88 ——并聯高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB Ld88 ——并聯高低通濾波器,阻抗 150Ω,三次諧波衰耗大于61dB FD   —— 30~50KHz 放大器, 阻抗 150Ω, 增益不小于 43 dB,三次諧波衰耗b3(0)≥91 dB, DP  —— Qp373 選頻電平表,輸入高阻抗, L ——被測無心罐形磁心及線圈, C  ——聚苯乙烯薄膜電容器CMO-100V-707APF±0.5%,二只。 測量時,所配用線圈應用絲包銅電磁線SQJ9×0.12(JB661-75)在直徑為16.1mm的線架上繞制 120 匝, (線架為一格) , 其空心電感值為 318μH(誤差1%) 被測磁心配對安裝好后,先調節振蕩器頻率為 36.6~40KHz,  使輸出電平值為+17.4 dB, 即選頻表在 22′端子測得的主波電平 (P2)為+17.4 dB,然后在33′端子處測得輸出的三次諧波電平(P3), 則三次諧波衰耗值為:b3(+2)= P2+S+ P3 式中:S 為放大器增益dB 從以往的資料引證, 就可以發現諧波失真的測量是一項很精細的工作,其中測量系統的高、低通濾波器,信號源和放大器本身的三次諧波衰耗控制很嚴,阻抗必須匹配,薄膜電容器的非線性也有相應要求。濾波器的電感全由不帶任何磁介質的大空心線圈繞成,以保證本身的“潔凈” ,不至于造成對磁心分選的誤判。 為了滿足多路通信整機的小型化和穩定性要求, 必須生產低損耗高穩定磁心。上世紀 70 年代初,1409 所和四機部、郵電部各廠,從工藝上改變了推板空氣窯燒結,出窯后經真空罐冷卻的落后方式,改用真空爐,并控制燒結、冷卻氣氛。技術上采用共沉淀法攻關試制出了μQ乘積 60 萬和 100 萬的低損耗高穩定材料,在此基礎上,還實現了高μ7000~10000材料的突破,從而大大縮短了與國外企業的技術差異。當時正處于通信技術由FDM(頻率劃分調制)向PCM(脈沖編碼調制) 轉換時期, 日本人明石雅夫發表了μQ乘積125 萬為 0.8×10 ,100KHz)的超優鐵氧體材料<3>,其磁滯系數降為優鐵

    標簽: 磁芯 電感器 諧波失真

    上傳時間: 2013-12-15

    上傳用戶:天空說我在

  • IC封裝製程簡介(IC封裝制程簡介)

    半導體的產品很多,應用的場合非常廣泛,圖一是常見的幾種半導體元件外型。半導體元件一般是以接腳形式或外型來劃分類別,圖一中不同類別的英文縮寫名稱原文為   PDID:Plastic Dual Inline Package SOP:Small Outline Package SOJ:Small Outline J-Lead Package PLCC:Plastic Leaded Chip Carrier QFP:Quad Flat Package PGA:Pin Grid Array BGA:Ball Grid Array         雖然半導體元件的外型種類很多,在電路板上常用的組裝方式有二種,一種是插入電路板的銲孔或腳座,如PDIP、PGA,另一種是貼附在電路板表面的銲墊上,如SOP、SOJ、PLCC、QFP、BGA。    從半導體元件的外觀,只看到從包覆的膠體或陶瓷中伸出的接腳,而半導體元件真正的的核心,是包覆在膠體或陶瓷內一片非常小的晶片,透過伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件,從上方的玻璃窗可看到內部的晶片,圖三是以顯微鏡將內部的晶片放大,可以看到晶片以多條銲線連接四周的接腳,這些接腳向外延伸並穿出膠體,成為晶片與外界通訊的道路。請注意圖三中有一條銲線從中斷裂,那是使用不當引發過電流而燒毀,致使晶片失去功能,這也是一般晶片遭到損毀而失效的原因之一。   圖四是常見的LED,也就是發光二極體,其內部也是一顆晶片,圖五是以顯微鏡正視LED的頂端,可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線,若以LED二支接腳的極性來做分別,晶片是貼附在負極的腳上,經由銲線連接正極的腳。當LED通過正向電流時,晶片會發光而使LED發亮,如圖六所示。     半導體元件的製作分成兩段的製造程序,前一段是先製造元件的核心─晶片,稱為晶圓製造;後一段是將晶中片加以封裝成最後產品,稱為IC封裝製程,又可細分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟,在本章節中將簡介這兩段的製造程序。

    標簽: 封裝 IC封裝 制程

    上傳時間: 2013-11-04

    上傳用戶:372825274

  • 思源量儀電器元件清單

    思源量儀電器元件清單

    標簽: 思源 電器元件 清單

    上傳時間: 2013-11-08

    上傳用戶:siying

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