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電信行業(yè)

  • 單片機與三菱PLC無協議串行通訊的實現

    介紹了三菱FX2N 系列PLC 在串行通訊技術中使用無協議數據傳輸的指令格式,以及單片機與其通訊的軟硬件實現方法。關鍵詞:PLC RS485 接口 無協議數據傳輸 打碼機控制器

    標簽: PLC 單片機 三菱 協議

    上傳時間: 2013-05-20

    上傳用戶:浮塵6666

  • 深入了解數字示波器死區時間及其影響

    混合信號示波器 (MSO) 已成為 當今嵌入設備設計師的首選工具。 安捷倫科技公司 (前惠普公司) 于 1996年推出了首款MSO,并于近日 推出了第三代MSO。所有主要示波 器廠商現在都可提供混合信號示波 器。MSO在基礎示波器功能中增加 了16 個或更多邏輯分析儀采集信 道,及串行總線觸發和協議解碼功 能,研發工程師和技術人員可更快 調試其混合信號設計。MSO可彌補 傳統數字存儲示波器 (DSO) 和當今 更加復雜的邏輯分析儀及串行總線 協議分析儀之間的差距。那么MSO 與傳統DSO 相比,有哪些改善? 不 同廠商的MSO 之間的差別是什么?

    標簽: 數字示波器 死區時間

    上傳時間: 2013-04-24

    上傳用戶:huql11633

  • 使用混合信號示波器調試串行總線系統應用指南

    這篇應用指南的目標讀者是數字 系統設計師,他們在研發過程中會用 到模擬和數字元器件,包括采用串行 總線的微控制器和DSP系統。本文討 論調試串行總線設計所面臨的挑戰和 新的解決方案,這些串行總線包括控 制器局域網 (CAN)、集成電路間總線 (I2C)、串行外設接口 (SPI) 或通用串行 總線 (USB)。

    標簽: 混合信號示波器 串行 總線系統 應用指南

    上傳時間: 2013-06-15

    上傳用戶:user08x

  • 51單片機的串行口擴展方法

    在以單片機為核心的多級分布式系統中,常常需要擴展單片機的串行通信口,本文分別介紹了基于SP2538 專用串行口擴展芯片及Intel8251 的兩種串行口擴展方法,并給出了實際的硬件電路原理及相應的通信

    標簽: 51單片機 串行口 擴展方法

    上傳時間: 2013-08-01

    上傳用戶:15679277906

  • C語言實現RS232上、下位機串行通信

    C語言實現RS232上、下位機串行通信 C語言實現RS232上、下位機串行通信

    標簽: 232 RS C語言 下位機

    上傳時間: 2013-06-03

    上傳用戶:haobin315

  • 華為7號信令教材

    華為7號信令教材,最詳細版本,學習者最想要找的就是這個啦。

    標簽: 華為 信令 教材

    上傳時間: 2013-07-20

    上傳用戶:wanghui2438

  • LDPC碼編碼器FPGA實現研究

    LDPC(低密度奇偶校驗碼)編碼是提高通信質量和數據傳輸速率的關鍵技術。LDPC碼應用于實際通信系統是本課題的研究重點。實際通信要求在LDPC碼長盡量短、碼率盡量高及硬件可實現的前提下,結合連續相位MSK調制,滿足歸一化信噪比SNR=2dB時,系統誤碼率低于10-4。根據課題背景,本文主要研究基于FPGA的LDPC編碼器設計與實現。 LDPC碼的編碼復雜度往往與其幀長的平方成正比,編碼復雜度大,成為編碼硬件實現的一個障礙;論文針對實際系統的預期指標,通過對多種矩陣構造算法的預選方案及影響LDPC碼性能參數仿真分析,基于1/2碼率,1024和2048兩種幀長,設計了三種編碼器的備選方案,分別為直接下三角編碼器,串行準循環編碼器和二階準循環編碼器。 對于每種編碼器,分別設計了其整體結構,并對每種編碼器的功能模塊進行深入研究,設計完成后利用第3方軟件MODELSIM對編碼器進行了時序仿真;根據時序仿真結果和綜合報告對三種編碼方案進行比較,最終選擇串行準循環編碼器作為硬件實現的編碼方案。 最后,在FPGA中硬件實現了串行準循環編碼器并對其進行測試,利用MATLAB仿真程序和串口通信工具最終驗證了這種編碼器的正確性和硬件可實現性。

    標簽: LDPC FPGA 編碼器 實現研究

    上傳時間: 2013-08-02

    上傳用戶:林魚2016

  • 海信HDP2919彩電電路圖

    海信HDP2919彩電電路圖海信HDP2919彩色電視機電路圖,海信HDP2919彩電圖紙,海信HDP2919原理圖。

    標簽: 2919 HDP 海信 彩電電路圖

    上傳時間: 2013-06-18

    上傳用戶:黃華強

  • 高吞吐量LDPC碼編碼構造及其FPGA實現

    低密度校驗碼(LDPC,Low Density Parity Check Code)是一種性能接近香農極限的信道編碼,已被廣泛地采用到各種無線通信領域標準中,包括我國的數字電視地面傳輸標準、歐洲第二代衛星數字視頻廣播標準(DVB-S2,Digital Video Broadcasting-Satellite 2)、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來4G通信系統中的核心技術之一。 當今LDPC碼構造的主流方向有兩個,分別是結合準循環(QC,Quasi Cyclic)移位結構的單次擴展構造和類似重復累積(RA,Repeat Accumulate)碼構造。相應地,主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高,但是需要較多的寄存器和ROM資源;基于迭代譯碼的編碼算法實現簡單,但是吞吐量不高,且不容易構造高性能的好碼。 本文在研究了上述幾種碼構造和編碼算法之后,結合編譯碼器綜合實現的復雜度考慮,提出了一種切實可行的基于二次擴展(Dex,Duplex Expansion)的QC-LDPC碼構造方法,以實現高吞吐量的LDPC碼收發端;并且充分利用該類碼校驗矩陣準循環移位結構的特點,結合RU算法,提出了一種新編碼器的設計方案。 基于二次擴展的QC-LDPC碼構造方法,是通過對母矩陣先后進行亂序擴展(Pex,Permutation Expansion)和循環移位擴展(CSEx,Cyclic Shift Expansion)實現的。在此基礎上,為了實現可變碼長、可變碼率,一般編譯碼器需同時支持多個亂序擴展和循環移位擴展的擴展因子。本文所述二次擴展構造方法的特點在于,固定循環移位擴展的擴展因子大小不變,支持多個亂序擴展的擴展因子,使得譯碼器結構得以精簡;構造得到的碼字具有近似規則碼的結構,便于硬件實現;(偽)隨機生成的循環移位系數能夠提高碼字的誤碼性能,是對硬件實現和誤碼性能的一種折中。 新編碼器在很大程度上考慮了資源的復用,使得實現復雜度近似與碼長成正比。考慮到吞吐量的要求,新編碼器結構完全拋棄了RU算法中串行的前向替換(FS,Forward Substitution)模塊,同時簡化了流水線結構,由原先RU算法的6級降低為4級;為了縮短編碼延時,設計時安排每一級流水線計算所需的時鐘數大致相同。 這種碼字構造和編碼聯合設計方案具有以下優勢:相比RU算法,新方案對可變碼長、可變碼率的支持更靈活,吞吐量也更大;相比基于生成矩陣的編碼算法,新方案節省了50%以上的寄存器和ROM資源,單位資源下的吞吐量更大;相比類似重復累積碼結構的基于迭代譯碼的編碼算法,新方案使高性能LDPC碼的構造更為方便。以上結果都在Xilinx Virtex II pro 70 FPGA上得到驗證。 通過在實驗板上實測表明,上述基于二次擴展的QC-LDPC碼構造和相應的編碼方案能夠實現高吞吐量LDPC碼收發端,在實際應用中具有很高的價值。 目前,LDPC碼正向著非規則、自適應、信源信道及調制聯合編碼方向發展。跨層聯合編碼的構造方法,及其對應的編碼算法,也必將成為信道編碼理論未來的研究重點。

    標簽: LDPC FPGA 吞吐量 編碼

    上傳時間: 2013-07-26

    上傳用戶:qoovoop

  • 隨機讀寫I2C串行總線接口電路設計

    I2C(Inter Integrated Circuits)是Philips公司開發的用于芯片之間連接的串行總線,以其嚴格的規范、卓越的性能、簡便的操作和眾多帶I2C接口的外圍器件而得到廣泛的應用并受到普遍的歡迎。 現場可編程門陣列(FPGA)設計靈活、速度快,在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用Verilog/FPGA來實現一個隨機讀/寫的I2C接口電路,實現與外圍I2C接口器件E2PROM進行數據通信,實現讀、寫等功能,傳輸速率實現為100KBps。在Modelsim6.0仿真軟件環境中進行仿真,在Xilinx公司的ISE9.li開發平臺上進行了下載,搭建外圍電路,用Agilem邏輯分析儀進行數據采集,分析測試結果。 首先,介紹了微電子設計的發展概況以及設計流程,重點介紹了HDL/FPGA的設計流程。其次,對I2C串行總線進行了介紹,重點說明了總線上的數據傳輸格式并對所使用的AT24C02 E2PROM存儲器的讀/寫時序作了介紹。第三,基于Verilog _HDL設計了隨機讀/寫的I2C接口電路、測試模塊和顯示電路;接口電路由同步有限狀態機(FSM)來實現;測試模塊首先將數據寫入到AT24C02的指定地址,接著將寫入的數據讀出,并將兩個數據顯示在外圍LED數碼管和發光二極管上,從而直觀地比較寫入和輸出的數據的正確性。FPGA下載芯片為Xilinx SPARTAN Ⅲ XC3S200。第四,用Agilent邏輯分析儀進行傳輸數據的采集,分析數據傳輸的時序,從而驗證電路設計的正確性。最后,論文對所取得的研究成果進行了總結,并展望了下一步的工作。

    標簽: I2C 隨機 讀寫 串行總線接口

    上傳時間: 2013-06-08

    上傳用戶:再見大盤雞

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