全加器的VHDL_CODE和TEST_BENCH 無須解壓縮密碼
標簽： TEST_BENCH VHDL_CODE 全加器
上傳時間： 2013-12-22
上傳用戶：hongmo
LVDS技術： 低電壓差分訊號(LVDS)在對訊號完整性、低抖動及共模特性要求較高的系統中得到了廣泛的應用。本文針對LVDS與其他幾種介面標準之間的連接，對幾種典型的LVDS介面電路進行了討論
標簽： LVDS 差分 模 系統
上傳時間： 2014-01-13
上傳用戶：stvnash
一個可以計算分壓電路的源碼。 可透過輸出與輸入電壓，計算電阻的大?。换蛲高^輸入電壓與電阻，計算最後輸出之電壓
標簽： 分
上傳時間： 2014-12-09
上傳用戶：hoperingcong
新器件應用,2007年第5期,包括基于MF RC500的非接觸式IC卡讀寫器設計,基于ARM920T的嵌入式靜力測量系統設計,基于單片機PIC18F66J10的主動放線機設計,TS201在數字信號處理設計中的應用
標簽： 2007 920T 18F 500
上傳時間： 2013-12-13
上傳用戶：zwei41
資料壓縮的原理與應用快速霍夫曼解碼器的C程式
標簽： 程式
上傳時間： 2013-12-23
上傳用戶：yan2267246
利用此源碼可以使用ALTERA DE2開發板將鍵盤變成一部電子琴
標簽： ALTERA DE2 鍵盤
上傳時間： 2016-03-23
上傳用戶：cc1015285075
用VC編的數碼相機仿真程序 包括圖像的預處理 DCT變換 壓縮等 最后可用verify.exe做比較
標簽： verify DCT exe 仿真程序
上傳時間： 2014-01-16
上傳用戶：Pzj
資料壓縮技術與應用-變動長度編碼壓縮及解壓縮(Run Length Encoding) 整數採用固定長度一個位元組表示法 對於只出現一次的位元組S亦用iS取代
標簽： Encoding Length Run 表示法
上傳時間： 2016-08-15
上傳用戶：GavinNeko
資料壓縮技術與應用-變動長度編碼壓縮(Run Length Encoding)~ 整數採用固定長度一個位元組表示法~ 對於只出現一次的位元組S亦用iS取代~
上傳用戶：asdfasdfd
verilog除頻器可用於編碼段運用可以穩定電路設計
標簽： verilog
上傳時間： 2013-12-26
上傳用戶：372825274
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