產(chǎn)品型號(hào)：VK36Q4 產(chǎn)品品牌：VINKA/永嘉微電/永嘉微 封裝形式：DFN10 產(chǎn)品年份：新年份 聯(lián) 系 人：許先生 深圳市永嘉微電科技有限公司，原廠直銷(xiāo)，原裝現(xiàn)貨更有優(yōu)勢(shì)！工程服務(wù)，技術(shù)支持，讓您的生產(chǎn)高枕無(wú)憂！ 量大價(jià)優(yōu)，保證原裝正品。您有量，我有價(jià)！QT176 1.概述 VK36Q4具有4個(gè)觸摸按鍵，可用來(lái)檢測(cè)外部觸摸按鍵上人手的觸摸動(dòng)作。該芯片具有較 高的集成度，僅需極少的外部組件便可實(shí)現(xiàn)觸摸按鍵的檢測(cè)。 提供了4路直接輸出功能。芯片內(nèi)部采用特殊的集成電路，具有高電源電壓抑制比，可 減少按鍵檢測(cè)錯(cuò)誤的發(fā)生，此特性保證在不利環(huán)境條件的應(yīng)用中芯片仍具有很高的可靠性。 此觸摸芯片具有自動(dòng)校準(zhǔn)功能，低待機(jī)電流，抗電壓波動(dòng)等特性，為各種觸摸按鍵+IO 輸出的應(yīng)用提供了一種簡(jiǎn)單而又有效的實(shí)現(xiàn)方法。 特點(diǎn) ? 工作電壓 2.4-5.5V ? 待機(jī)電流7uA/3.0V,14uA/5V ? 上電復(fù)位功能（POR） ? 低壓復(fù)位功能（LVR） ? 觸摸輸出響應(yīng)時(shí)間： 工作模式 48mS 待機(jī)模式160mS ? CMOS輸出，低電平有效，支持多鍵 ? 有效鍵最長(zhǎng)輸出16S ? 無(wú)觸摸4S自動(dòng)校準(zhǔn) ? 專用腳接對(duì)地電容調(diào)節(jié)靈敏度(1-47nF） ? 各觸摸通道單獨(dú)接對(duì)地小電容微調(diào)靈敏度（0-50pF）. ? 上電0.25S內(nèi)為穩(wěn)定時(shí)間，禁止觸摸. ? 封裝 DFN10L(3.0mm x 3.0mm PP=0,5mm)
標(biāo)簽： 3MM 0.75 36Q DFN VK 36 10 Q4 體積 4通道
上傳時(shí)間： 2021-12-24
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1. 目的 規(guī)范產(chǎn)品的PCB焊盤(pán)設(shè)計(jì)工藝， 規(guī)定PCB焊盤(pán)設(shè)計(jì)工藝的相關(guān)參數(shù)，使得PCB 的設(shè)計(jì)滿足可生產(chǎn)性、可測(cè)試性、安規(guī)、EMC、EMI 等的技術(shù)規(guī)范要求,在產(chǎn)品設(shè)計(jì)過(guò)程中構(gòu)建產(chǎn)品的工藝、技術(shù)、質(zhì)量、成本優(yōu)勢(shì)。 2. 適用范圍本規(guī)范適用于空調(diào)類(lèi)電子產(chǎn)品的PCB 工藝設(shè)計(jì)，運(yùn)用于但不限于PCB 的設(shè)計(jì)、PCB 批產(chǎn)工藝審查、單板工藝審查等活動(dòng)。本規(guī)范之前的相關(guān)標(biāo)準(zhǔn)、規(guī)范的內(nèi)容如與本規(guī)范的規(guī)定相抵觸的，以本規(guī)范為準(zhǔn)3.引用/參考標(biāo)準(zhǔn)或資料TS-S0902010001 <〈信息技術(shù)設(shè)備PCB 安規(guī)設(shè)計(jì)規(guī)范〉>TS—SOE0199001 <〈電子設(shè)備的強(qiáng)迫風(fēng)冷熱設(shè)計(jì)規(guī)范〉〉TS—SOE0199002 〈<電子設(shè)備的自然冷卻熱設(shè)計(jì)規(guī)范>>IEC60194 〈<印制板設(shè)計(jì)、制造與組裝術(shù)語(yǔ)與定義>> （Printed Circuit Board designmanufacture and assembly-terms and definitions)IPC—A-600F 〈<印制板的驗(yàn)收條件>〉 （Acceptably of printed board)IEC609504。規(guī)范內(nèi)容4。1焊盤(pán)的定義 通孔焊盤(pán)的外層形狀通常為圓形、方形或橢圓形。具體尺寸定義詳述如下，名詞定義如圖所示。1) 孔徑尺寸:若實(shí)物管腳為圓形：孔徑尺寸(直徑)=實(shí)際管腳直徑+0。20∽0。30mm（8。0∽12。0MIL）左右；若實(shí)物管腳為方形或矩形：孔徑尺寸（直徑）=實(shí)際管腳對(duì)角線的尺寸+0.10∽0。20mm（4.0∽8。0MIL）左右。2) 焊盤(pán)尺寸： 常規(guī)焊盤(pán)尺寸=孔徑尺寸（直徑)+0.50mm（20.0 MIL)左右.…………
標(biāo)簽： PCB
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書(shū)名:數(shù)字邏輯電路的ASIC設(shè)計(jì)/實(shí)用電子電路設(shè)計(jì)叢書(shū) 作者:（日）小林芳直 著，蔣民 譯，趙寶瑛 校 出版社：科學(xué)出版社 原價(jià)：30.00 出版日期：2004-9-1 ISBN：9787030133960 字?jǐn)?shù)：348000 頁(yè)數(shù)：293 印次： 版次：1 紙張：膠版紙 開(kāi)本： 商品標(biāo)識(shí)：8901735 編輯推薦 -------------------------------------------------------------------------------- 內(nèi)容提要 -------------------------------------------------------------------------------- 本書(shū)是“實(shí)用電子電路設(shè)計(jì)叢書(shū)”之一。本書(shū)以實(shí)現(xiàn)高速高可靠性的數(shù)字系統(tǒng)設(shè)計(jì)為目標(biāo)，以完全同步式電路為基礎(chǔ)，從技術(shù)實(shí)現(xiàn)的角度介紹ASIC邏輯電路設(shè)計(jì)技術(shù)。內(nèi)容包括：邏輯門(mén)電路、邏輯壓縮、組合電路、Johnson計(jì)數(shù)器、定序器設(shè)計(jì)及應(yīng)用等，并介紹了實(shí)現(xiàn)最佳設(shè)計(jì)的各種工程設(shè)計(jì)方法。 本書(shū)可供信息工程、電子工程、微電子技術(shù)、計(jì)算技術(shù)、控制工程等領(lǐng)域的高等院校師生及工程技術(shù)人員、研制開(kāi)發(fā)人員學(xué)習(xí)參考。 目錄 -------------------------------------------------------------------------------- 第1章 ASIC=同步式設(shè)計(jì)=更高可靠性設(shè)計(jì)方法的實(shí)現(xiàn) 1.1 面向高性能系統(tǒng)的設(shè)計(jì) 1.2 同步電路的不足 1.3 同步電路設(shè)計(jì) 1.4 ASIC機(jī)能設(shè)計(jì)方法有待思考的地方 第2章 邏輯門(mén)電路詳解 2.1 邏輯門(mén)電路的最基本的知識(shí) 2.2 加法電路及其構(gòu)成方法 2.3 其他輸入信號(hào)為３位的邏輯單元 2.4 復(fù)合邏輯門(mén)電路的調(diào)整 第3章 邏輯壓縮與奎恩·麥克拉斯基法 3.1 除去玻色項(xiàng)的方法 3.2 奎恩·麥克拉斯基法 第4章 組合電路設(shè)計(jì) 4.1 選擇器、解碼器、編碼器 4.2 比較和運(yùn)算電路的設(shè)計(jì) 第5章 計(jì)數(shù)器電路的設(shè)計(jì) 5.1 計(jì)數(shù)器設(shè)計(jì)的基礎(chǔ) 5.2 各種各樣的計(jì)數(shù)器設(shè)計(jì) 5.3 LFSR(M系列發(fā)生器)的設(shè)計(jì) 第6章 江遜計(jì)數(shù)器 6.1 設(shè)計(jì)高可靠性的江遜計(jì)數(shù)器 6.2 沖刷順序的組成 第7章 定序器設(shè)計(jì) 7.1 定序器電路設(shè)計(jì)的基礎(chǔ)知識(shí) 7.2 把江遜計(jì)數(shù)器制作成狀態(tài)機(jī) 7.3 一比特?zé)嵛粻顟B(tài)機(jī)與江遜狀態(tài)機(jī) 7.4 跳躍動(dòng)作的設(shè)計(jì) 第8章 定序器的高可靠化技術(shù) 8.1 高可靠性定序器概述 8.2 關(guān)注高可靠性江遜狀態(tài)機(jī) 第9章 定序器的應(yīng)用設(shè)計(jì) 9.1 軟件處理與硬件處理 9.2 自動(dòng)扶梯的設(shè)計(jì) 9.3 信號(hào)機(jī)的設(shè)計(jì) 9.4 數(shù)碼存錢(qián)箱的設(shè)計(jì) 9.5 數(shù)字鎖相環(huán)的設(shè)計(jì) 第10章 實(shí)現(xiàn)最佳設(shè)計(jì)的方法 10.1 如何杜絕運(yùn)行錯(cuò)誤的產(chǎn)生 10.2 16位乘法器的電路整定 10.3 冒泡分類(lèi)器（bubble sorter）的電路設(shè)定 參考文獻(xiàn)
標(biāo)簽： ASIC 數(shù)字邏輯電路
上傳時(shí)間： 2013-06-15
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ASIC對(duì)產(chǎn)品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對(duì)較低,運(yùn)算速度也受到限制.常規(guī)ASIC的硬件具有速度優(yōu)勢(shì)和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統(tǒng)硬件(CHW)相比,具有一定可配置特性的場(chǎng)可編程門(mén)陣列(FPGA)的出現(xiàn),使建立在可再配置硬件基礎(chǔ)上的進(jìn)化硬件(EHW)成為智能硬件電路設(shè)計(jì)的一種新方法.作為進(jìn)化算法和可編程器件技術(shù)相結(jié)合的產(chǎn)物,可重構(gòu)FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實(shí)現(xiàn)方法.論文認(rèn)為面向分類(lèi)的專用類(lèi)可重構(gòu)FPGA(ASR-FPGA)的研究,可使可重構(gòu)電路粒度劃分的針對(duì)性更強(qiáng)、設(shè)計(jì)更易實(shí)現(xiàn).論文研究的可重構(gòu)FPGA的BCH通訊糾錯(cuò)碼進(jìn)化電路是一類(lèi)ASR-FPGA電路的具體方法,具有一定的實(shí)用價(jià)值.論文所做的工作主要包括:(1)BCH編譯碼電路的設(shè)計(jì)——求取實(shí)驗(yàn)用BCH碼的生成多項(xiàng)式和校驗(yàn)多項(xiàng)式及其相應(yīng)的矩陣并構(gòu)造實(shí)驗(yàn)用BCH碼;(2)建立基于可重構(gòu)FPGA的基核——構(gòu)造具有可重構(gòu)特性的硬件功能單元,以此作為可重構(gòu)BCH碼電路的設(shè)計(jì)基礎(chǔ);(3)構(gòu)造實(shí)現(xiàn)可重構(gòu)BCH糾錯(cuò)碼電路的方法——建立可重構(gòu)糾錯(cuò)碼硬件電路算法并進(jìn)行實(shí)驗(yàn)驗(yàn)證;(4)在可重構(gòu)糾錯(cuò)碼電路基礎(chǔ)上,構(gòu)造進(jìn)化硬件控制功能塊的結(jié)構(gòu),完成各進(jìn)化RLA控制模塊的驗(yàn)證和實(shí)現(xiàn).課題是將可重構(gòu)BCH碼的編譯碼電路的實(shí)現(xiàn)作為一類(lèi)ASR-FPGA的研究目標(biāo),主要成果是根據(jù)可編程邏輯電路的特點(diǎn),選擇一種可編程樹(shù)的電路模型,并將它作為可重構(gòu)FPGA電路的基核T;通過(guò)對(duì)循環(huán)BCH糾錯(cuò)碼的構(gòu)造原理和電路結(jié)構(gòu)的研究,將基核模型擴(kuò)展為能滿足糾錯(cuò)碼電路需要的糾錯(cuò)碼基本功能單元T;以T作為再劃分的基本單元,對(duì)FPGA進(jìn)行"格式化",使T規(guī)則排列在FPGA上,通過(guò)對(duì)T的控制端的不同配置來(lái)實(shí)現(xiàn)糾錯(cuò)碼的各個(gè)功能單元;在可重構(gòu)基核的基礎(chǔ)上提出了糾錯(cuò)碼重構(gòu)電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進(jìn)化硬件描述語(yǔ)言,通過(guò)轉(zhuǎn)換為相應(yīng)的VHDL語(yǔ)言描述以實(shí)現(xiàn)硬件電路;采用RLA模型的有限狀態(tài)機(jī)FSM方式實(shí)現(xiàn)了可重構(gòu)糾錯(cuò)碼電路的EHW的各個(gè)控制功能塊.在實(shí)驗(yàn)方面,利用Xilinx FPGA開(kāi)發(fā)系統(tǒng)中的VHDL語(yǔ)言和電路圖相結(jié)合的設(shè)計(jì)方法建立了循環(huán)糾錯(cuò)碼基核單元的可重構(gòu)模型,進(jìn)行循環(huán)糾錯(cuò)BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進(jìn)行了FPGA實(shí)現(xiàn).課題在研究模型上選取的是比較基本的BCH糾錯(cuò)碼電路,立足于解決基于可重構(gòu)FPGA核的設(shè)計(jì)的基本問(wèn)題.課題的研究成果及其總結(jié)的一套ASR-FPGA進(jìn)化硬件電路的設(shè)計(jì)方法對(duì)實(shí)際的進(jìn)化硬件設(shè)計(jì)具有一定的實(shí)際指導(dǎo)意義,提出的基于專用類(lèi)基核FPGA電路結(jié)構(gòu)的研究方法為新型進(jìn)化硬件的器件結(jié)構(gòu)的設(shè)計(jì)也可提供一種借鑒.
標(biāo)簽： FPGA 可重構(gòu) 通訊 糾錯(cuò)
上傳時(shí)間： 2013-07-01
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·詳細(xì)說(shuō)明：北京航空航天大學(xué)電子信息工程學(xué)院 許小劍編的《雷達(dá)成像原理》word版
上傳時(shí)間： 2013-04-24
上傳用戶：litianchu
·本書(shū)介紹了現(xiàn)代傳感技術(shù)及檢測(cè)技術(shù)的概括，闡明了動(dòng)態(tài)測(cè)量和其他檢測(cè)理論及其應(yīng)用，詳細(xì)論述了各種傳感器的結(jié)構(gòu)、原理。 本書(shū)可作為電子科學(xué)與技術(shù)、測(cè)控技術(shù)及儀器、電子信息工程、自動(dòng)化等專業(yè)的本科生和研究生教學(xué)用書(shū)或者參考書(shū)，也可供從事電子信息類(lèi)工作的科技人員參考。
標(biāo)簽： 傳感技術(shù)
上傳時(shí)間： 2013-04-24
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Protel 99 SE是當(dāng)今最流行的電子電路計(jì)算機(jī)輔助設(shè)計(jì)（電子CAD）軟件之一。本書(shū)由淺入深系統(tǒng)地介紹了 Protel 99 SE的實(shí)用功能,本書(shū)可作為大中專院校電子類(lèi)、電氣類(lèi)、機(jī)電類(lèi)、自動(dòng)化類(lèi)、計(jì)算機(jī)類(lèi)、信息工程類(lèi)等專業(yè)和相關(guān)培訓(xùn)的電子電路計(jì)算機(jī)輔助設(shè)計(jì)（電子CAD）課程教材，也可作為從事電路設(shè)計(jì)工作的技術(shù)人員和電了愛(ài)好者的參考書(shū)。
上傳時(shí)間： 2013-09-14
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開(kāi)關(guān)在電路中起接通信號(hào)或斷開(kāi)信號(hào)的作用。最常見(jiàn)的可控開(kāi)關(guān)是繼電器，當(dāng)給驅(qū)動(dòng)繼電器的驅(qū)動(dòng)電路加高電平或低電平時(shí)，繼電器就吸合或釋放，其觸點(diǎn)接通或斷開(kāi)電路。CMOS模擬開(kāi)關(guān)是一種可控開(kāi)關(guān)，它不象繼電器那樣可以用在大電流、高電壓場(chǎng)合，只適于處理幅度不超過(guò)其工作電壓、電流較小的模擬或數(shù)字信號(hào)。 一、常用CMOS模擬開(kāi)關(guān)引腳功能和工作原理 1.四雙向模擬開(kāi)關(guān)CD4066 CD4066 的引腳功能如圖1所示。每個(gè)封裝內(nèi)部有4個(gè)獨(dú)立的模擬開(kāi)關(guān)，每個(gè)模擬開(kāi)關(guān)有輸入、輸出、控制三個(gè)端子，其中輸入端和輸出端可互換。當(dāng)控制端加高電平時(shí)，開(kāi)關(guān)導(dǎo)通；當(dāng)控制端加低電平時(shí)開(kāi)關(guān)截止。模擬開(kāi)關(guān)導(dǎo)通時(shí)，導(dǎo)通電阻為幾十歐姆；模擬開(kāi)關(guān)截止時(shí)，呈現(xiàn)很高的阻抗，可以看成為開(kāi)路。模擬開(kāi)關(guān)可傳輸數(shù)字信號(hào)和模擬信號(hào)，可傳輸?shù)哪M信號(hào)的上限頻率為40MHz。各開(kāi)關(guān)間的串?dāng)_很小，典型值為－50dB。
標(biāo)簽： CMOS 模擬開(kāi)關(guān) 工作原理
上傳時(shí)間： 2013-10-27
上傳用戶：bibirnovis
對(duì)於許多電子子繫統(tǒng)而言，比如：VFD (真空熒光顯示屏)、TFT-LCD、GPS 或 DSL 應(yīng)用，僅采用一個(gè)簡(jiǎn)單的降壓或升壓型 DC/DC 轉(zhuǎn)換器並不能滿足其要求
上傳時(shí)間： 2014-12-24
上傳用戶：nostopper
電子設(shè)備的 ON/OFF 按鈕給繫統(tǒng)設(shè)計(jì)師帶來(lái)了一組獨(dú)特的挑戰(zhàn)
標(biāo)簽： OFF 保險(xiǎn) 電壓監(jiān)視 按鈕
上傳時(shí)間： 2013-10-13
上傳用戶：18165383642
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