39839電感量計算小巧實用的綠色軟件，根據輸入的線圈長度、線圈直徑、導線直徑、線圈匝數及工作頻率快速計算出電感量、自分布電容、空載Q值、自諧振頻率
上傳時間： 2013-06-03
上傳用戶：夜月十二橋
隨著科學技術的發(fā)展與公共安全保障需求的提高，視頻監(jiān)控系統(tǒng)在工業(yè)生產、日常生活、警備與軍事方面的應用越來越廣泛。采用基于 FPGA 的SOPC技術、H．264壓縮編碼技術和網絡傳輸控制技術實現網絡視頻監(jiān)控系統(tǒng)，在穩(wěn)定性、功能、成本與擴展性等方面都有著突出的優(yōu)勢，具有重要的學術意義與實用意義， 本課題所設計的網絡視頻監(jiān)控系統(tǒng)由以Nios Ⅱ為核心的嵌入式圖像服務器、相關網絡設備與若干PC機客戶端組成。嵌入式圖像服務器實時采集圖像，采用H．264 編碼算法進行壓縮，并持續(xù)監(jiān)聽網絡。PC機客戶端可通過網絡對服務器進行遠程訪問，接收編碼數據，使用H．264解碼算法重建圖像并實時顯示，使監(jiān)控人員有效地掌握現場情況， 在嵌入式圖像服務器設計階段，本文首先進行了芯片選型與開發(fā)平臺選擇。然后構建圖像采集子系統(tǒng)，采用雙緩存乒乓交換的方法設計圖像采集用戶自定義模塊。接著設計雙Nios Ⅱ架構的SOPC系統(tǒng)，闡述了雙軟核設計中定制連接、內存芯片共享、數據搬移、通信與互斥的解決方法。同時完成了網絡服務器的設計，采用μC/OS-Ⅱ進行多任務的管理與調度， H．264視頻壓縮編解碼算法設計與實現是本文的重點。文中首先分析H．264．標準，規(guī)劃編解碼器結構。接著設計了16×16幀內預測算法，并設計宏塊掃描方式，采用兩次判決策略進行預測模式選擇。然后設計4×4子塊掃描方式，編寫整數變換與量化算法程序。熵編碼采用Exp-Golomb編碼與CAVLC相結合的方案，針對除拖尾系數之外的非零系數值編碼子算法，實現了一種基于表示范圍判別的編碼方法。最后設計了網絡傳輸的碼流組成格式，并針對編碼算法設計相應解碼算法。使用VC++完成算法驗證，并進行測試，觀察不同參數下壓縮率與失真度的變化。 算法驗證完成后，本文進行了PC機客戶端設計，使其具有遠程訪問、H．264解碼與實時顯示的功能。同時將H．264 編碼算法程序移植到NiosⅡ中，并將嵌入式圖像服務器與若干客戶端接入網絡進行聯合調試，構建完整的網絡視頻監(jiān)控系統(tǒng)， 實驗結果表明，本系統(tǒng)視頻壓縮率高，監(jiān)控圖像質量良好，充分證明了系統(tǒng)軟硬件與圖像編解碼算法設計成功。本系統(tǒng)具有成本低、擴展性好及適用范圍廣等優(yōu)點，發(fā)展前景十分廣闊。
標簽： FPGA 264 網絡視頻監(jiān)控 實現研究
上傳時間： 2013-08-03
上傳用戶：88mao
自適應天線技術、擴頻技術是提高通信系統(tǒng)抗干擾能力的有效手段.本課題短波電臺擴頻-自適應天線抗干擾系統(tǒng)的目的是將自適應天線技術與擴頻技術結合起來,使短波通信系統(tǒng)具有對抗各種干擾的性能,保證在惡劣的電磁環(huán)境中實現正常通信.本文主要工作如下:·研究了強干擾環(huán)境下的PN碼同步,給出了設計中關鍵指標的選取原則;·分析了參考信號提取的原理,提出了適合于本課題的設計方案;·給出了擴頻偽隨機碼PN1、導引信號偽隨機碼PN2的選取方法;·基于FPGA,給出了系統(tǒng)設計中PN碼同步,參考信號提取的具體實現.
上傳時間： 2013-04-24
上傳用戶：zzbbqq99n
隨著電子技術和信息技術的發(fā)展，可編程邏輯器件的應用領域越來越寬。可編程SoC設計已成為SoC設計的新方法。論文介紹了可編程邏輯器件的設計方法和開發(fā)技術，并用硬件描述語言和FPGA／CPLD設計技術，探索和研究了基于FPGA的RISCMCU的設計與實現過程。 論文參照Mircochip公司的PICl6C5X單片機的體系結構，設計了8位RISCMCU。該嵌入式MCU設計采用了自頂向下的設計方法和模塊化設計思想。MCU總體結構設計劃分控制模塊、ALU模塊、存儲模塊三大模塊。然后，對各模塊的具體技術實現細節(jié)分別進行了闡述。論文中設計的MCU能實現PICl6C5X單片機33條指令中除OPTION、CLRWDT、SLEEP和TRIS四條指令以外的其余29條指令的功能，但應用是基于FPGA的，能與其他外設IP方便的結合在一起使用，比ASIC的PICl6C57X的應用更具靈活性。 軟件仿真和硬件驗證表明：所設計的嵌入式MCU在各方面均達到了一定的性能指標，在Altera公司ACEX1K系列的EPlK30TCl44-3器件上的工作頻率達21.88MHz。這些為自主設計R／SCMCU的IP核提供了值得借鑒的探索成果和設計思路，在通用控制領域也有一定的實用價值。 此外，論文中還介紹了三相SPWM控制模塊的設計，該模塊具有死區(qū)時間和載波比任意可調的特點，可以單獨應用，也可以作為MCU的外設子模塊應用。
上傳時間： 2013-07-16
上傳用戶：熊少鋒
激光測距技術被廣泛應用于現代工業(yè)測量、航空與大地的測量、國防及通信等諸多領域。本文從已獲得廣泛應用的脈沖激光測距技術入手，重點分析了近年提出的自觸發(fā)脈沖激光測距技術(STPLR)特別是其中的雙自觸發(fā)脈沖激光測距技術(BSTPLR)，通過分析發(fā)現其核心部件之一就是用于測量激光脈沖飛行時間(周期)的高精度高速計數器，而目前一般的方式是采用昂貴的進口高速計數器或專用集成電路(ASIC)來完成，這使得激光測距儀在研發(fā)、系統(tǒng)的改造升級和自主知識產權保護等諸多方面受到制約，同時在其整體性能上特別是在集成化、小型化和高可靠性方面帶來阻礙。為此，本文研究了采用現場可編程門陣列(FPGA)來實現脈沖激光測距中的高精度高速計數及其他相關功能，基本解決了以上存在的問題。 論文通過對雙自觸發(fā)脈沖激光測距的主要技術要求和技術指標進行分析，對其中的信號處理單元采用了FPGA+單片機的設計形式。由FPGA主控芯片(EPF10K20TC144-4)作為周期測量模塊，在整個測距系統(tǒng)中是信號處理的核心部件，借助其用戶可編程特性及很高的內部時鐘頻率，設計了專用于BSTPLR的高速高精度計數芯片，負責對測距信號產生電路中的時刻鑒別電路輸出信號進行計數。數據處理模塊則主要由單片機(AT89C51)來實現。系統(tǒng)可以通過鍵盤預置門控信號的寬度以均衡測量的精度和速度，測量結果采用7位LED數碼管顯示。本設計在近距離(大尺寸)范圍內實驗測試時基本滿足設計要求。
上傳時間： 2013-04-24
上傳用戶：dapangxie
正交頻分復用(OFDM)技術是一種多載波數字調制技術，它具有頻譜利用率高、抗多徑能力強等特點，在寬帶無線多媒體通信領域中受到了廣泛的關注。 OFDM系統(tǒng)可分為連續(xù)工作模式和突發(fā)工作模式。在IEEE802.11a、HiperLANType2等無線局域網標準中采用了OFDM的突發(fā)工作模式，該模式下的接收機首先對符合某種特定格式的幀做出檢測。本文介紹了一種基于最小錯誤概率準則的幀檢測算法，提出了該算法的FPGA實現方案。 同步技術是OFDM最關鍵的技術之一，它包括載波頻率同步和符號同步。載波頻率同步是為了糾正接收端相對于發(fā)送端的載波頻率偏移，以保證子載波間的正交性；符號同步確定OFDM符號有用數據信息的開始時刻，也就是確定FFT窗的開始時刻。本文首先介紹了一種基于自相關的載波頻率同步算法，給出了它的FPGA實現方案，重點講述了其中用到的Cordic算法及其實現；然后介紹了分別基于互相關和自相關的兩種符號同步算法，給出了各自的FPGA實現方案，從實現的角度比較了兩種算法的優(yōu)缺點，并且在FPGA設計中體現了面積復用和流水線操作的設計思想。 文章最后介紹了系統(tǒng)調試的情況，總結出一種ChipScopePro與Matlab相結合的調試方法，該方法在FPGA調試方面具有一定的通用性。
上傳時間： 2013-07-16
上傳用戶：Killerboo
GPS技術在導航、定位及精確打擊等方面產生了重要影響，已經廣泛地應用在各種武器平臺上。但是，在干擾環(huán)境下也顯現出許多問題。由于其到達地球表面的信號極其微弱(-160dBW)，在現在復雜的電磁環(huán)境中容易受到干擾，尤其是C/A碼信號更易受到干擾，并且隨著導航戰(zhàn)的發(fā)展對GPS的抗干擾已成為爭取導航資源的有效措施。因此，研究干擾環(huán)境下的GPS接收機設計具有重要意義。 本文首先簡要介紹了GPS信號的結構及構成，通過對GPS信號特征以及接收機抗干擾能力的分析，結合干擾對接收機的作用方式及效果，確定GPS最易受的干擾類型為阻塞式干擾，然后針對這種干擾類型提出了一種有效的抗干擾技術-----自適應調零天線技術。接下來，著重研究了GPS接收機在此抗干擾技術前提下的若干抗干擾方法，并對其進行了詳細的分析和討論。 研究過程中，通過對最佳化準則和空域自適應濾波的理解，首先對不同天線陣列結構進行了性能仿真和比較分析，然后在對稱圓形天線陣列的基礎上對空域自適應算法進行了仿真分析，針對其自由度有限的問題接著對空時濾波方法做了詳細討論，在7元對稱圓形陣列的基礎上仿真說明了二者各自的優(yōu)缺點。考慮到實際的干擾環(huán)境和本課題研究的初期階段，因此選用了適合本課題干擾環(huán)境的空域濾波方法，并對其自適應算法進行了適當的改進，使得其抗干擾性能獲得了一定程度的改善。 最后，詳細說明了該接收機抗干擾模塊的FPGA實現原理。詳細給出了頂層及各子模塊的設計流程與RTL視圖，實驗結果驗證了該算法的有效性。
上傳時間： 2013-06-03
上傳用戶：xfbs821
人臉識別技術繼指紋識別、虹膜識別以及聲音識別等生物識別技術之后，以其獨特的方便、經濟及準確性而越來越受到世人的矚目。作為人臉識別系統(tǒng)的重要環(huán)節(jié)—人臉檢測，隨著研究的深入和應用的擴大，在視頻會議、圖像檢索、出入口控制以及智能人機交互等領域有著重要的應用前景，發(fā)展速度異常迅猛。 FPGA的制造技術不斷發(fā)展，它的功能、應用和可靠性逐漸增加，在各個行業(yè)也顯現出自身的優(yōu)勢。FPGA允許用戶根據自己的需要來建立自己的模塊，為用戶的升級和改進留下廣闊的空間。并且速度更高，密度也更大，其設計方法的靈活性降低了整個系統(tǒng)的開發(fā)成本，FPGA 設計成為電子自動化設計行業(yè)不可缺少的方法。 本文從人臉檢測算法入手，總結基于FPGA上的嵌入式系統(tǒng)設計方法，使用IBM的Coreconnect掛接自定義模塊技術。經過訓練分類器、定點化、以及硬件加速等方法后，能夠使人臉檢測系統(tǒng)在基于Xilinx的Virtex II Pro開發(fā)板上平臺上，達到實時的檢測效果。本文工作和成果可以具體描述如下： 1. 算法分析：對于人臉檢測算法，首先確保的是檢測率的準確性程度。本文所采用的是基于Paul Viola和Michael J.Jones提出的一種基于Adaboost算法的人臉檢測方法。算法中較多的是積分圖的特征值計算，這便于進一步的硬件設計。同時對檢測算法進行耗時分析確定運行速度的瓶頸。 2. 軟硬件功能劃分：這一步考慮市場可以提供的資源狀況，又要考慮系統(tǒng)成本、開發(fā)時間等諸多因素。Xilinx公司提供的Virtex II Pro開發(fā)板，在上面有可以供利用的Power PC處理器、可擴展的存儲器、I/O接口、總線及數據通道等，通過分析可以對算法進行細致的劃分，實現需要加速的模塊。 3. 定點化：在Adaboost算法中，需要進行大量的浮點計算。這里采用的方法是直接對數據位進行操作它提取指數和尾數，然后對尾數執(zhí)行移位操作。 4. 改進檢測用的級聯分類器的訓練，提出可以迅速提高分類能力、特征數量大大減小的一種訓練方法。 5. 最后對系統(tǒng)的整體進行了驗證。實驗表明，在視頻輸入輸出接入的同時，人臉檢測能夠達到17fps的檢測速度，并且獲得了很好的檢測率以及較低的誤檢率。
標簽： FPGA 人臉檢測 系統(tǒng)設計
上傳時間： 2013-04-24
上傳用戶：大融融rr
隨著數字圖像處理的應用領域不斷擴大，實時處理技術成為研究的熱點。VLSI技術的迅猛發(fā)展為數字圖像實時處理技術提供了硬件基礎。其中FPGA(現場可編程門陣列)的特點使其在圖像采集和處理方面的應用顯得更加經濟、靈活、方便。 本文設計了一種以FPGA為工作核心，并實現了PCI接口的圖像采集壓縮系統(tǒng)。整個系統(tǒng)采用了自頂向下的設計方案，先把系統(tǒng)分成了三大塊，即圖像采集、PCI接口和圖像壓縮，然后分別設計各個大模塊中的子模塊。 首先，利用FPGA對專用視頻轉換器SAA7111A進行控制，因為SAA7111A是采用IC總線模塊，從而完成了對SAA7111A的控制，并通過設計圖像采集模塊、讀/寫數據模塊、總線管理模塊等，實現把標準的模擬視頻信號轉換成數字視頻信號并采集的功能。 其次，在了解PCI規(guī)范的前提下，深入地分析了PCI時序和地址配置空間等，設計了簡化邏輯的狀態(tài)機，并用VHDL硬件描述語言設計了程序，完成了簡化邏輯的PCI接口設計在FPGA芯片內部的實現，達到了一33MHz、32位數據寬度、支持猝發(fā)傳輸的PCI從設備模塊的接口功能，與傳統(tǒng)的使用PCI專用接口芯片來實現的PCI接口比較來看，更加節(jié)約了系統(tǒng)的邏輯資源，降低了成本，增加了設計的靈活性。 再次，設計了WINDOWS下對PCI接口的驅動程序。驅動程序可以選擇不同的方法來完成，當然每個方法都有自己的特點，對幾種主要設計驅動程序的方法作以比較之后，本文選擇了使用DRIVER WORKS工具來完成。通過對配置空間的設計、系統(tǒng)端口和內存映射的設計、中斷服務的設計等，用VC++語言編寫了驅動程序。 最后，考慮到增加系統(tǒng)的實用性和完備性，還填加設計了圖像的壓縮部分。這部分需要完成的工作是在上述系統(tǒng)完成后，再額外地把采集來的視頻數據通過另一路數據通道按照一定的格式壓縮后存儲到硬盤中。本系統(tǒng)中，這部分設計是利用Altera公司提供的IP核來完成壓縮的，同時還用VHDL語言在FPGA上設計了IDE硬盤接口，使壓縮后的數據存儲到硬盤中。
上傳時間： 2013-06-01
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可靠通信要求消息從信源到信宿盡量無誤傳輸，這就要求通信系統(tǒng)具有很好的糾錯能力，如使用差錯控制編碼。自仙農定理提出以來，先后有許多糾錯編碼被相繼提出，例如漢明碼，BCH碼和RS碼等，而C。Berrou等人于1993年提出的Turbo碼以其優(yōu)異的糾錯性能成為通信界的一個里程碑。 然而，Turbo碼迭代譯碼復雜度大，導致其譯碼延時大，故而在工程中的應用受到一定限制，而并行Turbo譯碼可以很好地解決上述問題。本論文的主要工作是通過硬件實現一種基于幀分裂和歸零處理的新型并行Turbo編譯碼算法。論文提出了一種基于多端口存儲器的并行子交織器解決方法，很好地解決了并行訪問存儲器沖突的問題。 本論文在現場可編程門陣列(FPGA)平臺上實現了一種基于幀分裂和籬笆圖歸零處理的并行Turbo編譯碼器。所實現的并行Turbo編譯碼器在時鐘頻率為33MHz，幀長為1024比特，并行子譯碼器數和最大迭代次數均為4時，可支持8.2Mbps的編譯碼數掘吞吐量，而譯碼時延小于124us。本文還使用EP2C35FPGA芯片設計了系統(tǒng)開發(fā)板。該開發(fā)板可提供高速以太網MAC／PHY和PCI接口，很好地滿足了通信系統(tǒng)需求。系統(tǒng)測試結果表明，本文所實現的并行Turbo編譯碼器及其開發(fā)板運行正確、有效且可靠。 本論文主要分為五章，第一章為緒論，介紹Turbo碼背景和硬件實現相關技術。第二章為基于幀分裂和歸零的并行Turbo編碼的設計與實現，分別介紹了編碼器和譯碼器的RTL設計，還提出了一種基于多端口存儲器的并行子交織器和解交織器設計。第三章討論了使用NIOS處理器的SOC架構，使用SOC架構處理系統(tǒng)和基于NIOSII處理器和uC／0S一2操作系統(tǒng)的架構。第四章介紹了FPGA系統(tǒng)開發(fā)板設計與調試的一些工作。最后一章為本文總結及其展望。
上傳時間： 2013-04-24
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