六通道航模遙控發(fā)射接收機(jī)電路剖析
標(biāo)簽： 六通道 航模 接收機(jī)電路 遙控發(fā)射
上傳時(shí)間： 2013-10-19
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電子產(chǎn)品功能越來越強(qiáng)大的同時(shí)，對(duì)便攜的要求也越來越高，小型化設(shè)計(jì)成為很多電子設(shè)計(jì)公司的研究課題。本文以小型化設(shè)計(jì)的方法、挑戰(zhàn)和趨勢(shì)為主線，結(jié)合Cadence SPB16.5在小型化設(shè)計(jì)方面的強(qiáng)大功能，全面剖析小型化設(shè)計(jì)的工程實(shí)現(xiàn)。主要包括以下內(nèi)容：小型化設(shè)計(jì)的現(xiàn)狀和趨勢(shì)，以及現(xiàn)在主流的HDI加工工藝，介紹最新的ANYLAYER（任意階）技術(shù)的設(shè)計(jì)方法以及工藝實(shí)現(xiàn)，介紹埋阻、埋容的應(yīng)用，埋入式元器件的設(shè)計(jì)方法以及工藝實(shí)現(xiàn)。同時(shí)介紹Cadence SPB16.5軟件對(duì)小型化設(shè)計(jì)的支持。最后介紹HDI設(shè)計(jì)在高速中的應(yīng)用以及仿真方法，HDI在通信系統(tǒng)類產(chǎn)品中的應(yīng)用，HDI和背鉆的比較等。
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上傳時(shí)間： 2013-10-08
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深入剖析賽靈思（Xilinx）All Programmable三大創(chuàng)新器件:賽靈思在 28nm 節(jié)點(diǎn)上推出的多種新技術(shù)為客戶帶來了重大的超前價(jià)值，并使賽靈思領(lǐng)先競(jìng)爭(zhēng)對(duì)手整整一代。賽靈思并不是簡(jiǎn)單地將現(xiàn)有的 FPGA 架構(gòu)遷移到新的技術(shù)節(jié)點(diǎn)上，而是力求引領(lǐng)多種 FPGA 創(chuàng)新，并率先推出了 All Programmable 3D IC 和 SoC。 今天推出的 All Programmable 產(chǎn)品采用了各種形式的可編程技術(shù)，包括可編程硬件和軟件、數(shù)字信號(hào)和模擬混合信號(hào)（AMS）、單晶片和多片 3D IC 方案（圖 1）。有了這些全新的 All Programmable 器件，設(shè)計(jì)團(tuán)隊(duì)就能進(jìn)一步提升可編程系統(tǒng)的集成度，提高整體系統(tǒng)性能，降低 BOM 成本，并以更快的速度向市場(chǎng)推出更具創(chuàng)新性的智能產(chǎn)品。
標(biāo)簽： Programmable Xilinx All 賽靈思
上傳時(shí)間： 2013-10-29
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全新賽靈思（Xilinx）FPGA 7系列芯片精彩剖析:賽靈思的最新7系列FPGA芯片包括3個(gè)子系列，Artix-7、 Kintex-7和Virtex-7。在介紹芯片之前，先看看三個(gè)子系列芯片的介紹表，如下表1所示： 表1 全新Xilinx FPGA 7系列子系列介紹表 (1) Artix-7 FPGA系列——業(yè)界最低功耗和最低成本 通過表1我們不難得出以下結(jié)論： 與上一代 FPGA相比，其功耗降低了50%，成本削減了35%，性能提高30%，占用面積縮減了50%，賽靈思FPGA芯片在升級(jí)中，功耗和性能平衡得非常好。
標(biāo)簽： Xilinx FPGA 賽靈思 系列芯片
上傳時(shí)間： 2013-12-20
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自適應(yīng)多速率AMR技術(shù)剖析 自適應(yīng)多速率AMR技術(shù)剖析
標(biāo)簽： AMR 自適應(yīng)多速率
上傳時(shí)間： 2013-10-22
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電阻、電容、電感及其阻抗、容抗、感抗概念回顧
上傳時(shí)間： 2013-11-11
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隨著USB技術(shù)日趨成熟，USB開發(fā)者只需要關(guān)注頂層開發(fā)即可，這樣雖然減少了工作量，但容易使開發(fā)者忽略USB基礎(chǔ)理論與概念，導(dǎo)致的弊端在于開發(fā)者一旦遇到問題，往往不知如何解決。作者基于多年USB開發(fā)經(jīng)驗(yàn)，針對(duì)當(dāng)前很多USB開發(fā)者容易混淆的概念，進(jìn)行深入淺出的剖析，針對(duì)枚舉和重枚舉的區(qū)別、不同啟動(dòng)方式的區(qū)別等問題，進(jìn)行了歸納總結(jié)。本文從對(duì)比的角度分析問題，有助于開發(fā)者理清USB的工作機(jī)理。
標(biāo)簽： USB
上傳時(shí)間： 2013-10-26
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發(fā)現(xiàn)了C*Core國芯芯片中SCI發(fā)送與接受方波特率誤差導(dǎo)致數(shù)據(jù)不匹配問題，分析了發(fā)送與接受方數(shù)據(jù)傳輸丟幀、誤幀現(xiàn)象出現(xiàn)的根本原因，總結(jié)了SCI容限值與芯片主頻及標(biāo)準(zhǔn)波特率之間規(guī)律，提出了解決問題的優(yōu)化方案并通過C*Core C語言編寫程序?qū)崿F(xiàn)。實(shí)驗(yàn)證明，優(yōu)化后的SCI初始化程序可確保SCI發(fā)送與接收方不受波特率設(shè)置值、芯片主頻大小影響，使數(shù)據(jù)傳輸過程中不丟幀、不誤幀。
上傳時(shí)間： 2013-10-09
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隨著總線和接口技術(shù)的發(fā)展，在工業(yè)場(chǎng)合如何更加可靠、快速、便捷地進(jìn)行數(shù)據(jù)傳輸成為該領(lǐng)域通信的研究重點(diǎn)之一。而USB技術(shù)以其高速、可靠、通用性強(qiáng)等一系列特點(diǎn)在過去的十多年時(shí)間里發(fā)展迅猛，而USB OTG技術(shù)的誕生，使得兩USB設(shè)備在沒有PC參與的情況下進(jìn)行數(shù)據(jù)傳輸成為可能。本文通過搭建以16位微處理器MSP430F149為核心控制芯片、ISPl362為USB接口芯片的硬件平臺(tái)，分別實(shí)現(xiàn)了USB部分主機(jī)和從機(jī)功能，使之能進(jìn)行USB數(shù)據(jù)的存儲(chǔ)與交換。本文完成以下工作：首先，認(rèn)真研究USB協(xié)議，深入理解USB通信的基本概念和傳輸方式等內(nèi)容。仔細(xì)分析USB Mass Storage類協(xié)議，并討論了采用BULK-ONLY傳輸實(shí)現(xiàn)Mass Storage類協(xié)議的方法，并對(duì)SCSI指令集等進(jìn)行了深入的剖析。其次，根據(jù)要求，設(shè)計(jì)出由控制、接口、數(shù)據(jù)存儲(chǔ)、過流保護(hù)與供電切換電路等硬件模塊組成的系統(tǒng)，在ALTIUM 2004軟件上完成原理圖的設(shè)計(jì)和PCB圖的布局、布線，并完成硬件調(diào)試工作。再次，在已構(gòu)建的硬件平臺(tái)上，針對(duì)ISPl362 USB接口芯片的主／從機(jī)功能，分別設(shè)計(jì)了USB主機(jī)和從機(jī)的固件程序。利用IAR Workbench、BusHound等軟件進(jìn)行固件程序的調(diào)試，最終USB主機(jī)可對(duì)u盤進(jìn)行檢測(cè)、識(shí)別與配置；USB設(shè)備實(shí)現(xiàn)了USB設(shè)備的基本功能，能夠被Windows XP操作系統(tǒng)識(shí)別，與PC機(jī)之間實(shí)現(xiàn)數(shù)據(jù)的批量傳輸。最后，用DriverWorks軟件包的Driver Wizard生成驅(qū)動(dòng)程序框架，并利用Windows DDK和vc++等軟件進(jìn)行驅(qū)動(dòng)程序的編譯，最終生成基于Windows操作系統(tǒng)的WDM型USB設(shè)備驅(qū)動(dòng)程序。通過對(duì)USB通信協(xié)議的研究，本人成功地構(gòu)建了以MsP430F149和ISPl362為核心的硬件試驗(yàn)平臺(tái)，并在此平臺(tái)上進(jìn)行USB主機(jī)、從機(jī)通信試驗(yàn)。經(jīng)測(cè)試表明，PC機(jī)能檢測(cè)、識(shí)別、讀寫USB設(shè)備，其讀取與寫入速度分別為560KB／s和312Ⅺ玳。而主機(jī)能識(shí)別、配置接入的U盤。關(guān)鍵詞：USB主機(jī)、USB從機(jī)、MSI'430F149、ISPl362、BuR-Only傳輸
上傳時(shí)間： 2013-10-11
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華容道源程序
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上傳時(shí)間： 2015-01-07
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