RSM1843 是四線電阻式觸摸屏控制芯片。電路是一個(gè)12bit 模數(shù)轉(zhuǎn)換器（ADC），內(nèi)置 同步串行數(shù)據(jù)接口和驅(qū)動觸摸屏的低阻開關(guān)。基準(zhǔn)電壓（Vref）變化范圍從1V 到+Vcc，相 應(yīng)的輸入電壓范圍為0V 到Vref。電路提供了關(guān)斷模式，功耗可降低至0.5W。RSM1843 工 作電壓能低至2.7V，是電池供電設(shè)備的理想選擇，可適用于電阻式觸摸屏的PDA 等便攜設(shè)備。
標(biāo)簽： 1843 RSM 四線電阻式 觸摸屏控制芯片
上傳時(shí)間： 2013-11-19
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陷波器是無限沖擊響應(yīng)(IIR)數(shù)字濾波器，該濾波器可以用以下常系數(shù)線性差分方程表示：ΣΣ==−−−=MiNiiiinybinxany01)()()( (1)式中： x(n)和y(n)分別為輸人和輸出信號序列；和為濾波器系數(shù)。 iaib對式(1)兩邊進(jìn)行z變換，得到數(shù)字濾波器的傳遞函數(shù)為： ΠΠΣΣ===−=−−−==NiiMiiNiiiMiiipzzzzbzazH1100)()()( (2)式中：和分別為傳遞函數(shù)的零點(diǎn)和極點(diǎn)。 izip由傳遞函數(shù)的零點(diǎn)和極點(diǎn)可以大致繪出頻率響應(yīng)圖。在零點(diǎn)處，頻率響應(yīng)出現(xiàn)極小值；在極點(diǎn)處，頻率響應(yīng)出現(xiàn)極大值。因此可以根據(jù)所需頻率響應(yīng)配置零點(diǎn)和極點(diǎn)，然后反向設(shè)計(jì)帶陷數(shù)字濾波器。考慮一種特殊情況，若零點(diǎn)在第1象限單位圓上，極點(diǎn)在單位圓內(nèi)靠近零點(diǎn)的徑向上。為了防止濾波器系數(shù)出現(xiàn)復(fù)數(shù)，必須在z平面第4象限對稱位置配置相應(yīng)的共軛零點(diǎn)、共軛極點(diǎn)。 izip∗iz∗ip這樣零點(diǎn)、極點(diǎn)配置的濾波器稱為單一頻率陷波器，在頻率ωo處出現(xiàn)凹陷。而把極點(diǎn)設(shè)置在零的的徑向上距圓點(diǎn)的距離為l-μ處，陷波器的傳遞函數(shù)為： ))1()()1(())(()(2121zzzzzzzzzHμμ−−−−−−= (3)式(3)中μ越小，極點(diǎn)越靠近單位圓，則頻率響應(yīng)曲線凹陷越深，凹陷的寬度也越窄。當(dāng)需要消除窄帶干擾而不能對其他頻率有衰減時(shí)，陷波器是一種去除窄帶干擾的理想數(shù)字濾波器。當(dāng)要對幾個(gè)頻率同時(shí)進(jìn)行帶陷濾波時(shí)，可以按(2)式把幾個(gè)單獨(dú)頻率的帶陷濾波器(3)式串接在一起。一個(gè)例子：設(shè)有一個(gè)輸入，它
上傳時(shí)間： 2013-10-18
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PCI Express 協(xié)議由于其高速串行、系統(tǒng)拓?fù)浜唵蔚忍攸c(diǎn)被廣泛用于各種領(lǐng)域。Altera公司的Arria II GX FPGA內(nèi)集成了支持鏈?zhǔn)紻MA傳輸功能的PCI Express硬核，適應(yīng)了PCI Express總線高速度的要求。文中利用Jungo公司的WinDriver軟件實(shí)現(xiàn)了鏈?zhǔn)紻MA的上層應(yīng)用設(shè)計(jì)。首先給出了鏈?zhǔn)紻MA實(shí)現(xiàn)的基本過程，接著分析了鏈?zhǔn)紻MA數(shù)據(jù)傳輸需要處理的幾個(gè)問題，給出了相應(yīng)的解決辦法和策略。采用這些方法，保證了DAM數(shù)據(jù)傳輸?shù)恼_性，簡化了底層FPGA應(yīng)用邏輯的設(shè)計(jì)。
標(biāo)簽： WinDriver DMA 上傳時(shí)間： 2013-11-20
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WP369可擴(kuò)展式處理平臺-各種嵌入式系統(tǒng)的理想解決方案 ：Delivering unrivaled levels of system performance,flexibility, scalability, and integration to developers,Xilinx's architecture for a new Extensible Processing Platform is optimized for system power, cost, and size. Based on ARM's dual-core Cortex™-A9 MPCore processors and Xilinx’s 28 nm programmable logic,the Extensible Processing Platform takes a processor-centric approach by defining a comprehensive processor system implemented with standard design methods. This approach provides Software Developers a familiar programming environment within an optimized, full featured,powerful, yet low-cost, low-power processing platform.
標(biāo)簽： 369 WP 擴(kuò)展式 處理平臺
上傳時(shí)間： 2013-10-22
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賽靈思的新型可擴(kuò)展式處理平臺架構(gòu)可為開發(fā)人員提供無與倫比的系統(tǒng)性能、靈活性、可擴(kuò)展性和集成度，并為降低系統(tǒng)功耗、成本和縮小尺寸進(jìn)行了精心優(yōu)化。 可擴(kuò)展式處理平臺基于 ARM 的雙核 Cortex™-A9MPCore 處理器以及賽靈思的 28nm 可編程邏輯之上，采用以處理器為核心的設(shè)計(jì)方案，并能定義通過標(biāo)準(zhǔn)設(shè)計(jì)方法實(shí)施的綜合處理器系統(tǒng)。這種方案可為軟件開發(fā)人員在功能齊備且強(qiáng)大的優(yōu)化型低成本低功耗處理平臺上提供熟悉的編程環(huán)境。
標(biāo)簽： 369 WP 擴(kuò)展式 處理平臺
上傳時(shí)間： 2013-11-20
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容遲/容延網(wǎng)絡(luò)（Delay Tolerant Network/DTN）泛指由于節(jié)點(diǎn)移動、能量管理、調(diào)度等原因而出現(xiàn)頻繁中斷、甚至長時(shí)間處于中斷狀態(tài)的一類網(wǎng)絡(luò)。針對DTN具有的時(shí)延高、割裂頻繁、節(jié)點(diǎn)能量受限、以及節(jié)點(diǎn)移動性等特點(diǎn)，通過對DTN中基于復(fù)制策略的單播路由策略進(jìn)行分類和比較，提出了如何優(yōu)化DTN單播路由算法、提高網(wǎng)絡(luò)傳輸率的建議。
標(biāo)簽： 容遲網(wǎng)絡(luò) 策略 路由 算法研究
上傳時(shí)間： 2013-11-24
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電容式觸摸屏結(jié)構(gòu)、流程及控制點(diǎn)
上傳時(shí)間： 2013-10-26
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【陸】電容式傳感器的工作原理及結(jié)構(gòu)形式
上傳時(shí)間： 2013-11-06
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電容式傳感器論文電感式傳感器論文
上傳時(shí)間： 2014-12-29
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電容式觸摸屏入門(非常經(jīng)典)
標(biāo)簽： 電容式觸摸屏
上傳時(shí)間： 2013-10-23
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