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頻域算法

  • 無線擴頻集成電路開發(fā)中信道編解碼技術(shù)研究與FPGA實現(xiàn)

    本論文主要對無線擴頻集成電路設(shè)計中的信道編解碼算法進行研究并對其FPGA實現(xiàn)思路和方法進行相關(guān)研究。 近年來無線局域網(wǎng)IEEE802.11b標(biāo)準(zhǔn)建議物理層采用無線擴頻技術(shù),所以開發(fā)一套擴頻通信芯片具有重大的現(xiàn)實意義。無線擴頻通信系統(tǒng)與常規(guī)通信相比,具有很強的抗干擾能力,并具有信息蔭蔽、多址保密通信等特點。無線信道的特性較復(fù)雜,因此在無線擴頻集成電路設(shè)計中,加入信道編碼是提高芯片穩(wěn)定性的重要方法。 在了解擴頻通信基本原理的基礎(chǔ)上,本文提出了“串聯(lián)級聯(lián)碼+兩次交織”的信道編碼方案。串聯(lián)的級聯(lián)碼由外碼——(15,9,4)里德-所羅門(Reed-Solomon)碼,和內(nèi)碼-(2,1,3)卷積碼構(gòu)成,交織則采用交織深度為4的塊交織。重點對RS碼的時域迭代譯碼算法和卷積碼的維特比譯碼算法進行了詳細(xì)的討論,并完成信道編譯碼方案的性能仿真及用FPGA實現(xiàn)的方法。 計算機仿真的結(jié)果表明,采用此信道編碼方案可以較好的改善現(xiàn)有仿真系統(tǒng)的誤符號率。 本論文的內(nèi)容安排如下:第一章介紹了無線擴頻通信技術(shù)的發(fā)展?fàn)顟B(tài)以及國內(nèi)外開發(fā)擴頻通信芯片的現(xiàn)狀,并給出了本論文的研究內(nèi)容和安排。第二章主要介紹了擴頻通信的基本原理,主要包括擴頻通信的定義、理論基礎(chǔ)和分類,直接序列擴頻通信方式的數(shù)學(xué)模型。第三章介紹了基本的信道編碼原理,信道編碼的分類和各自的特點。第四章給出了本課題選擇的信道編碼方案——“串聯(lián)級聯(lián)碼+兩次交織”,詳細(xì)討論了方案中里德-所羅門(Reed-Solomon)碼和卷積碼的基本原理、編碼算法和譯碼算法。最后給出編碼方案的實際參數(shù)。第五章對第四章提出的編碼方案進行了性能仿真。第六章結(jié)合項目實際,討論了FPGA開發(fā)基帶擴頻通信系統(tǒng)的設(shè)計思路和方法。首先對FPGA開發(fā)流程以及實際開發(fā)的工具進行了簡要的介紹,然后給出了擴頻通信系統(tǒng)的總體設(shè)計。對發(fā)射和接收子系統(tǒng)中信道編碼、解碼等相關(guān)功能模塊的實現(xiàn)原理和方法進行分析。第七章對論文的工作進行總結(jié)。

    標(biāo)簽: FPGA 無線擴頻 信道編解 技術(shù)研究

    上傳時間: 2013-07-18

    上傳用戶:hbsunhui

  • 小波變換研究及其FPGA實現(xiàn)

    傅里葉變換是信號處理領(lǐng)域中較完善、應(yīng)用較廣泛的一種分析手段.但傅里葉變換只是一種時域或頻域的分析方法,它要求信號具有統(tǒng)計平穩(wěn),即時不變的特性.但是實際應(yīng)用中存在很多非平穩(wěn)信號,它們并不能很好的用傅立葉變換來處理.小波變換的出現(xiàn)解決了這個問題,它在處理非平穩(wěn)信號方面具有傅立葉變換無法比擬的優(yōu)越性.小波變換在通信技術(shù)、信號處理、地球物理、水利電力、醫(yī)療等領(lǐng)域中獲得了日益廣泛的應(yīng)用.小波變換的研究成為了當(dāng)今學(xué)術(shù)界的一個熱點.隨著現(xiàn)代數(shù)字信號處理朝著高速實時的方向發(fā)展,純軟件的程序式信號處理方法越來越不能滿足實際應(yīng)用的需求,因此人們希望用硬件電路來實現(xiàn)高速信號處理問題.基于以上原因,該文在研究了小波變換的基本理論和特點的基礎(chǔ)上,重點研究了小波變換的VLSI電路構(gòu)架,并用FPGA實現(xiàn)了它的功能.毫無疑問,該文所做的具體工作在理論和實踐上都有參考價值.論文中,在簡單介紹了小波變換的基本理論、特點和應(yīng)用;對信號小波變換分解,重構(gòu)的MATLAB算法進行了分析,為硬件實現(xiàn)奠定了理論基礎(chǔ).論文在研究了小波核心算法MALLAT算法的基礎(chǔ)上,以直觀的圖形方式描述了算法的流程圖;并由此提出了基于VLSI的電路模塊架構(gòu).根據(jù)上述模塊結(jié)構(gòu),對相關(guān)模塊進行了硬件描述語言(VERILOG-HDL)的建模,并且在仿真平臺上(ACTIVE-HDL)進行了仿真.在仿真正確的前提下,該文選用了EP20K100BC356-1V芯片作為目標(biāo)器件進行了綜合和后仿真,并且將仿真結(jié)果通過MATLAB與理論參數(shù)進行了比較,結(jié)果表明設(shè)計是正確的.對設(shè)計中存在的誤差和部分模塊的進一步優(yōu)化,該文也作了分析和說明,為下一步實現(xiàn)通用IP核設(shè)計奠定了基礎(chǔ).

    標(biāo)簽: FPGA 小波變換

    上傳時間: 2013-06-27

    上傳用戶:zhaoq123

  • 運動估計算法的FPGA仿真與實現(xiàn)研究

    隨著通信技術(shù)和計算機技術(shù)的發(fā)展,多媒體的應(yīng)用與服務(wù)越來越廣泛,視頻壓縮編碼技術(shù)也隨之成為非常重要的研究領(lǐng)域。運動估計是視頻壓縮編碼中的一項關(guān)鍵技術(shù)。由于視頻編碼系統(tǒng)的復(fù)雜性主要取決于運動估計算法,因此如何找到一種可靠、快速、性能優(yōu)良的運動估計算法一直是視頻壓縮編碼的研究熱點。運動估計在視頻編碼器中承擔(dān)的運算量最大、控制最為復(fù)雜,由于對視頻編碼的實時性要求,因此運動估計模塊一般都采用硬件來設(shè)計。 本文的目的是在FPGA芯片上設(shè)計實現(xiàn)一種更優(yōu)的易于硬件實現(xiàn)的塊匹配運動估計算法——二步搜索算法。全文首先討論了塊匹配運動估計理論及其主要技術(shù)指標(biāo),介紹了運動估計技術(shù)在MPEG-4中的應(yīng)用,然后在對典型的運動估計算法進行分析比較的基礎(chǔ)上討論了一種性能和硬件實現(xiàn)難易度綜合指數(shù)較高的二步搜索算法。本文對已有的用于全搜索算法實現(xiàn)的VLSI結(jié)構(gòu)進行了改進,設(shè)計了符合二步搜索算法要求的FPGA實現(xiàn)結(jié)構(gòu),并在對其理論分析之后,對實現(xiàn)該算法的運動估計模塊進行了功能模塊的劃分,并運用VerilogHDL硬件描述語言、ISE及Modelsim開發(fā)工具在Spartan-IIEXC2S300eFPGA芯片上完成了對各功能模塊的設(shè)計、實現(xiàn)與時序仿真。最后,對整個運動估計模塊進行了仿真測試,給出了其在FPGA上搭建實現(xiàn)后的時序仿真波形圖與占用硬件資源情況,通過對時序仿真結(jié)果可知本文設(shè)計的各功能模塊工作正常,并且能夠協(xié)同工作,整個運動估計模塊能夠正確的實現(xiàn)二步搜索運動估計算法,并輸出正確的運動估計結(jié)果;通過對占用硬件資源及時鐘頻率情況的分析驗證了本文設(shè)計的二步搜索運動估計算法的FPGA實現(xiàn)結(jié)構(gòu)具備先進性和實時可實現(xiàn)性。

    標(biāo)簽: FPGA 運動估計 算法 仿真

    上傳時間: 2013-05-27

    上傳用戶:wpt

  • 指紋識別算法的研究及基于FPGA的硬件實現(xiàn)

    隨著圖像處理和模式識別技術(shù)的進步,基于生物特征的識別技術(shù)成為蓬勃發(fā)展的高技術(shù)之一,根據(jù)IBG(InternationalBiometricGroup)組織對生物特征市場的統(tǒng)計和預(yù)測,該領(lǐng)域的收入的年增長率30-50%,到2008年,全球總收入將達到46.39億美元。而基于指紋特征的識別技術(shù)由于其獨特的可靠性,穩(wěn)定性,方便快捷的特點,恰好符合了市場的需求。目前指紋識別技術(shù)是生物識別領(lǐng)域中應(yīng)用最廣泛的識別技術(shù),也是研究與應(yīng)用的一個熱點。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計領(lǐng)域中最熱門的概念。NiosⅡ是Altera公司開發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核,可以將它嵌入FPGA內(nèi)部,與用戶自定義邏輯結(jié)合構(gòu)成一個基于FPGA的片上系統(tǒng)。與嵌入式硬核相比較,嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識別系統(tǒng)對速度的要求。 本文對指紋識別技術(shù)中各個環(huán)節(jié)的算法進行了較為深入的研究,結(jié)合NiosⅡ嵌入式處理器的特點,對算法進行了合理的選擇與優(yōu)化,形成了一套完整的指紋識別算法,并提出了一種基于FPGA的指紋識別系統(tǒng)硬件設(shè)計方案。 論文的內(nèi)容主要包括以下幾個方面: 1、對指紋圖像預(yù)處理、后處理和匹配算法進行了改進,提高了算法的性能;設(shè)計了一種適用于快速匹配的指紋特征數(shù)據(jù)結(jié)構(gòu);提出了一套基于特征點匹配的指紋識別算法。實驗結(jié)果表明該算法速度快、誤識率較低、可靠性較高,可以滿足實用的要求。 2、本著增加系統(tǒng)集成度、減小系統(tǒng)體積、提高便攜性、降低功耗和成本,同時提升系統(tǒng)的性能的原則,使用Altera公司提供的外圍設(shè)備IP核配合NiosⅡ處理器軟核搭建了一個單片嵌入式系統(tǒng),然后以內(nèi)嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片,外配片外RAM和Flash存儲器以及小鍵盤和LCD顯示屏等器件,設(shè)計了一個便攜式指紋識別系統(tǒng),提出了一套基于FPGA的硬件設(shè)計方案。 3、利用NiosⅡ開發(fā)板對硬件設(shè)計方案進行了初步的驗證,實現(xiàn)了指紋采集芯片F(xiàn)PS200與FPGA的接口,并進行了算法的移植。 實驗結(jié)果表明本文所提出的系統(tǒng)設(shè)計方案是可行的。基于FPGA的自動指紋識別系統(tǒng)在速度、功耗、體積、擴展性方面有著獨特的優(yōu)勢,具有廣闊的發(fā)展空間。最后提出了對這一設(shè)計繼續(xù)改進的思路和下一步研究的內(nèi)容。

    標(biāo)簽: FPGA 指紋識別 法的研究 硬件實現(xiàn)

    上傳時間: 2013-07-28

    上傳用戶:hxy200501

  • OFDM系統(tǒng)幀檢測及同步算法FPGA設(shè)計與實現(xiàn)

    正交頻分復(fù)用(OFDM)技術(shù)是一種多載波數(shù)字調(diào)制技術(shù),它具有頻譜利用率高、抗多徑能力強等特點,在寬帶無線多媒體通信領(lǐng)域中受到了廣泛的關(guān)注。 OFDM系統(tǒng)可分為連續(xù)工作模式和突發(fā)工作模式。在IEEE802.11a、HiperLANType2等無線局域網(wǎng)標(biāo)準(zhǔn)中采用了OFDM的突發(fā)工作模式,該模式下的接收機首先對符合某種特定格式的幀做出檢測。本文介紹了一種基于最小錯誤概率準(zhǔn)則的幀檢測算法,提出了該算法的FPGA實現(xiàn)方案。 同步技術(shù)是OFDM最關(guān)鍵的技術(shù)之一,它包括載波頻率同步和符號同步。載波頻率同步是為了糾正接收端相對于發(fā)送端的載波頻率偏移,以保證子載波間的正交性;符號同步確定OFDM符號有用數(shù)據(jù)信息的開始時刻,也就是確定FFT窗的開始時刻。本文首先介紹了一種基于自相關(guān)的載波頻率同步算法,給出了它的FPGA實現(xiàn)方案,重點講述了其中用到的Cordic算法及其實現(xiàn);然后介紹了分別基于互相關(guān)和自相關(guān)的兩種符號同步算法,給出了各自的FPGA實現(xiàn)方案,從實現(xiàn)的角度比較了兩種算法的優(yōu)缺點,并且在FPGA設(shè)計中體現(xiàn)了面積復(fù)用和流水線操作的設(shè)計思想。 文章最后介紹了系統(tǒng)調(diào)試的情況,總結(jié)出一種ChipScopePro與Matlab相結(jié)合的調(diào)試方法,該方法在FPGA調(diào)試方面具有一定的通用性。

    標(biāo)簽: OFDM FPGA

    上傳時間: 2013-07-16

    上傳用戶:Killerboo

  • Turbo碼編碼譯碼算法與FPGA實現(xiàn)方法的研究

    本文主要研究Turbo碼的編碼和譯碼算法及其FPGA硬件實現(xiàn).在概述信道編碼理論及其發(fā)展歷程之后,簡要地論述了Turbo碼的原理.然后分別對Turbo碼的MAP譯碼算法,LOG-MAP算法進行推導(dǎo),在給出LOG-MAP的推導(dǎo)之后,提出了對于LOG-MAP譯碼算法的兩點改進,采用三階牛頓插值函數(shù)對校驗函數(shù)進行擬合,采用雙滑動窗口技術(shù)取代傳統(tǒng)的單滑動窗口技術(shù).Turb碼還有一種譯碼復(fù)雜度相對較低的算法——SOVA算法,本文也給出了SOVA算法的詳細(xì)推導(dǎo)過程.在對LOG-MAP和SOVA算法的詳細(xì)推導(dǎo)之后,本文給出Turbo碼的軟件仿真,采用Matlab語言編寫Turbo碼仿真系統(tǒng)程序,仿真系統(tǒng)比較了單滑動窗口技術(shù)和雙滑動窗口技術(shù)在不同的信噪比下的譯碼性能.在軟件仿真的基礎(chǔ)上,本文給出了Turbo碼編碼器和采用LOG-MAP譯碼算法譯碼器的FPGA硬件實現(xiàn)方法.

    標(biāo)簽: Turbo FPGA 編碼譯碼 算法

    上傳時間: 2013-06-19

    上傳用戶:plsee

  • 基于ARM核嵌入式系統(tǒng)的AES算法優(yōu)化

    本文從AES的算法原理和基于ARM核嵌入式系統(tǒng)的開發(fā)著手,研究了AES算法的設(shè)計原則、數(shù)學(xué)知識、整體結(jié)構(gòu)、算法描述以及AES存住的優(yōu)點利局限性。 針對ARM核的體系結(jié)構(gòu)及特點,對AES算法進行了優(yōu)化設(shè)計,提出了從AES算法本身和其結(jié)構(gòu)兩個方面進行優(yōu)化的方法,在算法本身優(yōu)化方面是把加密模塊中的字節(jié)替換運算、列混合運算和解密模塊中的逆列混合運算中原來的復(fù)雜的運算分別轉(zhuǎn)換為簡單的循環(huán)移位、乘和異或運算。在算法結(jié)構(gòu)優(yōu)化方面是在輸入輸山接口上采用了4個32位的寄存器對128bits數(shù)據(jù)進行了并行輸入并行輸出的優(yōu)化設(shè)計;在密鑰擴展上的優(yōu)化設(shè)計是采用內(nèi)部擴展,即在進行每一輪的運算過程的同時算出下一輪的密鑰,并把下一輪的密鑰暫存在SRAM里,使得密鑰擴展與加/解密運算并行執(zhí)行;加密和解密優(yōu)化設(shè)計是將輪函數(shù)查表操作中的四個操作表查詢工作合并成一個操作表查詢工作,同時為了使加密代碼在解密代碼中可重用,節(jié)省硬件資源,在解密過程中采用了與加密相一致的過程順序。 根據(jù)上述的優(yōu)化設(shè)計,基于ARM核嵌入式系統(tǒng)的ADS開發(fā)環(huán)境,提出了AES實現(xiàn)的軟硬件方案、AES加密模塊和解密模塊的實現(xiàn)方案以及測試方案,總結(jié)了基于ARM下的高效編程技巧及混合接口規(guī)則,在集成開發(fā)環(huán)境下對算法進行了實現(xiàn),分別得出了初始密鑰為128bits、192bits和256bits下的加密與解密的結(jié)果,并得劍了正確驗證。在性能測試的過程中應(yīng)用編譯器的優(yōu)化選項和其它優(yōu)化技巧優(yōu)化了算法,使算法具有較高的加密速度。

    標(biāo)簽: ARM AES 嵌入式系統(tǒng) 算法優(yōu)化

    上傳時間: 2013-04-24

    上傳用戶:liansi

  • 基于ARM平臺的嵌入式流媒體播放技術(shù)的研究與應(yīng)用

    隨著嵌入式系統(tǒng)以及流媒體技術(shù)的快速發(fā)展,基于嵌入式系統(tǒng)實現(xiàn)可視電話、視頻點播、視頻會議等功能已經(jīng)成為當(dāng)前的熱點研究領(lǐng)域。這樣的系統(tǒng)通常具有小型化、低功耗、低成本、穩(wěn)定可靠、便于攜帶等特點。 本文旨在研究流媒體以及嵌入式系統(tǒng)的相關(guān)技術(shù),基于ARM9處理器平臺實現(xiàn)一種基于嵌入式系統(tǒng)的流媒體播放器。該播放器的硬件平臺以32位高性能ARM9處理器為核心進行規(guī)劃,在此基礎(chǔ)上,采用嵌入式Linux操作系統(tǒng)、MPEG-4視頻解碼技術(shù)和流媒體網(wǎng)絡(luò)傳輸技術(shù)進行設(shè)計。 本文的主要貢獻體現(xiàn)在以下六個方面: l、分析嵌入式流媒體播放器的功能需求和技術(shù)特點,對嵌入式流媒體播放器的總體實現(xiàn)方案進行設(shè)計。 2、研究嵌入式Linux系統(tǒng)設(shè)計方法,基于ARM處理器平臺構(gòu)建嵌入式Linux操作系統(tǒng)。這部分的工作包括嵌入式BootLoader的移植、Linux內(nèi)核的配置與編譯以及根文件系統(tǒng)的創(chuàng)建。 3、研究MPEG-4視頻壓縮標(biāo)準(zhǔn),基于ARM-Linux系統(tǒng)平臺移植MPEG-4視頻解碼器。 4、研究ARM體系結(jié)構(gòu)以及基于ARM平臺的嵌入式軟件優(yōu)化方法,對所移植的MPEG-4視頻解碼器進行平臺相關(guān)優(yōu)化。 5、研究視頻通信中的錯誤隱藏技術(shù),針對錯誤隱藏過程中傳統(tǒng)邊界匹配算法對邊緣匹配的局限性,提出了一種改進的基于時域與空域平滑性的邊界匹配算法。 6、研究流媒體網(wǎng)絡(luò)傳輸?shù)南嚓P(guān)技術(shù)協(xié)議,基于RTSP/RTP/RTCP協(xié)議實現(xiàn)了一個基本的MPEG-4視頻流實時傳輸系統(tǒng)。

    標(biāo)簽: ARM 嵌入式 流媒體 播放

    上傳時間: 2013-05-16

    上傳用戶:a937518043

  • GPS接收機天線陣列抗干擾算法研究及其FPGA實現(xiàn)

    GPS技術(shù)在導(dǎo)航、定位及精確打擊等方面產(chǎn)生了重要影響,已經(jīng)廣泛地應(yīng)用在各種武器平臺上。但是,在干擾環(huán)境下也顯現(xiàn)出許多問題。由于其到達地球表面的信號極其微弱(-160dBW),在現(xiàn)在復(fù)雜的電磁環(huán)境中容易受到干擾,尤其是C/A碼信號更易受到干擾,并且隨著導(dǎo)航戰(zhàn)的發(fā)展對GPS的抗干擾已成為爭取導(dǎo)航資源的有效措施。因此,研究干擾環(huán)境下的GPS接收機設(shè)計具有重要意義。 本文首先簡要介紹了GPS信號的結(jié)構(gòu)及構(gòu)成,通過對GPS信號特征以及接收機抗干擾能力的分析,結(jié)合干擾對接收機的作用方式及效果,確定GPS最易受的干擾類型為阻塞式干擾,然后針對這種干擾類型提出了一種有效的抗干擾技術(shù)-----自適應(yīng)調(diào)零天線技術(shù)。接下來,著重研究了GPS接收機在此抗干擾技術(shù)前提下的若干抗干擾方法,并對其進行了詳細(xì)的分析和討論。 研究過程中,通過對最佳化準(zhǔn)則和空域自適應(yīng)濾波的理解,首先對不同天線陣列結(jié)構(gòu)進行了性能仿真和比較分析,然后在對稱圓形天線陣列的基礎(chǔ)上對空域自適應(yīng)算法進行了仿真分析,針對其自由度有限的問題接著對空時濾波方法做了詳細(xì)討論,在7元對稱圓形陣列的基礎(chǔ)上仿真說明了二者各自的優(yōu)缺點。考慮到實際的干擾環(huán)境和本課題研究的初期階段,因此選用了適合本課題干擾環(huán)境的空域濾波方法,并對其自適應(yīng)算法進行了適當(dāng)?shù)母倪M,使得其抗干擾性能獲得了一定程度的改善。 最后,詳細(xì)說明了該接收機抗干擾模塊的FPGA實現(xiàn)原理。詳細(xì)給出了頂層及各子模塊的設(shè)計流程與RTL視圖,實驗結(jié)果驗證了該算法的有效性。

    標(biāo)簽: FPGA GPS 接收機 天線陣列

    上傳時間: 2013-06-03

    上傳用戶:xfbs821

  • H264AVC的CAVLC編碼算法研究及FPGA實現(xiàn)

    H.264/AVC是國際電信聯(lián)盟與國際標(biāo)準(zhǔn)化組織/國際電工委員會聯(lián)合推出的活動圖像編碼標(biāo)準(zhǔn),簡稱H.264。作為最新的國際視頻編碼標(biāo)準(zhǔn),H.264/AVC與MPEG-4、H.263等視頻編碼標(biāo)準(zhǔn)相比,性能有了很大的提高,并已在流媒體、數(shù)字電視、電話會議、視頻存儲等諸多領(lǐng)域得到廣泛的應(yīng)用。 本論文的研究課題是基于H.264/AVC視頻編碼標(biāo)準(zhǔn)的CAVLC(Context-based Adaptive Variable Length Coding,基于上下文的自適應(yīng)可變長編碼)編碼算法研究及FPGA實現(xiàn)。對于變換后的熵編碼,H.264/AVC支持兩種編碼模式:基于上下文的可變長編碼(CAVLC)和基于上下文的自適應(yīng)算術(shù)編碼(CABAC,Context-based Adaptive BinaryArithmetic Coding)。在H.264/AVC中,盡管CAVLC算法也是采用了VLC編碼,但是同以往標(biāo)準(zhǔn)不同,它所有的編碼都是基于上下文進行。這種方法比傳統(tǒng)的查單一表的方法提高了編碼效率,但也增加了設(shè)計上的困難。 作者在全面學(xué)習(xí)H.264/AVC協(xié)議和深入研究CAVLC編碼算法的基礎(chǔ)上,確定了并行編碼的CAVLC編碼器結(jié)構(gòu)框圖,并總結(jié)出了影響CAVLC編碼器實現(xiàn)的瓶頸。針對這些瓶頸,對CAVLC編碼器中的各個功能模塊進行了優(yōu)化設(shè)計,這些優(yōu)化設(shè)計包括多參考塊的表格預(yù)測法、快速查找表法、算術(shù)消除法等。最后,用Verilog硬件描述語言對所設(shè)計的CAVLC編碼器進行了描述,用EDA軟件對其主要功能模塊進行了仿真,并在Cyclone II系列EP2C20F484的FPGA上驗證了它們的功能。結(jié)果表明,該CAVLC編碼器各編碼單元的編碼速度得到了顯著提高且均能滿足實時通信要求,為整個CAVLC編碼器的實時通信提供了良好的基礎(chǔ)。

    標(biāo)簽: CAVLC H264 FPGA 264

    上傳時間: 2013-06-04

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