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  • GB-T4677.21-1988 印制板鍍層孔隙率測試方法 氣體暴露法

    GB-T4677.21-1988 印制板鍍層孔隙率測試方法 氣體暴露法

    標簽: 4677.21 GB-T 1988 印制板

    上傳時間: 2013-08-05

    上傳用戶:eeworm

  • 電能表修校及裝表接電工-260頁-3.6M.pdf

    專輯類-電工電力專輯-99冊-1.27G 電能表修校及裝表接電工-260頁-3.6M.pdf

    標簽: 260 3.6 電能表

    上傳時間: 2013-07-28

    上傳用戶:王慶才

  • GB-T4677.9-1984-印制板鍍層空隙率電圖象測試方法.pdf

    專輯類-國標類相關專輯-313冊-701M GB-T4677.9-1984-印制板鍍層空隙率電圖象測試方法.pdf

    標簽: 4677.9 GB-T 1984

    上傳時間: 2013-07-30

    上傳用戶:agent

  • GB-T4677.21-1988-印制板鍍層孔隙率測試方法-氣體暴露法.pdf

    專輯類-國標類相關專輯-313冊-701M GB-T4677.21-1988-印制板鍍層孔隙率測試方法-氣體暴露法.pdf

    標簽: 4677.21 GB-T 1988

    上傳時間: 2013-04-24

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  • CRC16校驗碼計算器v1.2.rar

    modbus-rtx crc16校驗碼

    標簽: CRC 16 校驗碼

    上傳時間: 2013-06-20

    上傳用戶:dongqiangqiang

  • 永磁同步發電機的電磁場分析.rar

    永磁同步發電機由于一系列高效節能的優點,在工農業生產、航空航天、國防和日常生活中得到廣泛應用,并且受到許多學者的關注,其研究領域主要涉及永磁同步發電機的設計、精確性能分析、控制等方面。 本課題作為國家自然科學基金項目《無刷無勵磁機諧波勵磁的混合勵磁永磁電機的研究》的課題,主要研究永磁電機的電磁場空載和負載計算,求出永磁電機的電壓波形和電壓調整率,為分段式轉子的混合勵磁永磁電機的研究奠定基礎,主要做了以下工作: 首先介紹了永磁同步發電機的基本原理,包括永磁同步發電機的結構形式和永磁同步發電機的運行性能,采用傳統解析理論給出了電壓調整率的計算方法及外特性的計算模型;然后用有限元ANSYS對永磁同步發電機樣機進行實體建模,經過定義分配材料、劃分網格、加邊界條件和載荷、求解計算等,得到矢量磁位Az、磁場強度H、磁感應強度B等結果,直觀地看出電機內部的磁場分布情況。 其次根據電磁場計算結果,應用齒磁通法對其進行后處理。該方法求解轉子在一個齒距內不同位置處的磁場,以定子齒的磁通為計算單位,根據繞組與齒的匝鏈關系,計算出磁鏈隨時間的變化,進而得到永磁同步發電機空、負載時電壓大小及波形。通過計算結果寫實驗結果對比,驗證了齒磁通法的正確性,為計算永磁同步發電機各種性能特性提供有力工具。 最后,基于齒磁通法對永磁同步發電機的外特性進行了深入研究,定量分析了結構參數對外特性的影響規律,提出了有效降低電壓調整率的方法的是:增加氣隙長度g的同時,適當增加永磁體的磁化方向的長度hm;此外,要盡量的減少每相串聯匝數N和增大導線面積以減小阻抗參數。通過改變電機的結構參數,對其電磁場進行計算,找到永磁電機電壓調整率的變化規律,為加電勵磁的混合勵磁永磁電機做準備,達到穩定輸出電壓的目的。

    標簽: 永磁同步 發電機 磁場分析

    上傳時間: 2013-04-24

    上傳用戶:15853744528

  • 基于FPGA的嵌入式系統SerialATA大容量數據存儲控制器的研究.rar

    隨著信息技術的飛速發展,數據吞吐量急劇增長,要求有更高的傳輸速度,來滿足大量數據的傳輸,而原有的并行數據傳輸總線結構上存在自身無法克服的缺陷,在高頻環境下容易串擾,而增大誤碼率。SATA串行總線技術應運而生。作為一種新型的總線接口,它提供了高達3.0Gbps的數據傳輸速率,使用8B/10B編碼格式,采用LVDS NRZ串行數據傳輸方式,有良好的抗干擾性能,有更強的達到32位的循環冗余校驗,并且提供了良好的物理接口特性,支持熱拔插,代表著計算機總線接口技術的發展方向。FPGA作為一種低功耗的半導體器件,在高頻工作環境中有優良的性能,將處理器與低功耗FPGA結合起來使用是數據存儲應用的趨勢,這樣能夠使得接口方案更加靈活。而在眾多FPGA器件中,Xilinx公司的Virtex-4平臺內部集成了PowerPC高性能處理器,并且其中提供了Rocket IO MGT這種嵌入式的多速率串行收發器,能夠以6.25-622Mb/s的速度傳送數據,并且支持包括SATA協議在內的多種串行通信協議。 本文從物理層、鏈路層、傳輸層分析了SATA1.0技術的接口協議,在此基礎提出滿足協議需求和適合FPGA設計的設計方案,并給出總體設計框圖,依照FPGA的設計方法,采用Xilinx公司的Virtex-4設計了一個符合SATA1.0接口協議的嵌入式存儲裝置,實現數據的存儲,仿真運行結果正常。

    標簽: SerialATA FPGA 嵌入式系統

    上傳時間: 2013-04-24

    上傳用戶:sz_hjbf

  • 并聯有源電力濾波器工程應用關鍵技術的研究.rar

    以諧波抑制,無功補償為主要功能的有源電力濾波器的基本理論已經成熟,但是市場尚無成熟的諧波有源抑制產品,同時電網諧波問題日益突出,因此需要對有源電力濾波器進行產業化應用研究。并聯有源電力濾波器以其安裝、維護方便,成為商用化產品的主流。所以本文針對并聯有源電力濾波器,展開產業化應用研究。 本文研究工作首先由如下工程問題引出:并聯有源電力濾波器在補償辦公樓電氣負載產生的諧波電流時,會出現諧波放大現象。辦公樓電氣負載主要是計算機、開關電源、不間斷電源、電壓型變頻器等,這些都是電壓型諧波源.本文以電容濾波型整流電路(電壓型諧波源)的分析作為切入點,基于“分段線性化”方法,對并聯有源電力濾波器補償電容濾波型整流負載進行了穩態分析,得到系統的電流和電壓波形,進而獲得其頻譜特性。通過本文所述穩態分析方法,可以從理論上理解并聯有源電力濾波器補償電容濾波型整流負載的工作過程,對有源電力濾波器的應用研究具有重要的理論和實際意義。 本文在分析辦公樓負載電氣特性的基礎上,建立了有源電力濾波器補償容性負載的簡化模型,依據該模型分析了負載中容性元件的電容值與諧波電流放大之間的關系;為了克服諧波放大現象,本文首先通過負載電流采樣環節后加裝濾波器的方式,將電流諧振頻率分量從采樣值中濾除,雖然達到了抑制諧波放大的目的,但是由于延時的引入,使得補償后網側電流畸變率(THD)急劇升高;然后根據這一思路,采用基于快速傅立葉變換(FFT)的有選擇諧波補償方法將電流諧振頻率分量從負載電流采樣值中濾除,使得系統在諧振頻率處變為開環控制,使系統穩定。經過對辦公樓負載的實際并網諧波補償實驗證明基于FFT的有選擇諧波補償方法對于抑制諧波放大是有效的。本創新點的研究工作對于實際工程應用具有參考價值。 為了滿足大容量的諧波抑制要求,本文提出了模塊化有源電力濾波器并聯補償方案,該方案的特點是模塊化結構及N+1冗余并聯控制策略、主從總線結構及主機產生、負載電流檢測方案以及并聯均流策略。主機產生及負載電流檢測是這一并聯方案的突出特點,體現了本文的創新性工作。本文還對多模塊并聯系統進行了建模和穩定性研究;依據模塊化并聯補償方案,在省科技計劃重點項目的支持下,對有源電力濾波器進行產業化研究,從項目方案、設計、器件選型,樣機調試、滿功率運行及性能檢測、樓宇負載與工業負載的實際并網實驗,直至工業樣機定型,對有源電力濾波器的產業化應用研究起了較大的推進作用,支撐項目目前已經有定型的工業化產品推出。 全文圍繞上述三個方面展開,章節分排如下:(1)第一章從實際應用角度,總結闡述了有源電力濾波技術在諧波檢測、電流跟蹤控制、拓撲結構三個方面的研究進展;(2)第二章對并聯有源電力濾波器補償電容濾波型整流負載進行了穩態分析;(3)第三章分析了有源電力濾波器補償容性負載時出現的諧波放大現象,并利用FFT方法使得系統在諧振頻率處變為開環控制,達到抑制諧波放大的目的;(4)第四章、第五章提出有源電力濾波器模塊化并聯方案,并詳細說明了模塊化并聯系統的設計和實驗;(5)第六章對全文進行了總結,并對今后的研究工作進行了展望。

    標簽: 并聯 工程 關鍵技術

    上傳時間: 2013-04-24

    上傳用戶:JANEM

  • 基于FPGA的SATAⅡ協議研究與實現.rar

    現代的計算機追求的是更快的速度、更高的數據完整性和靈活性。無論從物理性能,還是從電氣性能來看,現今的并行總線都已出現了某些局限,無法提供更高的數據傳輸率。而SATA以其傳輸速率快、支持熱插拔、可靠的數據傳輸等特點,得到各行業越來越多的支持。 目前市場上的SATA IP CORE都是面向IC設計的,不利于在FPGA上集成,因此,本文在Xilinx公司的Virtex5系列FPGA上實現SATAⅡ協議,對SATA技術的推廣、國內邏輯IP核的發展都有一定的意義。 本文將SATAⅡ協議的FPGA實現劃分成物理層、鏈路層、傳輸層和應用層四個模塊。提出了物理層串行收/發器設計以及物理鏈路初始化方案。分析了鏈路層模塊結構,給出了作為SATAⅡ鏈路層核心的狀態機的設計。為滿足SATAⅡ協議3.0Gbps的速率,采用擴大數據處理位寬的方法,設計完成了鏈路層的16b/20b編碼模塊,同時為提高數據傳輸可靠性和信號的穩定性,分別實現了鏈路層CRC校驗模塊和并行擾碼模塊。在描述協議傳輸層的模塊結構的基礎上,給出了作為傳輸層核心的狀態機的設計,并以DMA DATA OUT命令的操作為例介紹了FIS在傳輸層中的處理過程。完成了命令層協議狀態機的設計,并實現了SATAⅡ新增功能NCQ技術,從而使得數據傳輸更加有效。最后為使本設計應用更加廣泛,設計了基于AHB總線的用戶接口。 本設計采用Verilog HDL語言對需要實現的電路進行描述,并使用Modelsim軟件仿真。仿真結果表明,本文設計的邏輯電路可靠穩定,與SATAⅡ協議定義功能一致。

    標簽: FPGA SATA 協議研究

    上傳時間: 2013-06-16

    上傳用戶:cccole0605

  • 基于FPGA的LDPC碼的實現.rar

    低密度校驗碼(LDPC)是一種能逼近Shannon容量限的漸進好碼,其長碼性能甚至超過了Turbo碼。低密度校驗碼以其迭代譯碼復雜度低,沒有錯誤平層,碼率和碼長可靈活改變的優點成為Turbo碼強有力的競爭對手。目前,LDPC碼已廣泛應用于深空通信、光纖通信、衛星數字視頻和音頻廣播等領域,因此LDPC碼編譯碼器的硬件實現已成為糾錯編碼領域的研究熱點之一。 本文在分析LDPC碼的基本編碼結構基礎上,首先研究了LDPC碼的隨機構造方法,并給出了有效的PEG算法實現方法,重點分析了用環消除(cycle elimination)算法實現的準循環LDPC碼的構造。然后對LDPC碼的幾種不同譯碼算法進行分析比較,討論了一種適合硬件實現的譯碼算法-TDMP算法,并對易于硬件實現的TDMP算法進行了性能仿真,仿真結果表明TDMP算法作為硬件實現的譯碼算法具有優異的性能優勢。最后針對Altera公司的StratixEPIS25 FPGA芯片設計了一個基于TDMP算法的(4096,2048)非規則LDPC碼譯碼器,內部用了4個單校驗碼譯碼器并行譯1幀數據,3幀同時譯碼,作者詳細介紹了該譯碼器芯片的設計過程和內部結構和工作流程。

    標簽: FPGA LDPC

    上傳時間: 2013-05-23

    上傳用戶:fujun35303

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