嵌入式系統是以應用為中心，以計算機技術為基礎，軟硬件可裁減，適應應用系統，對功能，可靠性，成本，體積，功耗嚴格要求的專用計算機系統[1]。廣泛應用于軍事，信息家電，無線通信設備，消費類電子產品，移動計算平臺等諸多領域，是當今熱門的計算機開發技術。 隨著科學技術發展，人們生活水平提高，數字高清電視逐漸普及，在各大賣場，對銷售過程中展示設備也隨之提出了更高的要求。但據調查，在中國現有的高清播放系統普遍存在價格昂貴，損耗高，壽命短及外部接口少等缺陷，導致無法普及。 針對這一現狀，本課題設計了一種以嵌入式處理器ARM系列32位嵌入式EM8623芯片為硬件平臺，嵌入式實時操作系統uclinux為系統軟件平臺的高清播放系統。 ARM(Advanced RISC Machines)既是一種處理器架構，又是公司的名稱，該公司主要設計處理器架構，并將其技術授權給其他芯片廠商。該處理器架構具有外型小，性能高等特點，多用于便攜式通訊工具，多媒體數字式消費類儀器和嵌入式系統解決方案等領域。本課題在充分考慮系統實用性和開發成本的基礎上，采用EM8623芯片為CPU，片外擴展FLASH和SDRAM存儲器。 uclinux系統從Linux2.0/2.4內核派生而來，雖然是為了支持沒有MMU(虛擬內存管理單元)的處理器而設計，但保留了操作系統的所有特性，為硬件平臺更好地運行提供了保證，也降低了軟件設計復雜度，提高了系統的實時性和靈活性，縮短了開發周期。 該高清播放系統具有工作時間長，性能穩定等特點，采用面向對象和面向過程綜合編程方法，ASM，C，C++多種語言混合編程方式實現，使系統具有很高的健壯性和可擴展性。 基于ARM的高清播放系統在現場運行穩定可靠，達到了預期的效果和實際要求。而且由于該高清播放系統外接接口豐富(包括常見的HDMI，S-Video，VGA，YPbPr，YCbCr)，連接使用方便，所以具有很好的市場價值，可廣泛應用于電視銷售柜臺，化妝品展示柜臺，聯網廣告機等領域。
上傳時間： 2013-04-24
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這是高阻態的一些學習，了解對學單片機非常有用的，希望能對你們有幫助
上傳時間： 2013-07-06
上傳用戶：linlin
N個源碼，都是C文件或C++源文件。 此文件高壓縮。解壓時間可能長一些。 申請加下載限額。 主頁：http://www.programsalon.com/developer.asp?id=
上傳時間： 2013-07-01
上傳用戶：牛布牛
高精度電壓表、電流表和電阻表的制作:一、研究目的1．學習和掌握萬用表電路設計的思路。2．學習掌握電壓表、電流表和電阻表測量中不同量程的構成方式。3．學習和掌握采用含運算放大器的
上傳時間： 2013-07-22
上傳用戶：secsz2003
高精度電網功率因數測量加權插值FFT優化算法
上傳時間： 2013-05-22
上傳用戶：88mao
pb開發soket所需要的一個關鍵動態庫，我找了很久的，現在份享一下-pb socket dll
上傳時間： 2013-04-24
上傳用戶：refent
高質量C編程指南是具有一定C基礎的，進入更高層次的最佳選擇
上傳時間： 2013-04-24
上傳用戶：wangrijun
本文研究基于ARM與FPGA的高速數據采集系統技術。論文完成了ARM+FPGA結構的共享存儲器結構設計，實現了ARMLinux系統的軟件設計，包括觸摸屏控制、LCD顯示、正弦插值算法設計以及各種顯示算法設計等。同時進行了信號的高速采集和處理的實際測試，對實驗測試數據進行了分析。 論文分別從軟件和硬件兩方面入手，闡述了基于ARM處理器和FPGA芯片的高速數據采集的硬件系統設計方法，以及基于ARMLinux操作系統的設備驅動程序設計和應用程序設計。 硬件方面，在FPGA平臺上，我們首先利用乒乓操作的方式將一路高速數據信號轉換成頻率為原來頻率1/4的4路低速數據信號，再將這四路數據分別存儲到4個FIFO中，然后再對這4個FIFO中的數據拼接并存儲在FPGA片上的雙端口雙時鐘RAM中，最后將FPGA的雙端口雙時鐘RAM掛載到ARM系統的總線上，實現了ARM和FPGA共享存儲器的系統結構，使ARM處理器可以直接讀取這個雙端口雙時鐘的RAM中的數據，從而大大提高了數據采集與處理的效率。在采樣頻率控制電路設計方面，我們通過使FIFO的數據存儲時鐘降低為標準狀態下的1/n實現數據采集頻率降為標準狀態的1/n，從而實現了由FPGA控制的可變頻率的數據采集系統。 軟件方面，為了更有效地管理和拓展系統功能，我們移植了ARMLinux操作系統，并在S3C2410平臺上設計實現了基于Linux操作系統的觸摸屏驅動程序設計、LCD驅動程序移植、自定義的FPGA模塊驅動程序設計、LCD顯示程序設計、多線程的應用程序設計。應用程序能夠控制FPGA數據采集系統工作。 在前端采樣頻率為125MHz情況下，系統可以正常工作。能夠實現對頻率在5MHz以下的信號波形的直接顯示；對5MHz至40MHz的信號，使用正弦插值算法進行處理，顯示效果良好。同時這種硬件結構可擴展性強，可以在此基礎上實現8路甚至16路緩沖的系統結構，可以使系統支持更高的采樣頻率。
上傳時間： 2013-07-04
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DFT(Discrete Fourier Transformation)是數字信號分析與處理如圖形、語音及圖像等領域的重要變換工具,直接計算DFT的計算量與變換區間長度N的平方成正比.當N較大時,因計算量太大,直接用DFT算法進行譜分析和喜好的實時處理是不切實際的.快速傅里葉變換(Fast Fourier Transformation,簡稱FFT)使DFT運算效率提高1~2個數量級.本文的目的就是研究如何應用FPGA這種大規模可編程邏輯器件實現FFT的算法.本設計主要采用先進的基-4DIT算法研制一個具有實用價值的FFT實時硬件處理器.在FFT實時硬件處理器的設計實現過程中,利用遞歸結構以及成組浮點制運算方式,解決了蝶形計算、數據傳輸和存儲操作協調一致問題.合理地解決了位增長問題.同時,采用并行高密度乘法器和流水線(pipeline)工作方式,并將雙端口RAM、只讀ROM全部內置在FPGA芯片內部,使整個系統的數據交換和處理速度得以很大提高,實際合理地解決了資源和速度之間相互制約的問題.本設計采用Verilog HDL硬件描述語言進行設計,由于在設計中采用Xilinx公司提供的稱為Core的IP功能塊極大地提高了設計效率.
上傳時間： 2013-06-20
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低密度校驗碼（LDPC，Low Density Parity Check Code）是一種性能接近香農極限的信道編碼，已被廣泛地采用到各種無線通信領域標準中，包括我國的數字電視地面傳輸標準、歐洲第二代衛星數字視頻廣播標準（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來4G通信系統中的核心技術之一。 當今LDPC碼構造的主流方向有兩個，分別是結合準循環（QC，Quasi Cyclic）移位結構的單次擴展構造和類似重復累積（RA，Repeat Accumulate）碼構造。相應地，主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高，但是需要較多的寄存器和ROM資源；基于迭代譯碼的編碼算法實現簡單，但是吞吐量不高，且不容易構造高性能的好碼。 本文在研究了上述幾種碼構造和編碼算法之后，結合編譯碼器綜合實現的復雜度考慮，提出了一種切實可行的基于二次擴展（Dex，Duplex Expansion）的QC-LDPC碼構造方法，以實現高吞吐量的LDPC碼收發端；并且充分利用該類碼校驗矩陣準循環移位結構的特點，結合RU算法，提出了一種新編碼器的設計方案。 基于二次擴展的QC-LDPC碼構造方法，是通過對母矩陣先后進行亂序擴展（Pex，Permutation Expansion）和循環移位擴展（CSEx，Cyclic Shift Expansion）實現的。在此基礎上，為了實現可變碼長、可變碼率，一般編譯碼器需同時支持多個亂序擴展和循環移位擴展的擴展因子。本文所述二次擴展構造方法的特點在于，固定循環移位擴展的擴展因子大小不變，支持多個亂序擴展的擴展因子，使得譯碼器結構得以精簡；構造得到的碼字具有近似規則碼的結構，便于硬件實現；（偽）隨機生成的循環移位系數能夠提高碼字的誤碼性能，是對硬件實現和誤碼性能的一種折中。 新編碼器在很大程度上考慮了資源的復用，使得實現復雜度近似與碼長成正比。考慮到吞吐量的要求，新編碼器結構完全拋棄了RU算法中串行的前向替換（FS，Forward Substitution）模塊，同時簡化了流水線結構，由原先RU算法的6級降低為4級；為了縮短編碼延時，設計時安排每一級流水線計算所需的時鐘數大致相同。 這種碼字構造和編碼聯合設計方案具有以下優勢：相比RU算法，新方案對可變碼長、可變碼率的支持更靈活，吞吐量也更大；相比基于生成矩陣的編碼算法，新方案節省了50％以上的寄存器和ROM資源，單位資源下的吞吐量更大；相比類似重復累積碼結構的基于迭代譯碼的編碼算法，新方案使高性能LDPC碼的構造更為方便。以上結果都在Xilinx Virtex II pro 70 FPGA上得到驗證。 通過在實驗板上實測表明，上述基于二次擴展的QC-LDPC碼構造和相應的編碼方案能夠實現高吞吐量LDPC碼收發端，在實際應用中具有很高的價值。 目前，LDPC碼正向著非規則、自適應、信源信道及調制聯合編碼方向發展。跨層聯合編碼的構造方法，及其對應的編碼算法，也必將成為信道編碼理論未來的研究重點。
上傳時間： 2013-07-26
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