本文應(yīng)用EDA技術(shù)，基于FPGA器件設(shè)計(jì)與實(shí)現(xiàn)UART，并采用CRC校驗(yàn)。主要工作如下： 1、在異步串行通信電路部分完全用FPGA來(lái)實(shí)現(xiàn)。選用Xilinx公司的SpartanⅢ系列的XC3S1000來(lái)實(shí)現(xiàn)異步串行通信的接收、發(fā)送和接口控制功能，利用FPGA集成度比較高，具有在線可編程能力，在其完成各種功能的同時(shí)，完全可以將串行通信接口構(gòu)建其中，可根據(jù)實(shí)際需求分配資源。 2、利用VerilogHDL語(yǔ)言非常容易掌握，功能比VHDL更強(qiáng)大的特點(diǎn)，可以在設(shè)計(jì)時(shí)不斷修改程序，來(lái)適用不同規(guī)模的應(yīng)用，而且采用Verilog輸入法與工藝性無(wú)關(guān)，利用系統(tǒng)設(shè)計(jì)時(shí)對(duì)芯片的要求，施加不同的約束條件，即可設(shè)計(jì)出實(shí)際電路。 3、利用ModelSim仿真工具對(duì)程序進(jìn)行功能仿真和時(shí)序仿真，以驗(yàn)證設(shè)計(jì)是否能獲得所期望的功能，確定設(shè)計(jì)程序配置到邏輯芯片之后是否可以運(yùn)行，以及程序在目標(biāo)器件中的時(shí)序關(guān)系。 4、為保證數(shù)據(jù)傳輸?shù)恼_性，采用循環(huán)冗余校驗(yàn)CRC(CyclicRedundancyCheck)，該編碼簡(jiǎn)單，誤判概率低，為了減少硬件成本，降低硬件設(shè)計(jì)的復(fù)雜度，本設(shè)計(jì)通過(guò)CRC算法軟件實(shí)現(xiàn)。 實(shí)驗(yàn)結(jié)果表明，基于EDA技術(shù)的現(xiàn)場(chǎng)可編程門陣列FPGA集成度高，結(jié)構(gòu)靈活，設(shè)計(jì)方法多樣，開(kāi)發(fā)周期短，調(diào)試方便，修改容易，采用FPGA較好地實(shí)現(xiàn)了串行數(shù)據(jù)的通信功能，并對(duì)數(shù)據(jù)作了一定的處理，本設(shè)計(jì)中為CRC校驗(yàn)。另外，可以利用FPGA的在線可編程特性，對(duì)本設(shè)計(jì)電路進(jìn)行功能擴(kuò)展，以滿足更高的要求。
標(biāo)簽： FPGA CRC 串行 通信實(shí)現(xiàn)
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本文分析了 T EXAS 儀器公司新推出的串行10 位數(shù)/ 模轉(zhuǎn)換器(DAC) TL C5615 的功能、特點(diǎn)、工作原理及其與A T89C52 單片機(jī)的硬件接口和軟件編程, 提供了一個(gè)新穎實(shí)用的數(shù)/
標(biāo)簽： 5615 TLC 串行 中的應(yīng)用
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·Visual Basic與RS232串行通訊控制
標(biāo)簽： Visual Basic nbsp 232
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LM3S系列單片機(jī)串行（UART）升級(jí)應(yīng)用筆記
標(biāo)簽： LM3S UART 單片機(jī)串行 應(yīng)用筆記
上傳時(shí)間： 2013-04-24
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· 摘要： 以實(shí)例介紹了利用MZX3232芯片實(shí)現(xiàn)TMS320F2812與上位機(jī)的串行通信,給出了硬件電路,設(shè)計(jì)了串行通信程序.詳細(xì)說(shuō)明了利用Visual Basic6.0通信控件進(jìn)行通信的方法,并給出了程序流程圖和部分源程序.實(shí)驗(yàn)表明,該串行通信方法傳輸數(shù)據(jù)準(zhǔn)確可靠,具有實(shí)用價(jià)值.
標(biāo)簽： DSP 上位機(jī) 串行 通信設(shè)計(jì)
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單片機(jī)與三菱PLC 無(wú)協(xié)議串行通訊的實(shí)現(xiàn)
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單片機(jī)串行接口技術(shù)研究單片機(jī)串行接口技術(shù)研究
標(biāo)簽： 單片機(jī) 串行接口 技術(shù)研究
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ARM,NXP2300單片機(jī)SPI總線讀寫串行NORFlash驅(qū)動(dòng)程序
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標(biāo)簽： Spartan SPI 串行 外設(shè)接口
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基于VHDL語(yǔ)言的一個(gè)新型串行數(shù)字通信模塊。
標(biāo)簽： VHDL 串行 數(shù)字通信 模塊
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