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機率神經網路分類器之高階合成。對研究概率神經網絡很有幫助的。質量很高的論文
上傳時間： 2016-04-07
上傳用戶：jcljkh
高速PCB設計指南之（一~八 ）目錄 一、 1、PCB布線 2、PCB布局 3、高速PCB設計 二、 1、高密度（HD）電路設計 2、抗干擾技術 3、PCB的可靠性設計 4、電磁兼容性和PCB設計約束 三、 1、改進電路設計規程提高可測性 2、混合信號PCB的分區設計 3、蛇形走線的作用 4、確保信號完整性的電路板設計準則 四、 1、印制電路板的可靠性設計 五、 1、DSP系統的降噪技術 2、POWERPCB在PCB設計中的應用技術 3、PCB互連設計過程中最大程度降低RF效應的基本方法 六、 1、混合信號電路板的設計準則 2、分區設計 3、RF產品設計過程中降低信號耦合的PCB布線技巧 七、 1、PCB的基本概念 2、避免混合訊號系統的設計陷阱 3、信號隔離技術 4、高速數字系統的串音控制 八、 1、掌握IC封裝的特性以達到最佳EMI抑制性能 2、實現PCB高效自動布線的設計技巧和要點 3、布局布線技術的發展
上傳時間： 2016-04-08
上傳用戶：woshini123456
本文檔是 Intel GigaBit 網卡的 data sheet。是撰寫 Linux driver 的程序員不可或缺的參考資料。
標簽： GigaBit driver Intel Linux
上傳時間： 2014-01-20
上傳用戶：wfl_yy
PDIUSBD12 是一款帶有并行總線和局部DMA傳輸能力的高速USB 接口器件固件設計的目標就是 使PDIUSBD12 在USB 上達到最大的傳輸速率外圍設備例如打印機掃描儀外部的海量存儲器和數碼 相機都可使用PDIUSBD12 在USB 上傳輸數據這些設備的CPU 要忙于處理許多設備控制和數據以及圖像 處理等任務PDIUSBD12 的固件設計成完全的中斷驅動當CPU 處理前臺任務時USB 的傳輸可在后臺 進行這就確保了最佳的傳輸速率和更好的軟件結構同時簡化了編程和調試 后臺ISR 中斷服務程序和前臺主程序循環之間的數據交換通過事件標志和數據緩沖區來實現例 如PDIUSBD12 的批量輸出端點可使用循環的數據緩沖區當PDIUSBD12 從USB 收到一個數據包那 么就對CPU 產生一個中斷請求CPU 立即響應中斷在ISR中固件將數據包從PDIUSBD12 內部緩沖區 移到循環數據緩沖區并在隨后清零PDIUSBD12 的內部緩沖區以使能接收新的數據包CPU 可以繼續它當 前的前臺任務直到完成例如打印當前頁然后返回到主循環檢查循環緩沖區內是否有新的數據并開始其 它的前臺任務
上傳時間： 2016-04-10
上傳用戶：13160677563
D-S.Kim, Y.S.Lee, W.H.Kwon, and H.S.Park, "Maximum Allowable Delay Bounds in Networked Control Systems", Control Engineering Practice (Elsvier Science) (Simulation Example - Matlab Code), PP.1301-1313, Vol.11, Issue 11, December, 2003
標簽： Allowable Networked Control Maximum
上傳時間： 2016-04-10
上傳用戶：lifangyuan12
H.S.Park, D-S.Kim, and W.H.Kwon "A Scheduling Method for Network-based Control Systems", IEEE Transaction on Control System Technology, Vol.10, No.3, pp. 318-330, May, 2002 (Simulation Example 1- Matlab Code)
標簽： Network-based Scheduling Control Systems
上傳時間： 2014-01-20
上傳用戶：cainaifa
使用C8051F360高速單片機加無線收發芯片CC1100實現的無線語音通信的源代碼，通過初步測試。
上傳時間： 2014-01-12
上傳用戶：大三三
高速接口上的鏈接客戶說的法律框架和管理會計 發個上來困境累計曠工鏈接看電視
上傳時間： 2014-11-15
上傳用戶：tianjinfan
spring入門 spring入門spri ng入門 spring入門
上傳時間： 2013-12-26
上傳用戶：as275944189
LU分解法子過程,范德蒙方程組解法,矩陣的QR分解,全主元高斯約當消去法
上傳時間： 2013-12-21
上傳用戶：王楚楚
