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鼠標、鍵盤及其他設備

  • 基于FPGA的圖像采集處理系統設計與實現.rar

    隨著當今科學技術的迅猛發展,數字圖像處理技術正在各個行業得到廣泛的應用,而FPGA技術的不斷成熟改變了通常采用并行計算機或數字信號處理器(DSP)、專用集成電路(ASIC)等作為嵌入式處理器的慣例。可編程邏輯器件(FPGA)憑借其較低的開發成本、較高的并行處理速度、較大的靈活性及其較短的開發周期等特點,在圖像處理系統中有獨特的優勢。 本文提出了一種基于FPGA的圖像采集處理系統解決方案,并選用低成本高性能的Altera公司的CycloneIII系列FPGA EP3C40F324為核心,設計開發了圖像采集處理的軟硬件綜合系統。文章闡述了如何在FPGA中嵌入NiosII軟核處理器并完成圖像采集處理系統功能的設計方案。硬件電路上,系統設計了三塊電路板:FPGA核心處理板、圖像采集卡、圖像顯示卡,其中通過I2C總線對采集卡的工作模式進行配置,在采集模塊控制下,將采集到的圖像數據存儲到SDRAM;根據VGA顯示原理及其時序關系,設計了VGA顯示輸出控制模塊,合成了VGA工作的控制信號,又根據VGA顯示器的工業標準,合成VGA接口的水平和幀同步信號。邏輯硬件上,應用SOPCBuilder工具生成了FPGA內部的邏輯硬件功能模塊,定制了NiosII IP core、CMOS圖像采集模塊、VGA Controller及其I2C總線接口,系統各模塊間通過Avalon總線連接起來。軟件部分,在NiosII內核處理器上實現了彩色圖像顏色空間轉換、二值化、形態學腐蝕處理及其目標定位等算法。實驗結果證明了本文提出的方案及算法的正確性,可行性。

    標簽: FPGA 圖像采集 處理系統

    上傳時間: 2013-08-05

    上傳用戶:woshiyaosi

  • 大功率照明LED開關電源研究.rar

    大功率照明LED(Light Emitting Diode)是新一代光源,它光轉換效率高,也稱作綠色光源。由于大功率照明LED本身的伏安特性,大功率LED的開關電源的研究從一開始就遇到了困難。而發展LED照明是現在節能環保的大趨勢,所以研究開發一種新型的大功率照明LED開關電源是很有必要的。 本文簡要介紹了大功率LED的發光特性、伏安特性及其驅動方案,并回顧了大功率LED開關電源的發展歷史,展望了未來趨勢。給出了大功率LED開關電源課題的背景,并分析了設計難點。在此基礎上,提出了一種新型兩級式方案,前級為PFC級,后級為DC/DC級。PFC級采用電感電流臨界連續模式的Boost變換器,DC/DC級采用準諧振模式的反激變換器。為了提高PFC級在低電壓輸入時的效率,采用了變電壓輸出的控制方案。 文中首先對采用臨界連續工作模式的功率因數校正級的工作原理和主電路參數進行推導與設計,以及對基于L6562的PFC控制電路的設計進行了詳細的研究。其次詳細介紹了準諧振模式的理論基礎和應用,對基于NCP1377B的反激變換器的工作原理和穩態特性進行了詳細的分析;在此基礎上提出了一種高效低損耗的準諧振變換器的設計方案。論文詳細介紹了該方案的工作原理和特點,并分析了鉗位電路及基于TSM103的恒壓/恒流電路及線性穩壓器在提出的兩級式方案中的應用。 結合上面提到的方案,本文研制了一臺全球輸入電壓范圍(90~265Vac),12V/5A輸出的大功率照明LED開關電源,實驗結果驗證了所提方案的可行性。

    標簽: LED 大功率 照明

    上傳時間: 2013-07-15

    上傳用戶:大融融rr

  • 電梯系統中超級電容儲能的研究.rar

    電梯在垂直升降的過程中,由于功率變化范圍很大,節能潛力巨大。本文主要工作在于結合電梯系統的特點,對超級電容儲能系統中超級電容容量需求及其他相關參數的設置進行詳細討論。也對與之配套的雙向DC/DC變換器進行研究。 本文在研究了電梯系統的結構和運行特點的基礎上,對其運行過程中能量狀態的變化進行了詳細分析,得到了儲能裝置中超級電容器容量的計算方法,并在此基礎上,根據超級電容器容量需求與系統前級雙向整流器功率的關系,提出了一套簡單有效的能量管理方案,減少了儲能裝置中超級電容器的容量需求。并且對于超級電容容量設置給出了一般的原則。 儲能裝置與系統直流母線之間需要雙向變換器進行能量傳遞,本文對于各種雙向直流變換器拓撲的優缺點進行了比較,結合在超級電容儲能裝置中的具體應用需要,得出BUCK/BOOST型變換器更適合本文中的應用。 本文為儲能裝置設計了基于DSP(數字信號處理器)全數字控制的具有多種工作方式的雙向DC/DC變換器的小功率樣機,在電容器放電時,以恒流模式向直流母線輸送能量;在電容器充電時,以分段恒流模式或恒壓模式進行充電。文中給出了詳細的硬件電路以及數字控制部分的設計過程,并通過實驗進行了驗證。

    標簽: 電梯系統 儲能 超級電容

    上傳時間: 2013-04-24

    上傳用戶:冇尾飛鉈

  • 基于CAN總線的嵌入式測控系統的研究.rar

    本文在分析了嵌入式技術及控制系統的發展概況后,首先對現場總線,主要是CAN總線的技術特點進行了全面的介紹,并重點對CAN總線網絡中數據傳輸的實時性問題及改善的方案進行了分析和研究。之后利用嵌入式技術實現了基于CAN總線的網絡測控系統。該系統的主控節點,即ARM平臺采用32位的嵌入式處理器AR2M和嵌入式實時操作系統μC/OS-Ⅱ來實現,并在該平臺上完成了系統多任務的建立,包括與底層CAN網絡的通信、液晶顯示輸出和嵌入式Web服務器等。 論文共分六章。第一章介紹了控制系統的發展過程、嵌入式技術及其發展現狀,并引出了課題的背景和研究意義,給出了主要研究內容。第二章著重介紹了CAN現場總線技術,并對其工作原理和CAN總線系統的實時性進行了分析。第三章論述了CAN總線測控網絡的實現以及CAN測控網絡與Internet集成的必要性,并給出了本文的系統設計方案、工作原理和組成。第四章論述了基于CAN總線的嵌入式測控系統的設計與實現,詳細闡述了系統的硬件、軟件設計思路和實現方法。硬件方面,介紹了硬件平臺中的主處理器LPC2292和整個硬件邏輯模塊。軟件設計上實現了μC/OS-Ⅱ實時操作系統在ARM7上的移植,并完成了嵌入式系統下多任務的建立。第五章介紹了以QXLPC-Ⅲ過程控制系統為應用對象,進行的實際應用實驗,該實驗對被控過程的部分物理量進行了檢測,驗證了本方案的可行性。第六章對全文進行了總結,給出了有待進一步研究的問題,并對后續工作進行了展望。

    標簽: CAN 總線 嵌入式

    上傳時間: 2013-06-03

    上傳用戶:zttztt2005

  • C2000DSP實驗指導.rar

    電氣與自動化工程學院為本科生和研究生開設了DSP原理及應用課程、DSP技術及其應用綜合實驗。根據我們學院所設置專業的特點,選擇TI公司C2000系列DSP芯片作為主要學習內容,該課程的實踐性很強,即實驗是該課程的主要內容。我們針對TI公司C2000系列DSP芯片的工作原理、體系結構、指令系統和應用開發了一套實驗平臺――TMS320LF2407A實驗箱,該實驗箱內容豐富,易于擴展,可以做綜合性的提高實驗。為了方便實驗教學,我們編寫了實驗箱的實驗指導書。 該實驗指導書共分為五章。第一章是概述,簡單介紹TMS320LF2407A芯片的特點,DSP應用軟件的開發流程和如何編寫源程序和cmd文件。第二章介紹DSP的集成開發環境-CCS,即介紹CCS的安裝、配置和使用。第三章介紹DSP的并口仿真器。第四章介紹我們開發的實驗平臺――TMS320LF2407A實驗箱。第五章介紹在TMS320LF2407A的實驗箱平臺上進行的20個實驗。 在電氣與自動化工程學院DSP實驗室的建設中,得到了美國TI公司大學計劃的捐贈;得到合肥工業大學實驗裝置改造與研制基金和本科評建實驗室建設項目的資助;學院領導給予了很大的重視和支持,院實驗中心的老師們也做了大量的工作。在此一并表示感謝。 該實驗指導書是第3版。第1版是李巧利、吳婷和徐科軍針對TMS320LF2407A EVM板編寫的,由徐科軍審閱。在實驗中,張瀚、陳智淵、余向陽、周楊、梅楠楠和曾憲俊等提出了修訂意見。第2版是在第1版的基礎上,針對張瀚和陳智淵研制的實驗箱(由合肥工業大學實驗基金資助),由陳智淵和張瀚編寫,由徐科軍審閱。第3版是在第2版的基礎上,針對陳智淵、張瀚和周楊研制的實驗箱(由合肥工業大學本科評建項目資助),由陳智淵完成初稿,由黃云志、張瀚、周楊和曾憲俊修訂,由徐科軍審閱。在實驗指導書的編寫過程中,參考了一些公司的資料和專家的書籍。由于編者水平有限,書中肯定存在不妥之處,敬請批評指正。

    標簽: C2000 2000 DSP

    上傳時間: 2013-06-26

    上傳用戶:gut1234567

  • 電路(第六版).rar

    國外著名的電路教材的中文版。周玉坤翻譯。 電路第六版系統地講述了電路中的基本概念、基本理論、基本分析和計算方法。全書共分18章。主要內容有電路基本元件、簡單電阻電路分析、電路常見分析法、運算放大器基本應用電路、一階和二階電路的分析、正弦穩態分析及其功率計算、平衡三相電路、拉普拉斯變換及其應用、選頻電路、有源濾波器、傅里葉級數及傅里葉變換和雙端口網絡等。書中包含豐富的例題、詳盡的圖表資料,且內容新,講解透徹,是一本電路分析的優秀教材。

    標簽: 電路

    上傳時間: 2013-04-24

    上傳用戶:tfyt

  • ds1302中文資料

    美國DALLAS公司推出的具有涓細電流充電能力的低功耗實時時鐘電路DS1302的結構、工作原理及其在實時顯示時間中的應用。它可以對年、月、日、周、日、時、分、秒進行計時,且具有閏年補償等多種功能

    標簽: 1302 ds

    上傳時間: 2013-07-14

    上傳用戶:iswlkje

  • 基于ARM的下運帶式輸送機軟制動系統的研究

    隨著煤礦高產高效技術的推廣和應用,井下長距離、大運量、大功率下運帶式輸送機的應用越來越普遍。其中,解決好傾角較大(大于6°)的下運帶式輸送機的運行制動和安全制動問題對保障全礦安全、高效生產具有重要意義。 本文在對國內外現有下運帶式輸送機制動系統的現狀分析基礎上,針對煤礦生產的特殊性,提出了基于ARM的嵌入式計算機控制液壓調速軟制動系統方案,所用元件可靠性和防爆性好,系統簡單,動態制動性能好;結合成熟的工業PID控制經驗和智能控制理論,并依據制動控制方案,設計了一種模糊自適應PID控制器用于控制電液比例調速閥的開口大小,其PID參數Kp、Ki和Kd可根據系統狀態進行在線調整,結構簡單、魯棒性強,在系統結構參數發生改變時也可獲得較好的控制效果;在基于S3C44BOX的最小ARM系統基礎上,設計了系統控制信號的輸入、輸出方式及其電路;分析了實時操作系統μC/OS-ⅡBootLoader的設計及其在S3C44BOX上的移植過程;制動系統應用軟件采用多任務機制,狀態檢測與控制任務并行運行,數據采集采用定時中斷的方式;系統可擴展性、可移植性好,控制算法容易實現多樣性且開發簡單、維護方便。 該液壓調速軟制動系統可用于大型下運帶式輸送機的正常工作制動、緊急停車和斷電防止飛車事故發生的安全制動,對輸送機的輔助啟動也起重要作用。制動力矩依據輸送機載荷大小和輸送機制動減速時速度的變化進行自動調整,制動曲線可調,輸送機減速時不產生較大沖擊、安全平穩,并按照規定的減速度大小減速停車。

    標簽: ARM 帶式輸送機 制動系統

    上傳時間: 2013-07-09

    上傳用戶:幾何公差

  • 基于ARM嵌入式系統的GPS接收機設計

    由于全球定位系統在航天、航空、航海、海洋上程、大地測量、陸地導航以及軍事上的大量運用及其廣闊的應用前景,使得GPS接收機系統成為國內外相關領域競相研究的對象。GPS系統的用戶部分主要是各種型號的GPS接收機。所以GPS接收機中的微處理器的運算能力和功耗直接影響整機的性能。 本文所研究的是基于ARM微處理器和μC/OS—Ⅱ的嵌入式系統開發及其在GPS接收機中的應用。介紹了OPS接收機設計原理,分析了接收機硬件模塊的組成和功能,設計了由FPGA和ARM完成基帶信號處理及導航解算的接收機,建立了基于ARM和μC/OS—Ⅱ的GPS接收機嵌入式硬件開發平臺。研究了嵌入式實時操作系統μC/OS—Ⅱ,分析了其內核的組成結構:與處理器無關代碼、處理器相關代碼、與應用相關代碼,并重點分析和配置了其中與處理器相關和與應用相關的代碼部分,最終將其成功移植到ARM LPC2290微處理器上。建立了基于ARM LPC2290和μC/OS—Ⅱ的嵌入式系統軟件編譯和調試的交叉環境,設計了運行在此環境下的中斷和多任務來實現接收機信號處理、導航解算及顯示等功能,最終完成了基于ARM和μC/OS—Ⅱ的GPS接收機軟應用件設計。 總之,本文從研究嵌入式系統的軟、硬件設計及其應用著手,掌握了嵌入式系統開發的核心技術,研制了基于ARM嵌入式開發平臺的GPS接收機。

    標簽: ARM GPS 嵌入式系統 收機設計

    上傳時間: 2013-04-24

    上傳用戶:buffer

  • 基于FPGA的數字射頻存儲器設計

    數字射頻存儲器(Digital Radio FreqlJencyr:Memory DRFM)具有對射頻信號和微波信號的存儲、處理及傳輸能力,已成為現代雷達系統的重要部件。現代雷達普遍采用了諸如脈沖壓縮、相位編碼等更為復雜的信號處理技術,DRFM由于具有處理這些相干波形的能力,被越來越廣泛地應用于電子對抗領域作為射頻頻率源。目前,國內外對DRFM技術的研究還處于起步階段,DRFM部件在采樣率、采樣精度及存儲容量等方面,還不能滿足現代雷達信號處理的要求。 本文介紹了DRFM的量化類型、基本組成及其工作原理,在現有的研究基礎上提出了一種便于工程實現的設計方法,給出了基于現場可編程門陣列(Field Programmable Gate Array FPGA)實現的幅度量化DRFM設計方案。本方案的采樣率為1 GHz、采樣精度12位,具體實現是采用4個采樣率為250 MHz的ADC并行交替等效時間采樣以達到1 GHz的采樣率。單通道內采用數字正交采樣技術進行相干檢波,用于保存信號復包絡的所有信息。利用FPGA器件實現DRFM的控制器和多路采樣數據緩沖器,采用硬件描述語言(Very High Speed}lardware Description Language VHDL)實現了DRFM電路的FPGA設計和功能仿真、時序分析。方案中采用了大量的低壓差分信號(Low Voltage Differential Signaling LVDS)邏輯的芯片,從而大大降低了系統的功耗,提高了系統工作的可靠性。本文最后對采用的數字信號處理算法進行了仿真,仿真結果證明了設計方案的可行性。 本文提出的基于FPGA的多通道DRFM系統與基于專用FIFO存儲器的DRFM相比,具有更高的性能指標和優越性。

    標簽: FPGA 數字射頻 存儲器

    上傳時間: 2013-06-01

    上傳用戶:lanwei

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