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16B

  • 以太網16B/20B源代碼包括編碼器和解碼器功能

    以太網16B/20B源代碼包括編碼器和解碼器功能

    標簽: 16 20 以太網 源代碼

    上傳時間: 2016-02-11

    上傳用戶:iswlkje

  • vhdl語言的16B cpu代碼 全部的代碼我會依次上傳 另有說明txt文本

    vhdl語言的16B cpu代碼 全部的代碼我會依次上傳 另有說明txt文本

    標簽: vhdl 16B cpu txt

    上傳時間: 2014-12-06

    上傳用戶:Zxcvbnm

  • 基于FPGA的SATAⅡ協議研究與實現.rar

    現代的計算機追求的是更快的速度、更高的數據完整性和靈活性。無論從物理性能,還是從電氣性能來看,現今的并行總線都已出現了某些局限,無法提供更高的數據傳輸率。而SATA以其傳輸速率快、支持熱插拔、可靠的數據傳輸等特點,得到各行業越來越多的支持。 目前市場上的SATA IP CORE都是面向IC設計的,不利于在FPGA上集成,因此,本文在Xilinx公司的Virtex5系列FPGA上實現SATAⅡ協議,對SATA技術的推廣、國內邏輯IP核的發展都有一定的意義。 本文將SATAⅡ協議的FPGA實現劃分成物理層、鏈路層、傳輸層和應用層四個模塊。提出了物理層串行收/發器設計以及物理鏈路初始化方案。分析了鏈路層模塊結構,給出了作為SATAⅡ鏈路層核心的狀態機的設計。為滿足SATAⅡ協議3.0Gbps的速率,采用擴大數據處理位寬的方法,設計完成了鏈路層的16B/20b編碼模塊,同時為提高數據傳輸可靠性和信號的穩定性,分別實現了鏈路層CRC校驗模塊和并行擾碼模塊。在描述協議傳輸層的模塊結構的基礎上,給出了作為傳輸層核心的狀態機的設計,并以DMA DATA OUT命令的操作為例介紹了FIS在傳輸層中的處理過程。完成了命令層協議狀態機的設計,并實現了SATAⅡ新增功能NCQ技術,從而使得數據傳輸更加有效。最后為使本設計應用更加廣泛,設計了基于AHB總線的用戶接口。 本設計采用Verilog HDL語言對需要實現的電路進行描述,并使用Modelsim軟件仿真。仿真結果表明,本文設計的邏輯電路可靠穩定,與SATAⅡ協議定義功能一致。

    標簽: FPGA SATA 協議研究

    上傳時間: 2013-06-16

    上傳用戶:cccole0605

  • IIC接口E2PROM(AT24C64) 讀寫VERILOG 驅動源碼+仿真激勵文件: module

    IIC接口E2PROM(AT24C64) 讀寫VERILOG 驅動源碼+仿真激勵文件:module i2c_dri    #(      parameter   SLAVE_ADDR = 7'b1010000   ,  //EEPROM從機地址      parameter   CLK_FREQ   = 26'd50_000_000, //模塊輸入的時鐘頻率      parameter   I2C_FREQ   = 18'd250_000     //IIC_SCL的時鐘頻率    )   (                                                                input                clk        ,        input                rst_n      ,                                                //i2c interface                          input                i2c_exec   ,  //I2C觸發執行信號    input                bit_ctrl   ,  //字地址位控制(16B/8b)    input                i2c_rh_wl  ,  //I2C讀寫控制信號    input        [15:0]  i2c_addr   ,  //I2C器件內地址    input        [ 7:0]  i2c_data_w ,  //I2C要寫的數據    output  reg  [ 7:0]  i2c_data_r ,  //I2C讀出的數據    output  reg          i2c_done   ,  //I2C一次操作完成    output  reg          i2c_ack    ,  //I2C應答標志 0:應答 1:未應答    output  reg          scl        ,  //I2C的SCL時鐘信號    inout                sda        ,  //I2C的SDA信號                                           //user interface                       output  reg          dri_clk       //驅動I2C操作的驅動時鐘     );//localparam definelocalparam  st_idle     = 8'b0000_0001; //空閑狀態localparam  st_sladdr   = 8'b0000_0010; //發送器件地址(slave address)localparam  st_addr16   = 8'b0000_0100; //發送16位字地址localparam  st_addr8    = 8'b0000_1000; //發送8位字地址localparam  st_data_wr  = 8'b0001_0000; //寫數據(8 bit)localparam  st_addr_rd  = 8'b0010_0000; //發送器件地址讀localparam  st_data_rd  = 8'b0100_0000; //讀數據(8 bit)localparam  st_stop     = 8'b1000_0000; //結束I2C操作//reg definereg            sda_dir   ; //I2C數據(SDA)方向控制reg            sda_out   ; //SDA輸出信號reg            st_done   ; //狀態結束reg            wr_flag   ; //寫標志reg    [ 6:0]  cnt       ; //計數reg    [ 7:0]  cur_state ; //狀態機當前狀態reg    [ 7:0]  next_state; //狀態機下一狀態reg    [15:0]  addr_t    ; //地址reg    [ 7:0]  data_r    ; //讀取的數據reg    [ 7:0]  data_wr_t ; //I2C需寫的數據的臨時寄存reg    [ 9:0]  clk_cnt   ; //分頻時

    標簽: iic 接口 e2prom at24c64 verilog 驅動 仿真

    上傳時間: 2021-11-05

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