本文件是基于高斯正弦波行的寬帶脈沖波形設計,保證了相對帶寬大,衰減滿足3db要求
上傳時間： 2014-12-05
上傳用戶：極客
一種寬頻帶3db環(huán)形電橋設計 本文討論并設計了一種改進的 3db寬頻帶環(huán)形電橋。采用在各引出臂上加四分之 一波長阻抗變換器，并將環(huán)分為特性阻抗不同的六段，使其帶寬增寬，理論上帶寬可以達到40％左右。并給出了微帶型電橋的設計、仿真及實測結果。
上傳時間： 2013-12-17
上傳用戶：氣溫達上千萬的
1）設計Butterworth型音頻抗混疊濾波器； 2）參數(shù)： 下通帶頻率300Hz；上通帶頻率3400Hz； 下阻帶頻率280Hz；上阻帶頻率3600Hz； 通帶最大衰減0.3db； 阻帶最小衰減40dB； 3）采用一低通濾波器和一高通濾波器級聯(lián)； 4）分別確定LPF和HPF的性能指標； 5）求出兩濾波器的系統(tǒng)函數(shù)和頻率響應，并畫出其幅頻特性曲線； 6）求整個濾波器的系統(tǒng)函數(shù)和頻率響應，并畫出其幅頻特性曲線。
標簽： Hz Butterworth 頻率 3400
上傳時間： 2017-06-07
上傳用戶：bibirnovis
fp=2400hz,fs=5000hz,rp=3db,rs=25db.求其3db時的各項參數(shù)！
上傳時間： 2014-01-04
上傳用戶：familiarsmile
Sigma-Delta A/D轉換器利用過采樣，噪聲整形和數(shù)字濾波技術，有效衰減了輸出信號帶內的量化噪聲，提高了信噪比。與傳統(tǒng)的Nyquist轉換器相比，它降低了對模擬電路性能指標和元件精度的要求，簡化了模擬電路的設計，降低了生產成本。 本論文在對Sigma-Delta A/D轉換器原理研究的基礎上，基于TSMC0．18um工藝，采用1．8V工作電源，128倍的過采樣率，6．4MHz的采樣頻率，設計了一個主要應用于音頻信號處理的Sigma-Delta A/D轉換器，分辨率達到16位。在調制器的設計中，本文采用了多級噪聲整形MASH（2-1）級聯(lián)調制器結構，同時，考慮了各種非理想因素對系統(tǒng)性能的影響，在SDtoolbox工具的幫助下使用Simulink進行調制器系統(tǒng)設計。并使用Cadence Spectre對模塊電路進行設計仿真，包括運放，比較器，帶隙基準電壓源，CMOS開關，非交疊時鐘產生電路等。在數(shù)字抽取濾波器的設計中，采用了分級抽取技術，使用MATLAB軟件中的SPTool和FDATool工具對各級抽取濾波器進行優(yōu)化設計。并在原有的濾波器算法的基礎上，采用了CIC濾波器和半帶濾波器，設計出了運算量和存儲量都相對少的三級抽取濾波器系統(tǒng)，大大降低了功耗和面積。 論文的仿真結果表明，所設計的Sigma-Delta A/D轉換器信噪比達到102．3db，滿足系統(tǒng)需要的16位精度要求。 關鍵詞：Sigma-Ddta； 信噪比； 多級噪聲整形； 數(shù)字抽取濾波器
標簽： SigmaDelta 音頻 模數(shù)轉換器
上傳時間： 2013-06-27
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The LTC®1966 is a true RMS-to-DC converter that uses aDS computational technique to make it dramatically simplerto use, significantly more accurate, lower in powerconsumption and more flexible than conventional logantilogRMS-to-DC converters. The LTC1966 RMS-to-DCconverter has an input signal range from 5mVRMS to1.5VRMS (a 50dB dynamic range with a single 5V supplyrail) and a 3db bandwidth of 800kHz with signal crestfactors up to four.
上傳時間： 2013-10-12
上傳用戶：qilin
本文將接續(xù)介紹電源與功率電路基板，以及數(shù)字電路基板導線設計。寬帶與高頻電路基板導線設計a.輸入阻抗1MHz，平滑性(flatness)50MHz 的OP增幅器電路基板圖26 是由FET 輸入的高速OP 增幅器OPA656 構成的高輸入阻抗OP 增幅電路，它的gain取決于R1、R2，本電路圖的電路定數(shù)為2 倍。此外為改善平滑性特別追加設置可以加大噪訊gain，抑制gain-頻率特性高頻領域時峰值的R3。圖26 高輸入阻抗的寬帶OP增幅電路圖27 是高輸入阻抗OP 增幅器的電路基板圖案。降低高速OP 增幅器反相輸入端子與接地之間的浮游容量非常重要，所以本電路的浮游容量設計目標低于0.5pF。如果上述部位附著大浮游容量的話，會成為高頻領域的頻率特性產生峰值的原因，嚴重時頻率甚至會因為feedback 阻抗與浮游容量，造成feedback 信號的位相延遲，最后導致頻率特性產生波動現(xiàn)象。此外高輸入阻抗OP 增幅器輸入部位的浮游容量也逐漸成為問題，圖27 的電路基板圖案的非反相輸入端子部位無full ground設計，如果有外部噪訊干擾之虞時，接地可設計成網(wǎng)格狀(mesh)。圖28 是根據(jù)圖26 制成的OP 增幅器Gain－頻率特性測試結果，由圖可知即使接近50MHz頻率特性非常平滑，-3db cutoff頻率大約是133MHz。
標簽： PCB
上傳時間： 2013-11-13
上傳用戶：hebanlian
包括了新型70MHz帶通濾波器設計,40MHz帶通濾波器設計實例 凡是有能力對信號頻譜進行處理的裝置都可以稱為濾波器。在通信設備和各類系統(tǒng)中，濾波器應用極為廣泛，濾波器的優(yōu)劣直接決定產品的好壞，所以對濾波器的研究和生產一直備為關注。由于計算機技術、集成工藝和材料工業(yè)的發(fā)展，濾波器的發(fā)展也上了一個新臺階，并且朝高精度、低功耗、小體積方向發(fā)展。本文主要以中心頻率為70MHz 帶通濾波器為例，介紹如何采用Bessel函數(shù)[1]進行帶通濾波器的設計，同時借助Pspice軟件[2,3]強大的電路仿真功能對濾波器的波特圖和群延遲進行仿真，以觀測其效果。2 方案選擇帶通濾波器技術指標要求：帶寬3db 為4MHz，離中心頻率± 4MHz 處最小衰減為14dB。在整個通帶內時延不變。雖然目前最常用的濾波器設計方法是巴特沃斯、切比雪夫、橢圓函數(shù)等幾種形式，但這些方法在設計70MHz 濾波器時，要通過變換以實現(xiàn)其帶通，并且它們所設計的濾波器的群延遲特性在通帶內呈現(xiàn)凹形波形，故在實際使用（如在廣播，移動通信中的中頻濾波，二次濾波）中要進行群延遲均衡，使設計步驟繁瑣且使濾波電路復雜。采用Bessel 函數(shù)設計的帶通濾設器具有最窄過渡帶；在通帶內時延均衡，電路所用的階數(shù)最少；在實際的應用中電路容易調整；由于所有的節(jié)點諧振在相同的頻率上，調諧比較簡單；從經(jīng)濟性和制造容易程度來考慮，電容耦合電路最合適，而用Bessel 函數(shù)設計的濾波器正是電容耦合電路，故采用Bessel 函數(shù)進行濾波器的設計。
上傳時間： 2013-10-27
上傳用戶：bakdesec
本文將接續(xù)介紹電源與功率電路基板，以及數(shù)字電路基板導線設計。寬帶與高頻電路基板導線設計a.輸入阻抗1MHz，平滑性(flatness)50MHz 的OP增幅器電路基板圖26 是由FET 輸入的高速OP 增幅器OPA656 構成的高輸入阻抗OP 增幅電路，它的gain取決于R1、R2，本電路圖的電路定數(shù)為2 倍。此外為改善平滑性特別追加設置可以加大噪訊gain，抑制gain-頻率特性高頻領域時峰值的R3。圖26 高輸入阻抗的寬帶OP增幅電路圖27 是高輸入阻抗OP 增幅器的電路基板圖案。降低高速OP 增幅器反相輸入端子與接地之間的浮游容量非常重要，所以本電路的浮游容量設計目標低于0.5pF。如果上述部位附著大浮游容量的話，會成為高頻領域的頻率特性產生峰值的原因，嚴重時頻率甚至會因為feedback 阻抗與浮游容量，造成feedback 信號的位相延遲，最后導致頻率特性產生波動現(xiàn)象。此外高輸入阻抗OP 增幅器輸入部位的浮游容量也逐漸成為問題，圖27 的電路基板圖案的非反相輸入端子部位無full ground設計，如果有外部噪訊干擾之虞時，接地可設計成網(wǎng)格狀(mesh)。圖28 是根據(jù)圖26 制成的OP 增幅器Gain－頻率特性測試結果，由圖可知即使接近50MHz頻率特性非常平滑，-3db cutoff頻率大約是133MHz。
標簽： PCB
上傳時間： 2013-11-09
上傳用戶：z754970244
在無線網(wǎng)絡的接收機端，對16進制的正交幅度調制信號進行軟解調， 這種軟解調方式比硬解調會提高2-3db
標簽： 無線網(wǎng)絡 接收機
上傳時間： 2016-05-30
上傳用戶：er1219
