每路輸入數(shù)據(jù)與輸出數(shù)據(jù)均為4位2進(jìn)制數(shù)，當(dāng)選擇開關(guān)(至少3位)或輸入數(shù)據(jù)發(fā)生變化時，輸出數(shù)據(jù)也相應(yīng)地變化。有興趣的同學(xué)可以進(jìn)一步擴(kuò)充系統(tǒng)功能。
標(biāo)簽： 輸入 數(shù)據(jù) 輸出數(shù)據(jù) 進(jìn)制數(shù)
上傳時間： 2016-07-03
上傳用戶：weixiao99
本文件包括多路選擇器器建模，譯碼器實(shí)驗(yàn)程序，加法器實(shí)驗(yàn)程序，比較器實(shí)驗(yàn)程序，計(jì)數(shù)器建模，I2C接口標(biāo)準(zhǔn)建模源碼，串行接口RS232標(biāo)準(zhǔn)建模源碼標(biāo)準(zhǔn)，LCM建模源碼，時鐘６分頻源碼，串并轉(zhuǎn)化源碼。 ，對于硬件設(shè)計(jì)初學(xué)者來說有一定的參考價值。
上傳時間： 2014-01-21
上傳用戶：stvnash
8*8乘法器及其測試：采用booth編碼的乘法器：1． ultipler_quick_add_4 即4位的并行全加器，在這里主要起了兩個作用：第一個是在求部分積單元時，當(dāng)編碼為3x時用來輸出部分積；另外一個是在將部分積加起來時，求3到6位時所用到。 2． ultiplier_quick_add_5 即5位的并行全加器，這里用來分別計(jì)算積的7到11位和12到16位。 3． ultiplier_unit_4 這個模塊是用來實(shí)現(xiàn)部分積的，每一個模塊實(shí)現(xiàn)一個部分積的4位，因此一個部分積需要4個這個模塊來實(shí)現(xiàn)。總共需要12個這樣的模塊。 4．Multiplier_full_add 這是一位的全加器，在實(shí)現(xiàn)部分積相加的時候，通過全加器的陣列來實(shí)現(xiàn)的。
標(biāo)簽： ultipler_quick_add booth 乘法器 測試
上傳時間： 2016-07-12
上傳用戶：zhaiye
用VC++6.0開發(fā)的用于對攝像頭采集到的視頻用xvid編碼器(MPEG-4的一種)進(jìn)行壓縮存儲。
上傳時間： 2016-07-24
上傳用戶：朗朗乾坤
自己設(shè)計(jì)的5路定時器！用于公司。內(nèi)附電路圖（DXP）
上傳時間： 2016-08-12
上傳用戶：aysyzxzm
1 前言 2 2 需求分析 2 2．1原理 2 2．2要求 2 2．3任務(wù) 2 3 概要設(shè)計(jì) 3 3．1實(shí)現(xiàn)功能 3 3．2搶答器的組成框圖 3 4 詳細(xì)設(shè)計(jì) 4 4．1搶答電路設(shè)計(jì) 4 4．2定時電路設(shè)計(jì) 5 4．3報(bào)警電路設(shè)計(jì) 6 4．4搶答器控制電路設(shè)計(jì) 6 5 課程設(shè)計(jì)的總結(jié)與體會 8 6 致謝 8 7 參考資料 8
標(biāo)簽： 分 搶答器 搶答 詳細(xì)設(shè)計(jì)
上傳時間： 2016-08-12
上傳用戶：Andy123456
1.Fisher分類算法 2.感知器算法 3.最小二乘算法 4.快速近鄰算法 5.K-近鄰法 6.剪輯近鄰法和壓縮近鄰法 7.二叉決策樹算法
標(biāo)簽： Fisher 算法 分類算法 決策樹算法
上傳時間： 2016-08-12
上傳用戶：懶龍1988
利用8255實(shí)現(xiàn)8路搶答器,簡單明了,初學(xué)者非常適用,經(jīng)實(shí)驗(yàn)證明絕對可行
標(biāo)簽： 8255 8路 搶答器 初學(xué)者
上傳時間： 2014-01-05
上傳用戶：zhoujunzhen
4位半的BCD AD轉(zhuǎn)換器的單片機(jī)單線接口設(shè)計(jì),附源代碼和原理圖及PCB.
標(biāo)簽： BCD PCB AD轉(zhuǎn)換器 單片機(jī)
上傳時間： 2013-12-16
上傳用戶：xuanjie
1、 通過可編程并行接口芯片8255A和定時器/計(jì)數(shù)器8253實(shí)現(xiàn)十字路口交通燈的模擬控制。 2、 掌握通過8253實(shí)現(xiàn)準(zhǔn)確定時的方法。 3、 進(jìn)一步掌握并行接口芯片8255A的使用方法。 4、 進(jìn)一步掌握8259A可編程中斷控制器的使用方法。
上傳時間： 2014-01-05
上傳用戶：wmwai1314
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