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APPlication-layer

  • 基于FPGA動態(tài)重構(gòu)的故障容錯技術(shù).rar

    可重構(gòu)計算技術(shù)兼具通用處理器(General-Purpose Processor,GPP)和專用集成電路(Application Specific Integr—ated Circuits,ASIC)的特點,既可以提供硬件高速的特性,又具有軟件可以重新配置的特性。而動態(tài)部分可重構(gòu)技術(shù)是可重構(gòu)計算技術(shù)的最新進展之一。該技術(shù)的要點就是在系統(tǒng)正常工作的情況下,修改部分模塊的功能,而系統(tǒng)其它模塊能夠照常運行,這樣既節(jié)約硬件資源,又增強了系統(tǒng)靈活性。 可重構(gòu)SoC既可以在處理器上進行編程又可以改變FPGA內(nèi)部的硬件結(jié)構(gòu),這使得SoC系統(tǒng)既具有處理器善于控制和運算的特點,又具FPGA靈活的重構(gòu)特點;由于處理器和FPGA硬件是在同一塊硅片上,使得它們之間的通信寬帶大大提高,這種平臺很適合于容錯算法的實現(xiàn)。 本文基于863計劃項目;動態(tài)重構(gòu)計算機的可信實現(xiàn)關(guān)鍵技術(shù),重點研究應(yīng)用于惡劣環(huán)境中FPGA自我容錯的體系結(jié)構(gòu),提出了一套完整的SoC系統(tǒng)的容錯設(shè)計方案,并研究其實現(xiàn)技術(shù),設(shè)計實現(xiàn)了實現(xiàn)該技術(shù)的硬件平臺和軟件算法,并驗證成功。 論文取得了如下的創(chuàng)新性研究成果: 1、設(shè)計了實現(xiàn)動態(tài)重構(gòu)技術(shù)的硬件平臺,包括高性能的FPGA(內(nèi)含入式處理器PowcrPC)、PROM、SRAM、FLASH、串口通信等硬件模塊。 2、說明了動態(tài)重構(gòu)技術(shù)的設(shè)計規(guī)范和設(shè)計流程,實現(xiàn)動態(tài)重構(gòu)技術(shù)。 3、提出了一種基于動態(tài)重構(gòu)實現(xiàn)容錯的方法,不需要外部處理器干預(yù),由嵌入式處理器負責(zé)管理整個過程。 4、設(shè)計并實現(xiàn)了嵌入式處理器運行時需要的軟件,主要有兩個功能,首先是從CF卡中讀入重構(gòu)所需的配置文件,并將配置文件寫進FPGA內(nèi)部的配置存儲器中,改變FPGA內(nèi)部的功能。其次,是實現(xiàn)容錯技術(shù)的算法。

    標(biāo)簽: FPGA 動態(tài) 容錯技術(shù)

    上傳時間: 2013-04-24

    上傳用戶:edrtbme

  • FPGA測試方法研究.rar

    FPGA(Field Programmable Gate Arrays)是目前廣泛使用的一種可編程器件,F(xiàn)PGA的出現(xiàn)使得ASIC(Application Specific Integrated Circuits)產(chǎn)品的上市周期大大縮短,并且節(jié)省了大量的開發(fā)成本。目前FPGA的功能越來越強大,滿足了目前集成電路發(fā)展的新需求,但是其結(jié)構(gòu)同益復(fù)雜,規(guī)模也越來越大,內(nèi)部資源的種類也R益豐富,但同時也給測試帶來了困難,F(xiàn)PGA的發(fā)展對測試的要求越來越高,對FPGA測試的研究也就顯得異常重要。 本文的主要工作是提出一種開關(guān)盒布線資源的可測性設(shè)計,通過在FPGA內(nèi)部加入一條移位寄存器鏈對開關(guān)盒進行配置編程,使得開關(guān)盒布線資源測試時間和測試成本減少了99%以上,而且所增加的芯片面積僅僅在5%左右,增加的邏輯資源對FPGA芯片的使用不會造成任何影響,這種方案采用了小規(guī)模電路進行了驗證,取得了很好的結(jié)果,是一種可行的測試方案。 本文的另一工作是采用一種FPGA邏輯資源的測試算法對自主研發(fā)的FPGA芯片F(xiàn)DP250K的邏輯資源進行了嚴格、充分的測試,從FPGA最小的邏輯單元LC開始,首先得到一個LC的測試配置,再結(jié)合SLICE內(nèi)部兩個LC的連接關(guān)系得到一個SLICE邏輯單元的4種測試配置,并且采用陣列化的測試方案,同時測試芯片內(nèi)部所有的邏輯單元,使得FPGA內(nèi)部的邏輯資源得完全充分的測試,測試的故障覆蓋率可達100%,測試配置由配套編程工具產(chǎn)生,測試取得了完滿的結(jié)果。

    標(biāo)簽: FPGA 測試 方法研究

    上傳時間: 2013-06-11

    上傳用戶:唐僧他不信佛

  • MP3音頻編解碼運算中IMDCT算法研究及其FPGA實現(xiàn).rar

    近年來,隨著多媒體技術(shù)的迅猛發(fā)展,電子、計算機、通訊和娛樂之間的相互融合、滲透越來越多,而數(shù)字音頻技術(shù)則是應(yīng)用最為廣泛的技術(shù)之一。MP3(MPEG-1 Audio LayerⅢ)編解碼算法作為數(shù)字音頻的解決方案,在便攜式多媒體產(chǎn)品中得到了廣泛流行。 在已有的便攜式MP3系統(tǒng)實現(xiàn)方案中,低速處理器與專用硬件結(jié)合的SOC設(shè)計方案結(jié)合了硬件實現(xiàn)方式和軟件實現(xiàn)方式的優(yōu)點,具有成本低、升級容易、功能豐富等特點。IMDCT(反向改進離散余弦變換)是編解碼算法中一個運算量大調(diào)用頻率高的運算步驟,因此適于硬件實現(xiàn),以降低處理器的開銷和功耗,來提高整個系統(tǒng)的性能。 本文首先闡述了MP3音頻編解碼標(biāo)準和流程,以及IMDCT常用的各種實現(xiàn)算法。在此基礎(chǔ)上選擇了適于硬件實現(xiàn)的遞歸循環(huán)實現(xiàn)方法,并在已有算法的基礎(chǔ)上進行了改進,減小了所需硬件資源需求并保持了運算速度。接著提出了模塊總體設(shè)計方案,結(jié)合算法進行了實現(xiàn)結(jié)構(gòu)的優(yōu)化,并在EDA環(huán)境下具體實現(xiàn),用硬件描述語言設(shè)計、綜合、仿真,且下載到Xilinx公司的VirtexⅡ系列xc2v1000FPGA器件中,在減小硬件資源的同時快速地實現(xiàn)了IMDCT,經(jīng)驗證功能正確。

    標(biāo)簽: IMDCT FPGA MP3

    上傳時間: 2013-05-31

    上傳用戶:Minly

  • Design of Power Factor Correction Circuit Using SA7527

    The SA7527 is an active power factor correction(PFC)controller for boost PFC application whic

    標(biāo)簽: Correction Circuit Design Factor

    上傳時間: 2013-04-24

    上傳用戶:onewq

  • 90W Single stage PFC-flyback using L6562A for LED driver

    In these years, power LEDs for lighting is quite hot application. For the reasons: theirlife of

    標(biāo)簽: PFC-flyback Single L6562A driver

    上傳時間: 2013-06-26

    上傳用戶:181992417

  • 世界超級電容器發(fā)展動態(tài)

    超級電容器又稱超大容量電容器、金電容、黃金電容、儲能電容、法拉電容、電化學(xué)電容器或雙電層電容器(英文名稱為EDLC,即Electric Double Layer Capacitors),是靠極化電解液

    標(biāo)簽: 超級電容器 發(fā)展動態(tài)

    上傳時間: 2013-05-23

    上傳用戶:gxmm

  • 基于ARM嵌入式平臺的X86譯碼SoC架構(gòu)設(shè)計.pdf

    SoC(System On a Chip)又稱為片上系統(tǒng),是指將微處理器、模擬IP核、數(shù)字IP核和存儲器(或片外存儲器接口)集成在單一芯片上。SoC產(chǎn)品不斷朝著體積小、功能強的方向發(fā)展,芯片內(nèi)部整合越來越多的功能。ARM架構(gòu)作為嵌入式系統(tǒng)流行的應(yīng)用,其應(yīng)用的擴展面臨軟件擴充的問題,而X86平臺上卻有很多軟件資源。若將已有的X86軟件移植到ARM平臺,則可以在一定程度上解決軟件擴充的問題。 本論文針對X86指令在ARM中兼容的應(yīng)用,以智能手機的應(yīng)用為例,提出了基于ARM嵌入式平臺,使用X86指令到ARM指令的二進制翻譯模塊,達到對X86指令的兼容。主要研究ARM公司的片上總線系統(tǒng)——AMBA AHB和AMBA APB片上總線標(biāo)準。對Multi-layer總線結(jié)構(gòu)進行研究,分析了Multi-layer AHB系統(tǒng)中使用的Bus Matrix模塊的結(jié)構(gòu),從Bus Matrix模塊的內(nèi)部矩陣結(jié)構(gòu)和系統(tǒng)架構(gòu)兩方面針對系統(tǒng)的特點作出優(yōu)化。 最后介紹了論文采用的事物級模型與Verilog HDL協(xié)同仿真的方法和系統(tǒng)的控制過程,通過仿真結(jié)果的比較,驗證了利用二進制翻譯模塊實現(xiàn)X86指令執(zhí)行的可行性和優(yōu)化后的架構(gòu)較適合于X86翻譯系統(tǒng)的應(yīng)用。

    標(biāo)簽: ARM X86 SoC

    上傳時間: 2013-06-28

    上傳用戶:釣鰲牧馬

  • MATLAB

    matlab編程與應(yīng)用,非常實用和完整的工具書。希望大家能夠喜歡。-Matlab programming and application of practical and very complete

    標(biāo)簽: MATLAB

    上傳時間: 2013-07-03

    上傳用戶:66666

  • 效率85%的12v轉(zhuǎn)5v降壓轉(zhuǎn)換器

    This application note describes how the NCP3063 can be configured as a buck controller to drive an e

    標(biāo)簽: 12v 效率 降壓轉(zhuǎn)換器

    上傳時間: 2013-05-28

    上傳用戶:mslj2008

  • 干涉型光纖水聽器信號解調(diào)方法研究

    光纖水聽器自問世以來,在巨大的軍事價值和民用價值推動下得到了迅速發(fā)展,已逐漸從實驗室研究階段走向工程應(yīng)用。同時隨著光纖水聽器的不斷發(fā)展,對水聲信號的檢測技術(shù)以及數(shù)字處理能力也提出了新的要求。論文在此背景下開展了一系列研究工作,并提出了利用FPGA(Field ProgrammableGate Array,現(xiàn)場可編程門陣列)實現(xiàn)光纖3×3耦合器解調(diào)算法的新思路。 目前干涉型光纖水聽器的解調(diào)一般采用PGC(Phase Generated Carrier,相位生成載波技術(shù))技術(shù)和基于3×3光纖耦合器干涉的解調(diào)技術(shù)。PGC技術(shù)在解調(diào)過程中引入了載波信號,它對采樣率,激光器等的要求都較高,因此我們把目光投向3×3耦合器解調(diào)技術(shù),文中對其解調(diào)原理進行了闡述,對采樣率的確定進行了討論,并對3×3耦合器三路輸出不對稱的情況進行了分析,最后在本文的結(jié)論部分提出了基于3×3耦合器解調(diào)的改良方案。 目前,光纖信號數(shù)字化解調(diào)的硬件實現(xiàn)采用DSP(Digital Signal Process,可編程數(shù)字信號處理器)信號處理機,與之相比,F(xiàn)PGA解調(diào)具有速度快、資源占用少、易于擴展等優(yōu)勢。本文對FPGA與DSP、ASIC(application-specificintegrated circuit,專用集成電路)實現(xiàn)方案進行了對比,分析了適合利用FPGA實現(xiàn)的算法所應(yīng)具備的特征;介紹了3×3耦合器解調(diào)算法中各個模塊的設(shè)計情況;分析了系統(tǒng)的工作情況,硬件的構(gòu)造及芯片的選擇,最后驗證了利用FPGA可以實現(xiàn)3×3耦合器解調(diào)算法。

    標(biāo)簽: 干涉型 光纖水聽器 信號解調(diào) 方法研究

    上傳時間: 2013-07-03

    上傳用戶:love1314

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