是個(gè)能做復(fù)立葉轉(zhuǎn)換並將矩陣轉(zhuǎn)換成實(shí)部和虛部的部份~相當(dāng)?shù)姆奖?/p>
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上傳時(shí)間: 2016-12-09
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我自己寫的RGB與YCbCr(YUV)色彩格式轉(zhuǎn)換,可以RGB轉(zhuǎn)YCbCr或YCbCr轉(zhuǎn)RGB,並支持顯示轉(zhuǎn)換後的色彩功能.
標(biāo)簽: YCbCr RGB YUV 色彩
上傳時(shí)間: 2014-01-14
上傳用戶:edisonfather
十六位的除法器,采用verilog hdl
標(biāo)簽: 十六位 除法器
上傳時(shí)間: 2013-11-27
上傳用戶:kr770906
8位單片機(jī)實(shí)現(xiàn)十六位除法運(yùn)算,例如:51單片機(jī)實(shí)現(xiàn)算法
標(biāo)簽: 8位單片機(jī) 十六位 除法運(yùn)算
上傳時(shí)間: 2014-01-03
上傳用戶:evil
匯編設(shè)計(jì) 乘法指令 用十六位成一十六位 結(jié)果三十而位
標(biāo)簽: 十六位 匯編 乘法 指令
上傳時(shí)間: 2017-01-06
上傳用戶:kiklkook
基于CPLD/FPGA的十六位乘法器的VHDL實(shí)現(xiàn)
標(biāo)簽: CPLD FPGA VHDL 十六位
上傳時(shí)間: 2013-12-16
上傳用戶:qq1604324866
這是二十四進(jìn)制計(jì)數(shù)器的源程序,有需要的同學(xué)可以參照一下!
標(biāo)簽: 四進(jìn)制 計(jì)數(shù)器 源程序
上傳時(shí)間: 2017-01-20
上傳用戶:nairui21
FFT和IFFT的轉(zhuǎn)換,用VC語言編寫 FFT和IFFT的轉(zhuǎn)換,用VC語言編寫
標(biāo)簽: IFFT FFT
上傳時(shí)間: 2013-12-19
上傳用戶:yiwen213
設(shè)計(jì)一個(gè)能進(jìn)行時(shí)、分、秒計(jì)時(shí)的十二小時(shí)制或二十四小時(shí)制的數(shù)字鐘,并具有定時(shí)與鬧鐘功能,能在設(shè)定的時(shí)間發(fā)出鬧鈴音,能非常方便地對(duì)小時(shí)、分鐘和秒進(jìn)行手動(dòng)調(diào)節(jié)以校準(zhǔn)時(shí)間,每逢整點(diǎn),產(chǎn)生報(bào)時(shí)音報(bào)時(shí)。實(shí)驗(yàn)平臺(tái): 1. 一臺(tái)PC機(jī); 2. MAX+PLUSII10.1。 Verilog HDL語言實(shí)現(xiàn)
標(biāo)簽: 分 計(jì)時(shí) 數(shù)字
上傳時(shí)間: 2017-01-30
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《Windows網(wǎng)絡(luò)編程技術(shù)》附書源碼源碼. 運(yùn)行環(huán)境:9x/Me/NT/2000/XP/ 源碼語言:簡(jiǎn)體中文 第十六章 最后一章
標(biāo)簽: Windows 2000 源碼 Me
上傳時(shí)間: 2013-12-18
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