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Atm

自動取款機又稱Atm（AutomatedTellerMachine的縮寫），意思是自動柜員機，因大部分用于取款，又稱自動取款機。它是一種高度精密的機電一體化裝置，利用磁性代碼卡或智能卡實現(xiàn)金融交易的自助服務(wù)，代替銀行柜面人員的工作?？商崛‖F(xiàn)金、查詢存款余額、進行賬戶之間資金劃撥、余額查詢等工作；還可以進行現(xiàn)金存款（實時入賬）、支票存款（國內(nèi)無）、存折補登、中間業(yè)務(wù)等工作。持卡人可以使用信用卡或儲蓄卡，根據(jù)密碼辦理自動取款、查詢余額、轉(zhuǎn)賬、現(xiàn)金存款，存折補登，購買基金，更改密碼，繳納手機話費等業(yè)務(wù)。

  • Atm取款

    Atm簡易取款，可完成查詢、取款、存款等操作。 搜索 復(fù)制

    標(biāo)簽： Atm

    上傳時間： 2015-06-01

    上傳用戶：tingchong

  • Atm系統(tǒng)取款系統(tǒng)

    當(dāng)今時代是飛速發(fā)展的信息時代，使用計算機進行信息控制，不僅提高了工作效率，而且大大的提高了其安全性。尤其對于Atm復(fù)雜的信息管理，計算機能夠充分發(fā)揮它的優(yōu)越性。計算機進行信息管理與信息管理系統(tǒng)的開發(fā)密切相關(guān)，系統(tǒng)的開發(fā)是系統(tǒng)管理的前提。本系統(tǒng)就是為了管理好管理員和用戶的信息而設(shè)計的。

    標(biāo)簽： Atm 系統(tǒng)

    上傳時間： 2017-11-11

    上傳用戶：狂暴老戴

  • Atm機C++語言實現(xiàn)源碼

      用C++實現(xiàn)Atm機登陸系統(tǒng)

    標(biāo)簽： Atm機 C++ 源碼

    上傳時間： 2017-11-26

    上傳用戶：494958578

  • Atm機,C++實現(xiàn)

    用C++實現(xiàn)Atm機登陸系統(tǒng)，包含多個類，簡單易懂

    標(biāo)簽： Atm C++ 源碼

    上傳時間： 2017-11-26

    上傳用戶：494958578

  • 簡易Atm系統(tǒng)

    基于客戶端和服務(wù)端的Atm系統(tǒng)，具有查詢和一定的存款，取款功能。

    標(biāo)簽： Atm 系統(tǒng)

    上傳時間： 2017-12-24

    上傳用戶：AY13

  • JAVA-Atm觸屏

    java編寫的Atm觸屏，查詢余額、轉(zhuǎn)賬、修改密碼、取錢和存款功能。

    標(biāo)簽： JAVA-Atm 觸屏

    上傳時間： 2019-05-11

    上傳用戶：xsx65

  • Atm柜臺管理模擬程序

    TM柜員機模擬程序,其功能為： 當(dāng)輸入給定的卡號和密碼（初始卡號和密碼為123456）時，系統(tǒng)能登錄Atm柜員機系統(tǒng)，用戶可以進行： 1 查詢余額：初始余額為10000元 2 Atm取款：每次取款金額為100的倍數(shù)，總額不超過5000元，支取金額不允許透支。 3 Atm存款：不能出現(xiàn)負存款。 4 修改密碼：新密碼長度不小于6位，不允許出現(xiàn)6位完全相同的情況，只有舊密碼正確，新密碼符合要求，且兩次輸入相同的情況下才可以成功修改密碼。

    標(biāo)簽： Atm 模擬 程序

    上傳時間： 2021-12-07

    上傳用戶：18776564594

  • 模擬Atm(C++程序代碼)

    模擬Atm(C++程序代碼)，有需要的可以參考！

    標(biāo)簽： C++ Atm

    上傳時間： 2022-03-11

    上傳用戶：ttalli

  • 相關(guān)協(xié)議的FPGA和網(wǎng)絡(luò)處理器上的實現(xiàn)

    由于集成電路產(chǎn)業(yè)在中國的飛速發(fā)展,FPGA設(shè)計技術(shù),作為一種靈活性很強的芯片設(shè)計技術(shù),在國內(nèi)得到廣泛的應(yīng)用.由于芯片的可升級性和開發(fā)自主知識產(chǎn)權(quán)芯片的必要性,在北京郵電大學(xué)寬帶通信網(wǎng)絡(luò)實驗室開發(fā)的三層以太網(wǎng)交換機項目中,以太網(wǎng)口和Atm口之間的數(shù)據(jù)通道的實現(xiàn)上采用了FPGA設(shè)計方法.該文主要集中在Atm口之間的數(shù)據(jù)通道的HEC頭校驗的FPGA實現(xiàn).并完成了硬件設(shè)計、配置、硬件測試聯(lián)調(diào)工作以及論文撰寫工作.硬件的設(shè)計和開發(fā)基于Protel99和Tornado/VxWorks,軟件的設(shè)計和開發(fā)采用了標(biāo)準的VHDL語言,開發(fā)環(huán)境是WINDOWS,開發(fā)工具是Xilinx公司的iSE4.1i集成開發(fā)環(huán)境.隨著網(wǎng)絡(luò)設(shè)備的發(fā)展,位于網(wǎng)絡(luò)邊緣的設(shè)備將會變得更加靈巧,更加迎合網(wǎng)絡(luò)發(fā)展的需要,在網(wǎng)絡(luò)設(shè)備上越來越多地引入了網(wǎng)絡(luò)處理器.我們實驗室和Intel建立了聯(lián)合實驗室,在此基礎(chǔ)上,我們要把網(wǎng)絡(luò)處理器評估板硬件上,運行軟件,使其成為路由器,首先要加載的就是網(wǎng)絡(luò)路由協(xié)議.由于Linux的開放源代碼,所以我們決定采用Linux做嵌入式系統(tǒng),在上面運行zebra的路由協(xié)議.Zebra是linux上面的開放源代碼的路由軟件.

    標(biāo)簽： FPGA 協(xié)議 網(wǎng)絡(luò)處理器

    上傳時間： 2013-07-08

    上傳用戶：yhm_all

  • 用SignalTapII邏輯分析儀調(diào)試FPGA

    　SignalTap II 內(nèi)嵌邏輯分析儀是Altera 公司Quartus II 軟件中內(nèi)嵌的一種調(diào)試程序,通過把一段執(zhí)行邏輯分析功能 的代碼和客戶的設(shè)計組合在一起編譯、布局布線,完成傳統(tǒng)邏輯分析儀的功能。介紹了SignalTap II 的基本內(nèi)容、實現(xiàn)原理以及 在實際工程中的應(yīng)用環(huán)境。結(jié)合Atm交換矩陣的設(shè)計實例,詳細闡述了用SignalTapII 對FPGA 調(diào)試的具體方法和調(diào)試步驟, 以及在工程中的使用全過程。分析比較了該方法與傳統(tǒng)的外置式邏輯分析儀的優(yōu)劣,對SignalTap II 應(yīng)用條件進行了闡述。

    標(biāo)簽： SignalTapII FPGA 邏輯分析儀 調(diào)試

    上傳時間： 2013-07-13

    上傳用戶：古谷仁美

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