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CACHE

Caché,是一種后關系型數據庫。能并發訪問同一數據的數據庫技術。
  • 社區文章采用的是平板、樹形自由選擇的兩種展示方式

    社區文章采用的是平板、樹形自由選擇的兩種展示方式,社區整體布局采用左右分幀,這樣的結構更適合版面較多的網站使用! 社區支持無限級分類,左側工具欄靜態化再多的版面也不會影響速度。 大量的使用高性能緩存使得軟件在高并發下對數據庫的壓力降到最低!支持分布式CACHE! 軟件經過優秀的用戶體驗專家和交互設計師指點注重每一個細節的設計! DIV+CSS架構頁面,使得更換樣式變得異常簡單,讓網友瀏覽大數據量網頁沒有卡住的感覺! 細心的人會發現,我們在瀏覽器兼容方面所做的努力,社區99%以上的頁面是完全兼容IE、friefox、oprea等主流瀏覽器的!

    標簽: 平板 方式 自由選擇

    上傳時間: 2013-12-10

    上傳用戶:dongqiangqiang

  • 計算機體系結構實驗程序

    計算機體系結構實驗程序,分別采用FIFO與LRU算法實現CACHE塊的更新,功能更新過程中換入換出、命中等分步動態顯示。

    標簽: 計算機體系結構 實驗 程序

    上傳時間: 2013-12-25

    上傳用戶:從此走出陰霾

  • 基于visual dsp++開發環境

    基于visual dsp++開發環境,針對bf535處理器的硬件單元驅動源碼。包括audio,CACHE,fft,fir

    標簽: visual dsp 開發環境

    上傳時間: 2013-12-19

    上傳用戶:helmos

  • 基于visual dsp++開發環境

    基于visual dsp++開發環境,針對bf537處理器的硬件單元驅動源碼。包括ad/da,audio codec,booting,CACHE,can bus

    標簽: visual dsp 開發環境

    上傳時間: 2014-01-02

    上傳用戶:熊少鋒

  • Atmel’s AT91SAM7FP105 is a low pincount FingerChip processor based on the 32-bit ARM RISC processor

    Atmel’s AT91SAM7FP105 is a low pincount FingerChip processor based on the 32-bit ARM RISC processor. It features a on-chip biometric engine performing enrollment verification and identification, an internal record CACHE of up to 25 records and a secure command protocol over USB, SPI, UART. This protocol enables an external host system or processor to control the onchip bioengine functions, manipulate the record CACHE, and securely export record CACHE records for external storage. Together with the FingerChip sensor device AT77C104B, it forms an embedded, secured biometric turnkey solution.

    標簽: processor FingerChip pincount Atmel

    上傳時間: 2013-12-26

    上傳用戶:shawvi

  • 使用0.18um 標準 CMOS 的工藝設計

    使用0.18um 標準 CMOS 的工藝設計,內嵌ASIX CORE(32 位RISC 內核,兼容ARM720T,帶8KB 指令數 據CACHE 和全功能MMU),采用馮諾依曼結構

    標簽: 0.18 CMOS um 標準

    上傳時間: 2016-09-07

    上傳用戶:dengzb84

  • 龍芯處理器主要包括三個系列。龍芯1號處理器及其IP系列主要面向嵌入式應用

    龍芯處理器主要包括三個系列。龍芯1號處理器及其IP系列主要面向嵌入式應用,龍芯2號超標量處理器及其IP系列主要面向桌面應用,龍芯3號多核處理器系列主要面向服務器和高性能機應用。根據應用的需要,其中部分龍芯2號也可以面向部分高端嵌入式應用,部分低端龍芯3號也可以面向部分桌面應用。以后上述三個系列將并行地發展。 龍芯系列處理器通過充分開發指令級并行性、數據級并行性、以及線程級并行性來提高性能。其中龍芯1號系列微處理器實現了帶有靜態分支預測和阻塞CACHE的單發射的亂序執行流水線;龍芯2號系列微處理器實現了帶有動態分支預測和非阻塞CACHE的超標量四發射亂序執行流水線,龍芯2號系列微處理器還使用浮點數據通路復用技術實現了定點的單指令流多數據流指令;下一代的龍芯3號系列微處理器將實現片內多核技術。

    標簽: 龍芯處理器 龍芯1號 處理器 嵌入式應用

    上傳時間: 2016-10-16

    上傳用戶:xuanjie

  • The DHRY program performs the dhrystone benchmarks on the 8051. Dhrystone is a general-performanc

    The DHRY program performs the dhrystone benchmarks on the 8051. Dhrystone is a general-performance benchmark test originally developed by Reinhold Weicker in 1984. This benchmark is used to measure and compare the performance of different computers or, in this case, the efficiency of the code generated for the same computer by different compilers. The test reports general performance in dhrystones per second. Like most benchmark programs, dhrystone consists of standard code and concentrates on string handling. It uses no floating-point operations. It is heavily influenced by hardware and software design, compiler and linker options, code optimizing, CACHE memory, wait states, and integer data types. The DHRY program is available in different targets: Simulator: Large Model: DHRY example in LARGE model for Simulation Philips 80C51MX: DHRY example in LARGE model for the Philips 80C51MC

    標簽: general-performanc benchmarks Dhrystone dhrystone

    上傳時間: 2016-11-30

    上傳用戶:hphh

  • 這是學ARM9和ADS1.2的一個很好的例程

    這是學ARM9和ADS1.2的一個很好的例程,這個例程簡單易懂。 這個例程可以用開發板是的LED燈和仿真器來測試硬件的好壞, 還可以CACHE對程序運行速度的影響,測試設置FCLK的頻率。

    標簽: ARM9 ADS 1.2

    上傳時間: 2016-12-16

    上傳用戶:水中浮云

  • 凌陽SPCE3200 系統開發板隨機自帶源程序。共安排了32個子目錄

    凌陽SPCE3200 系統開發板隨機自帶源程序。共安排了32個子目錄,其中按照SPCE3200實驗指導書(上冊)中的實驗順序存放了實驗程序的源代碼,所有項目代碼均在S+coreIDE v2.1.2下測試通過。此為第16到第23個試驗源代碼。試驗內容如下: 5.3 實驗十六:CACHE 讀寫實驗. 5.4 實驗十七:DMA讀寫實驗 5.5 實驗十八:SD卡讀取實驗 SPCE3200教學平臺通信模塊實驗 6.1 實驗十九:SPI通信實驗 6.2 實驗二十:I2C通信實驗. 6.3 實驗二十一:UART異步串行口通訊實驗 6.4 實驗二十二:USB DEVICE實驗 6.5 實驗二十三:USB HOST 實驗

    標簽: SPCE 3200 凌陽

    上傳時間: 2014-12-05

    上傳用戶:thinode

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