基于FPGA的DDS和周期合成技術(shù)在EIS中的應(yīng)用,caj格式
標(biāo)簽： FPGA DDS EIS caj
上傳時(shí)間： 2013-08-26
上傳用戶(hù)：lhll918
文檔是關(guān)于自適應(yīng)信號(hào)處理算法研究及FPGA實(shí)現(xiàn)的文章，
標(biāo)簽： FPGA 文檔 信號(hào)處理 算法研究
上傳時(shí)間： 2013-08-27
上傳用戶(hù)：Maple
ACTEL A3P StartKit FPGA開(kāi)發(fā)全套文擋（含測(cè)試源碼）
標(biāo)簽： StartKit ACTEL FPGA A3P
上傳時(shí)間： 2013-08-28
上傳用戶(hù)：litianchu
學(xué)習(xí)FPGA CPLD的入門(mén)文檔，比較適合初學(xué)者
標(biāo)簽： FPGA CPLD 文檔
上傳時(shí)間： 2013-08-30
上傳用戶(hù)：hui626493
基于FPGA的直接數(shù)字合成器的設(shè)計(jì)與分析的代碼程序,代碼格式為VHDL
標(biāo)簽： FPGA VHDL 代碼 直接數(shù)字合成器
上傳時(shí)間： 2013-09-02
上傳用戶(hù)：ifree2016
這是一個(gè)關(guān)于FPGA使用的文檔，對(duì)于硬件開(kāi)發(fā)很有幫助
標(biāo)簽： FPGA 文檔
上傳用戶(hù)：euroford
該文闡述了現(xiàn)場(chǎng)可編程邏輯器件FPGA的主要特點(diǎn)，應(yīng)用FPGA芯片和VHDL硬件描述語(yǔ)言設(shè)計(jì)的模擬示波器數(shù)字信號(hào)顯示系統(tǒng)的設(shè)計(jì)原理和設(shè)計(jì)方法。
標(biāo)簽： FPGA 現(xiàn)場(chǎng)可編程 邏輯器件
上傳時(shí)間： 2013-09-04
上傳用戶(hù)：qweqweqwe
TMS320F2812原理圖庫(kù)文件（allegro格式）
標(biāo)簽： allegro F2812 2812 320F
上傳時(shí)間： 2013-09-06
上傳用戶(hù)：杜瑩12345
allegro學(xué)習(xí)的PDF文檔，allegro學(xué)習(xí)的PDF文檔
標(biāo)簽： allegro 文檔
上傳用戶(hù)：南國(guó)時(shí)代
Allegro中關(guān)于XNet的等長(zhǎng)設(shè)置,為PDF格式，方便大家下載使用
標(biāo)簽： Allegro XNet 等長(zhǎng)設(shè)置
上傳用戶(hù)：thing20
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