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CISC

  • 一個(gè)8位CISC結(jié)構(gòu)的精簡CPU

    一個(gè)8位CISC結(jié)構(gòu)的精簡CPU,2還提供了編譯器

    標(biāo)簽: CISC CPU 8位

    上傳時(shí)間: 2013-12-28

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  • CISCo網(wǎng)絡(luò)路由器dynamips的模擬器幫助文件!CISC o網(wǎng)絡(luò)路由器dynamips的模擬器幫助文件!CISCo網(wǎng)絡(luò)路由器dynamips的模擬器幫助文件!

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    標(biāo)簽: dynamips CISCo CISC 網(wǎng)絡(luò)

    上傳時(shí)間: 2016-09-19

    上傳用戶:fhzm5658

  • 基于VHDL語言的設(shè)計(jì)8位CISC微處理器實(shí)例

    基于VHDL語言的設(shè)計(jì)8位CISC微處理器實(shí)例

    標(biāo)簽: VHDL CISC 8位 語言

    上傳時(shí)間: 2013-12-20

    上傳用戶:ryb

  • 基于FPGA的MCS51核的VHDL語言設(shè)計(jì)與實(shí)現(xiàn).rar

    本文以研究嵌入式微處理器為主,自主地設(shè)計(jì)了能夠運(yùn)行MCS-51系列單片機(jī)指令的MCU系統(tǒng)。系統(tǒng)采用了VHDL 語言與原理框圖的綜合設(shè)計(jì)方法,并且在Altera公司的FPGA上通過驗(yàn)證。論文深入地研究了微處理器的指令系統(tǒng)和數(shù)據(jù)地址通路,采用VHDL 語言完成了取指單元,指令譯碼器單元,存儲器單元和邏輯運(yùn)算單元的電路模塊的設(shè)計(jì)與實(shí)現(xiàn);研究了控制單元的實(shí)現(xiàn)方法和基于全局狀態(tài)機(jī)的設(shè)計(jì)理論,采用硬件描述語言完成了對各個(gè)控制線的相關(guān)設(shè)計(jì)與實(shí)現(xiàn)。論文通過原理示意圖和示例代碼的演示,著重介紹了指令譯碼器的實(shí)現(xiàn)方式,基于此種方式形成的譯碼電路還能夠?qū)崿F(xiàn)更為復(fù)雜的CISC指令。 本系統(tǒng)采用分模塊的設(shè)計(jì)方式,把具有相同功能的邏輯電路集中到一個(gè)框圖里,使得系統(tǒng)的可移植性大大地提高。系統(tǒng)還采用層次框圖的設(shè)計(jì)方式,把明顯地具有主從關(guān)系的電路放在不同的層次里,這也使得系統(tǒng)模塊功能的可擴(kuò)展性大大地增強(qiáng)。內(nèi)部邏輯共分為數(shù)據(jù)存儲器模塊;程序存儲器模塊;時(shí)序控制模塊;特殊功能寄存器模塊和Core核心模塊這五個(gè)部分,文中對各個(gè)模塊的設(shè)計(jì)作了詳細(xì)的介紹。本文在最后對已實(shí)現(xiàn)的部分典型指令進(jìn)行了邏輯仿真測試,測試結(jié)果表明,本文所設(shè)計(jì)的MCU系統(tǒng)能夠如預(yù)期地執(zhí)行相應(yīng)的指令。在指令執(zhí)行的過程中,相應(yīng)寄存器和總線上的值也均符合設(shè)計(jì)要求,實(shí)現(xiàn)了設(shè)計(jì)目標(biāo)。

    標(biāo)簽: FPGA VHDL MCS

    上傳時(shí)間: 2013-05-20

    上傳用戶:2525775

  • 基于FPGA的Java虛擬機(jī)實(shí)現(xiàn)

    使用Java語言有非常多的好處,如安全的對象引用、語言級支持多線程和跨平臺等特性。但是嵌入式系統(tǒng)中Java語言的應(yīng)用卻很少見,這是由于Java如下兩方面的不足: (1)Java虛擬機(jī)實(shí)現(xiàn)需要大量的硬件資源;(2)Java語言的運(yùn)行時(shí)間不可預(yù)測。 為此,本論文將實(shí)現(xiàn)一個(gè)能夠應(yīng)用在低端FPGA器件的實(shí)時(shí)Java虛擬機(jī)。論文的主要?jiǎng)?chuàng)新點(diǎn)如下: 1.使用基于堆棧的RISC模型處理器實(shí)現(xiàn)CISC模型的JVM; 2.處理器微指令無任何相關(guān)性; 3.所設(shè)計(jì)的JVM能使Java程序擁有足夠的底層訪問能力。 論文的主要內(nèi)容和工作如下: 1.制定基于堆棧的RISC結(jié)構(gòu)處理器各級結(jié)構(gòu)。 2.設(shè)計(jì)簡潔高效的處理器微指令,并且微指令能夠滿足字節(jié)碼的需要。 3.制定Java字節(jié)碼到處理器代碼的轉(zhuǎn)換關(guān)系和快速轉(zhuǎn)換結(jié)構(gòu)。 4.設(shè)計(jì)中使用高速緩存,提高運(yùn)行速度。 5.優(yōu)化堆棧的硬件結(jié)構(gòu),使得出棧入棧操作更加簡潔快速。 6.設(shè)計(jì)一系列的本地方法,使得Java程序能夠直接訪問底層資源。 7.將Java類庫使用本地方法實(shí)現(xiàn)。 8.自定義程序在內(nèi)存中的結(jié)構(gòu),并使用裝載工具實(shí)現(xiàn)。 9.制定處理外圍數(shù)據(jù)處理機(jī)制,如IO和內(nèi)存接口10.制定中斷處理方式,并且實(shí)現(xiàn)軟中斷的機(jī)制。

    標(biāo)簽: FPGA Java 虛擬機(jī)

    上傳時(shí)間: 2013-06-11

    上傳用戶:417313137

  • 基于FPGA的MCS51核的VHDL語言

    本文以研究嵌入式微處理器為主,自主地設(shè)計(jì)了能夠運(yùn)行MCS-51系列單片機(jī)指令的MCU系統(tǒng)。系統(tǒng)采用了VHDL 語言與原理框圖的綜合設(shè)計(jì)方法,并且在Altera公司的FPGA上通過驗(yàn)證。論文深入地研究了微處理器的指令系統(tǒng)和數(shù)據(jù)地址通路,采用VHDL 語言完成了取指單元,指令譯碼器單元,存儲器單元和邏輯運(yùn)算單元的電路模塊的設(shè)計(jì)與實(shí)現(xiàn);研究了控制單元的實(shí)現(xiàn)方法和基于全局狀態(tài)機(jī)的設(shè)計(jì)理論,采用硬件描述語言完成了對各個(gè)控制線的相關(guān)設(shè)計(jì)與實(shí)現(xiàn)。論文通過原理示意圖和示例代碼的演示,著重介紹了指令譯碼器的實(shí)現(xiàn)方式,基于此種方式形成的譯碼電路還能夠?qū)崿F(xiàn)更為復(fù)雜的CISC指令。 本系統(tǒng)采用分模塊的設(shè)計(jì)方式,把具有相同功能的邏輯電路集中到一個(gè)框圖里,使得系統(tǒng)的可移植性大大地提高。系統(tǒng)還采用層次框圖的設(shè)計(jì)方式,把明顯地具有主從關(guān)系的電路放在不同的層次里,這也使得系統(tǒng)模塊功能的可擴(kuò)展性大大地增強(qiáng)。內(nèi)部邏輯共分為數(shù)據(jù)存儲器模塊;程序存儲器模塊;時(shí)序控制模塊;特殊功能寄存器模塊和Core核心模塊這五個(gè)部分,文中對各個(gè)模塊的設(shè)計(jì)作了詳細(xì)的介紹。本文在最后對已實(shí)現(xiàn)的部分典型指令進(jìn)行了邏輯仿真測試,測試結(jié)果表明,本文所設(shè)計(jì)的MCU系統(tǒng)能夠如預(yù)期地執(zhí)行相應(yīng)的指令。在指令執(zhí)行的過程中,相應(yīng)寄存器和總線上的值也均符合設(shè)計(jì)要求,實(shí)現(xiàn)了設(shè)計(jì)目標(biāo)。

    標(biāo)簽: FPGA VHDL MCS 51

    上傳時(shí)間: 2013-06-05

    上傳用戶:金宜

  • 瑞薩電子基于RX62T單片機(jī)的PMSM電機(jī)位置控制

      瑞薩電子基于RX62T單片機(jī)的PMSM電機(jī)位置控制英文資料:RX62T基于RX CPU架構(gòu),集成了增強(qiáng)的定時(shí)器單元(MTU3、GPT)、12位AD轉(zhuǎn)換器(1μs轉(zhuǎn)換時(shí)間),每個(gè)AD轉(zhuǎn)換單元還集成可調(diào)增益運(yùn)放和窗口比較器,適用于各種電機(jī)控制和變頻器應(yīng)用。最近瑞薩電子推出先進(jìn)電機(jī)控制算法,其關(guān)鍵技術(shù)包括高級脈沖幅值調(diào)制技術(shù)、先進(jìn)的電動(dòng)機(jī)驅(qū)動(dòng)技術(shù)等?;赗X62T高性能32位CISC MCU,使用瑞薩先進(jìn)電機(jī)控制算法實(shí)現(xiàn)空調(diào)壓縮機(jī)控制時(shí),可以實(shí)現(xiàn)如下系統(tǒng)規(guī)格:適用空調(diào)器制冷量范圍《8000W,低頻振動(dòng)最高振幅《300μm,壓縮機(jī)轉(zhuǎn)速范圍為1~150rps,功率因數(shù)額定工況》0.9,滿載高達(dá)100%,調(diào)制度《200%,電流檢測方式為單電阻檢測。它不但可以提供業(yè)界最精簡的BOM,還可以在不增加BOM成本的情況下實(shí)現(xiàn)更多的功能。

    標(biāo)簽: PMSM 62T RX 62

    上傳時(shí)間: 2013-10-20

    上傳用戶:ve3344

  • 8位OTP單片機(jī)芯片MC10P23XXY管腳與三星9454完

    主要特點(diǎn)管腳完全與三星9454兼容8位CISC型內(nèi)核(MC05)4K byte OTP ROM208 byte RAM3組IO口(最多可支持17個(gè)通用IO口和1個(gè)輸入口)1個(gè)PWM輸出1個(gè)8位基本定時(shí)器1個(gè)8位帶比較輸出的定時(shí)器1個(gè)10位ADC(9路輸入)2個(gè)外中斷、1個(gè)定時(shí)器中斷、1個(gè)PWM中斷看門狗復(fù)位功能3V低壓復(fù)位可選晶振/RC振蕩晶振400K-8MHzRC振蕩有3.2MHz(@5V,typ.)、8MHz(@5V,typ.)、外接電阻電容3種可選

    標(biāo)簽: 9454 10P OTP P23

    上傳時(shí)間: 2013-11-05

    上傳用戶:Jerry_Chow

  • 8位OTP單片機(jī)芯片BL35P02R

    概述 BL35P02R是一款低功耗8位OTP型微控制器單元(MCU),并帶有內(nèi)置高精度振蕩器,及一個(gè)可直接驅(qū)動(dòng)紅外發(fā)射管的遙控碼輸出口,適用于各類家電(如電視、VCD機(jī)等)的紅外遙控器。 主要特點(diǎn) 8位CISC結(jié)構(gòu)CPU(MotorolaHC05兼容)最多可支持16個(gè)通用IO口和1個(gè)輸入口1個(gè)8位定時(shí)/計(jì)數(shù)器9路鍵盤中斷(KBI)1路遙控碼輸出口(IROUT),8種載波頻率可選(1/3占空比),驅(qū)動(dòng)能力強(qiáng)(>300mA)外接晶振325K-8MHz/內(nèi)置RC振蕩4MHz(偏差≤5%,0-40℃,2.0-3.6V工作電壓范圍內(nèi))低功耗設(shè)計(jì)(待機(jī)功耗<1uA@3V)32byteRAM(含堆棧)2K*8bitOTPROMOTP數(shù)據(jù)加密功能工作電壓2.0-5.5V封裝形式:SOP20(300mil)/SOP18(300mil)/SOP16(150mil)

    標(biāo)簽: 02R 35P OTP P02

    上傳時(shí)間: 2013-10-12

    上傳用戶:z240529971

  • 8位OTP單片機(jī)芯片BL22P02

    概述 BL22P02是一款低功耗8位OTP型微控制器單元(MCU),適用于各類小家電控制。 主要特點(diǎn) 8位CISC結(jié)構(gòu)CPU(Motorola HC05兼容)17個(gè)通用IO口8位實(shí)時(shí)定時(shí)器/計(jì)數(shù)器,其信號源和觸發(fā)沿可由軟件設(shè)定,可設(shè)置溢出中斷7路鍵盤中斷(KBI)2路外中斷(INT)振蕩模式晶振:32K晶振:432K-8MHz內(nèi)部RC:2MHz@5V、4MHz@5V、6MHz@5V外接電阻低功耗設(shè)計(jì)(靜態(tài)功耗<1uA@5V)內(nèi)部自振式看門狗計(jì)數(shù)器(WDT)64byteRAM2K*8bitOTPROM串行燒寫接口電路程序加密功能工作電壓2.0-5.5V@(432K-4M)2.7-5.5V@(432K-8M)封裝形式:DIP20、SOP20、DIP18、SOP18、DIP16、SOP16、DIP14、SOP14、DIP8、SOP8

    標(biāo)簽: 22P OTP P02 22

    上傳時(shí)間: 2013-10-15

    上傳用戶:佳期如夢

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