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Cyclone,Altera,F(xiàn)PGA,生產(chǎn)

  • 基于FPGA的無線信道仿真器設計與實現

    隨著人們對無線通信需求和質量的要求越來越高,無線通信設備的研發也變得越來越復雜,系統測試在整個設備研發過程中所占的比重也越來越大。為了能夠盡快縮短研發周期,測試人員需要在實驗室模擬出無線信道的各種傳播特性,以便對所設計的系統進行調試與測試。無線信道仿真器是進行無線通信系統硬件調試與測試不可或缺的儀器之一。 本文設計的無線信道仿真器是以Clarke信道模型為參考,采用基于Jakes模型的改進算法,使用Altera公司的StratixⅡ EP2S180模擬實現了頻率選擇性衰落信道。信道仿真器實現了四根天線數據的上行接收,每根天線由八條可分辨路徑,每條可分辨路徑由64個反射體構成,每根天線可分辨路徑和反射體的數目可以獨立配置。通過對每個反射體初始角度和初始相位的設置,并且保證反射體的角度和相位是均勻分布的隨機數,可以使得同一條路徑不同反射體之間的非相關特性,得到的多徑傳播信道是一個離散的廣義平穩非相關散射模型(WSSUS)。無線信道仿真器模擬了上行數據傳輸環境,上行數據由后臺產生后儲存在單板上的SDRAM中。啟動測試之后,上行數據在CPU的控制下通過信道仿真器,然后送達基帶處理板解調,最后測試數據的誤碼率和誤塊率,從而分析基站的上行接收性能。 首先,本文研究了3GPP TS 25.141協議中對通信設備測試的要求和無線信道自身的特點,完成了對無線信道仿真器系統設計方案的吸收和修改。 其次,針對FPGA內部資源結構,研究了信道仿真器FPGA實現過程中的困難和資源的消耗,進行了模塊劃分。主要完成了時延模塊、瑞利衰落模塊、背板接口模塊等的RTL級代碼的開發、仿真、綜合和板上調試;完成了FPGA和后臺軟件的聯合調試;完成了兩天線到四天線的改版工作,使FPGA內部的工作頻率翻了一倍,大幅降低了FPGA資源的消耗。 最后,在完成無線信道仿真器的硬件設計之后,對無線信道仿真器的測試根據3GPP TS 25.141 V6.13.0協議中的要求進行,即在數據誤塊率(BLER)一定的情況下,對不同信道傳播環境和不同傳輸業務下的信噪比(Eb/No)進行測試,單天線和多天線的測試結果符合協議中規定的信噪比(Eb/No)的要求。

    標簽: FPGA 無線信道 仿真器

    上傳時間: 2013-04-24

    上傳用戶:小楊高1

  • 基于可重配置的OFDM基帶系統的FPGA設計

    1992年5月,JoeMitola首次明確提出了軟件無線電的概念。軟件無線電將模塊化、標準化的硬件單元連接構成硬件平臺,通過軟件加載實現各種無線通信功能。端到端重配置技術是在軟件無線電的基礎上發展起來的,該技術使通信系統不僅具有重配置的能力,還能提供一體化的重配置管理架構,實現聯合無線資源管理和網絡規劃。端到端重配置技術已經成為軟件無線電的發展趨勢。 寬帶無線接入(BWA,BroadbandWirelessAccess)是當前通信界研究的熱點之一,而WiMax和WiFi是BWA中最熱門的兩個技術,所以本文選擇了IEEE802.16-2004與IEEE802.11a,設計了基于其物理層標準的可重配置OFDM基帶系統。它們均采用正交頻分復用技術(OFDM,OrthogonalFrequencyDivisionMultiplexing)。 本文研究了IEEE802.16-2004與IEEE802.11a物理層標準,結合Altera公司提供的FPGA開發工具QuartusⅡ、Mentor公司仿真工具ModelsimSE6.0,完成了基于IEEE802.16-2004及IEEE802.11a的可重配置OFDM基帶系統的FPGA設計。該設計中,對FPGA進行重新配置,實現了802.16-2004與802.11a兩種技術的完全重配置;通過選擇不同的參數來調用不同子模塊,實現802.16-2004與802.11a內部不同調制技術的局部重配置。該可重配置基帶系統核心的FFT/IFFT。模塊采用基4按頻率抽取及Cordic算法,消除乘法運算,有利于FPGA實現;在802.16-2004系統中,選取了基于前導序列的符號同步算法,在FPGA中實現。最后使用開發軟件、綜合軟件以及仿真軟件分析了系統的性能并給出了系統的性能指標。

    標簽: OFDM FPGA 可重配置 基帶系統

    上傳時間: 2013-05-19

    上傳用戶:branblackson

  • MAX+PLUSII 10.230

    Max+plusⅡ是Altera公司提供的FPGA/CPLD開發集成環境,Altera是世界上最大可編程邏輯器件的供應商之一。Max+plusⅡ界面友好,使用便捷,被譽為業界最易用易學的EDA軟件。在Max+plusⅡ上可以完成設計輸入、元件適配、時序仿真和功能仿真、編程下載整個流程,它提供了一種與結構無關的設計環境,是設計者能方便地進行設計輸入、快速處理和器件編程。

    標簽: 10.230 PLUSII MAX

    上傳時間: 2013-07-31

    上傳用戶:小強mmmm

  • MAX+PLUS II Advanced Synthsis 10.230

    MAX+PLUS II Advanced Synthsis ALtera的一個免費HDL綜合工具,安裝后可以直接使用,是MaxplusII的一個插件,用這個插件進行語言綜合,比直接使用MaxplusII綜合的效果好

    標簽: Advanced Synthsis 10.230 PLUS

    上傳時間: 2013-05-27

    上傳用戶:feichengweoayauya

  • NIOSII IDE_5_00

    "Nios II軟件構建工具開發環境是一組功能強大的命令、工具以及腳本,利用它們可以管理應用程序、電路板支持包(BSP)和軟件庫的編譯選項。命令在Nios II軟件構建工具上可以獨立于Nios II IDE而運行。如果你偏愛于使用命令行環境,或者你想獲得能夠快速適應你所喜歡的軟件(或系統)開發環境的開發工具,Altera公司建議使用這個開發平臺。Nios II軟件構建工具是Altera公司未來開發工具的基礎。"

    標簽: NIOSII IDE 00

    上傳時間: 2013-05-17

    上傳用戶:WsyzxxnSej

  • 基于FPGA的CCD探測系統

    隨著圖像采集系統的廣泛應用,人們對CCD探測系統的要求日益提高。傳統的CCD探測系統由于結構復雜,造價較高,己不能滿足日益廣泛的應用需要。本文設計了一套基于單片FPGA的小型化與經濟化的CCD探測系統,能夠滿足空間光強的測量并實現光信號的識別和處理。    本文研究了CCD探測系統的基本結構。設計了基于單片FPGA的CCD探測系統的硬件電路原理圖,完成了硬件電路板制作與調試。系統FPGA選用Altera公司的低成本FPGA芯片EP2C20Q240,電路板采用雙層板設計,實現了CCD探測系統的小型化與經濟化的目標。利用FPGA器件實現了CCD驅動時序脈沖的設計、實現了單采樣與相關雙采樣的控制程序設計,利用FPGA的數字信號處理功能實現了相關雙采樣的信號處理。基于FPGA的可編程特性,在不改變外部電路的基礎上,通過程序的改變,對CCD驅動頻率、模數轉換器采樣時刻的選擇進行方便調節。系統與上位機的數據傳輸接口采用了網絡傳輸方案,充分發揮了網絡傳輸的遠距離傳輸、遠程訪問、信息共享等優勢,系統采用基于FPGA的NiosⅡ嵌入式處理器系統,通過對其應用軟件的開發,實現了系統與上位機之間數據的可靠性傳輸。

    標簽: FPGA CCD 探測系統

    上傳時間: 2013-08-06

    上傳用戶:hainan_256

  • 神經網絡PID飛行控制算法的FPGA實現

    神經網絡控制算法作為一種比較成熟的智能控制算法,在空空導彈的理論研究中也得到了很多應用,但它的實際應用通常是通過軟件實現的,而軟件實現是串行執行指令,運行速度慢,可靠性低,很難滿足實際導彈制導系統實時性的要求。控制算法硬件實現的最大特點就是可提高控制算法的實時運算速度和可靠性。本課題針對導彈制導系統,以FPGA為硬件平臺研究神經網絡控制算法的硬件實現。本文首先對BP神經網絡算法思想進行了深入分析,并對BP網絡的各個階段進行了理論推導,最后對BP神經網絡PID飛行控制算法進行了研究和總結,為硬件實現提供了理論基礎。基于對上述理論的深入研究和分析,本文提出了一種適合FPGA實現該神經網絡控制算法的硬件實現模型。在該模型中,神經網絡各層之間采用串行執行數據方式,層間則采用并行運行方式,可有效提高系統的運算速度。由于模塊化、層次化的自頂向下的模塊化設計方法可有效減少錯誤的產生,是設計復雜大規模系統的理想設計方法。本文采用了此設計方法,通過把系統模塊化,對各個子模塊分別用VHDL硬件描述語言進行描述,并基于QUARTUS II軟件開發平臺進行綜合和仿真,直到達到研究設計要求。最后將仿真程序源代碼下載配置到具體的Cyclone II系列EP2C70 FPGA芯片中,應用于某實際導彈控制系統的研究。理論分析和實驗結果表明該神經網絡飛行控制算法的FPGA硬件實現是有效可行的,可滿足系統實時性的要求,為制導系統的實際工程實現提供了基礎。

    標簽: FPGA PID 神經網絡 飛行控制

    上傳時間: 2013-04-24

    上傳用戶:冇尾飛鉈

  • Quartus_II_9.0破解器.rar

    #首先安裝Quartus II 9.0 (32-Bit): #用Quartus_II_9.0破解器.exe破解C:\altera\90\quartus\bin下的sys_cpt.dll和quartus.exe文件(運行Quartus_II_9.0破解器.exe后,直接點擊“應用補丁”,如果出現“未找到該文件。搜索該文件嗎?”,點擊“是”,(如果直接把該破解器Copy到C:\altera\90\quartus\bin下,就不會出現這個對話框,而是直接開始破解!)然后選中sys_cpt.dll,點擊“打開”。安裝默認的sys_cpt.dll路徑是在C:\altera\90\quartus\bin下)。 #把license.dat里的XXXXXXXXXXXX 用您老的網卡號替換(在Quartus II 9.0的Tools菜單下選擇License Setup,下面就有NIC ID)。 #在Quartus II 9.0的Tools菜單下選擇License Setup,然后選擇License file,最后點擊OK。 #注意:license文件存放的路徑名稱不能包含漢字和空格,空格可以用下劃線代替。 #僅限于學習,不要用于商業目的! 嚴禁貼到網上!!!

    標簽: Quartus_II 9.0 破解

    上傳時間: 2013-04-24

    上傳用戶:zhuoying119

  • FPGA開發光盤各章節實例的設計工程與源碼

    附錄 光盤說明\r\n本書附贈的光盤包括各章節實例的設計工程與源碼,所有工程在下列軟件環境下運行通過:\r\n? Windows XP SP2\r\n? MATLAB\r\n? Altera Quartus II \r\n? synplify8.4\r\n? modelsim_ae6.1\r\n\r\n光盤目錄與實例名稱的對應關系如下:\r\n\r\n cht02文件夾中存放的是書中第2章中的例子,讀者可以將一些簡單例子的代碼 \r\n拷貝到MATLAB命令窗口進行運行,也可以把

    標簽: FPGA 發光 工程 源碼

    上傳時間: 2013-08-11

    上傳用戶:ecooo

  • Quartus_II_11.0_x86破解器下載

    Quartus_II_11.0_x86破解器下載方法: 首先安裝Quartus II 11.0軟件(默認是32/64-Bit一起安裝): 用Quartus_II_11.0_x86破解器(內部版).exe破解C:\altera\11.0\quartus\bin下的sys_cpt.dll文件(運行Quartus_II_11.0_x86破解器(內部版).exe后,直接點擊“應用補丁”,如果出現“未找到該文件。搜索該文件嗎?”,點擊“是”,(如果直接把該破解器Copy到C:\altera\11.0\quartus\bin下,就不會出現這個對話框,而是直接開始破解!)然后選中sys_cpt.dll,點擊“打開”。安裝默認的sys_cpt.dll路徑是在C:\altera\11.0\quartus\bin下)。 把license.dat里的XXXXXXXXXXXX 用您老的網卡號替換(在Quartus II 11.0的Tools菜單下選擇License Setup,下面就有NIC ID)。 在Quartus II 11.0的Tools菜單下選擇License Setup,然后選擇License file,最后點擊OK。 注意:license文件存放的路徑名稱不能包含漢字和空格,空格可以用下劃線代替。 此軟件已經通過了諾頓測試,在其它某些殺毒軟件下,也許被誤認為是“病毒”,這是殺毒軟件智能化程度不夠的原因,所以只能暫時關閉之。

    標簽: Quartus_II 11.0 86 破解

    上傳時間: 2013-11-01

    上傳用戶:hebmuljb

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