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DA轉(zhuǎn)(zhuǎn)換器

sin產(chǎn)生器

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將VHDL設(shè)計(jì)轉(zhuǎn)換成Verilog設(shè)計(jì)的程式

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DPLL由鑒相器模K加減計(jì)數(shù)器脈沖加減電路同步建立偵察電路模N分頻器構(gòu)成. 整個(gè)系統(tǒng)的中心頻率(即signal_in和signal_out的碼速率的2倍) 為clk/8/N. 模K

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sigma-delta ADC轉(zhuǎn)換之matlab模型

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一、實(shí)驗(yàn)?zāi)康? 了解數(shù)/模轉(zhuǎn)換器的基本原理

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設(shè)計(jì)一個(gè)一元稀疏多項(xiàng)式簡單計(jì)算機(jī)器 1. 本演示程序中

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步進(jìn)馬達(dá)控制器的編程方法

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資料壓縮的原理與應(yīng)用二維8×8DCT轉(zhuǎn)換的C程式

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資料壓縮的原理與應(yīng)用二階段式小波轉(zhuǎn)換的C程式

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OPC工具包是用來簡化OPC規(guī)范服務(wù)器/客戶端開發(fā)的工具包

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