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DAB

  • 本源碼是在DAB系統(tǒng)中MPE封裝開銷的源代碼。希望對(duì)大家有用。

    本源碼是在DAB系統(tǒng)中MPE封裝開銷的源代碼。希望對(duì)大家有用。

    標(biāo)簽: DAB MPE 源碼 封裝

    上傳時(shí)間: 2016-08-27

    上傳用戶:qw12

  • 最新的DAB、DVB歐洲標(biāo)準(zhǔn)

    最新的DAB、DVB歐洲標(biāo)準(zhǔn),版本分別為1.4 和1.5

    標(biāo)簽: DAB DVB 標(biāo)準(zhǔn)

    上傳時(shí)間: 2014-06-14

    上傳用戶:shus521

  • datapath_fifo used in DMA contect PCI in the DAB system the format of this file is VHDL

    datapath_fifo used in DMA contect PCI in the DAB system the format of this file is VHDL

    標(biāo)簽: datapath_fifo the contect format

    上傳時(shí)間: 2014-01-16

    上傳用戶:skfreeman

  • DAB transmitter, synchronization and receiver under development

    DAB transmitter, synchronization and receiver under development

    標(biāo)簽: synchronization transmitter development receiver

    上傳時(shí)間: 2017-07-01

    上傳用戶:ma1301115706

  • 基于FPGA的DAB信道編碼器輸入接口的設(shè)計(jì)與實(shí)現(xiàn)

    電臺(tái)廣播在我們的社會(huì)生活中占有重要的地位。隨著我國(guó)廣播事業(yè)的發(fā)展,對(duì)我國(guó)廣播業(yè)開發(fā)技術(shù)、信號(hào)的傳輸質(zhì)量和速度提出了更高更新的要求,促使廣播科研人員不斷更新現(xiàn)有技術(shù),以滿足人民群眾日益增長(zhǎng)的需求。 本論文主要分析了現(xiàn)行廣播發(fā)射臺(tái)的數(shù)字廣播激勵(lì)器輸入接口的不足之處,根據(jù)歐洲ETS300799標(biāo)準(zhǔn),實(shí)現(xiàn)了一種激勵(lì)器輸入接口的解決方案,這種方案將復(fù)接器送來(lái)的ETI(NA,G704)格式的碼流轉(zhuǎn)換成符合ETS300799標(biāo)準(zhǔn)ETI(NI)的標(biāo)準(zhǔn)碼流,并送往后面的信道編碼器。ETI(NA,G704)格式與現(xiàn)行的ETI(NI,G703)格式相比,主要加入了交織和RS糾錯(cuò)編碼,使得信號(hào)抗干擾能力大大加強(qiáng),提高了節(jié)目從演播室到發(fā)射臺(tái)的傳輸質(zhì)量,特別是實(shí)時(shí)直播節(jié)目要求信號(hào)質(zhì)量比較好時(shí)具有更大的作用。 本論文利用校驗(yàn)位為奇數(shù)個(gè)的RS碼,對(duì)可檢不可糾的錯(cuò)誤發(fā)出報(bào)警信號(hào),通過其它方法替代原有信號(hào),對(duì)音質(zhì)影響不大,節(jié)省了糾正這個(gè)錯(cuò)誤的資源和開發(fā)成本。 同時(shí),我們采用FPGA硬件開發(fā)平臺(tái)和VHDL硬件描述語(yǔ)言編寫代碼實(shí)現(xiàn)硬件功能,而不采用專用芯片實(shí)現(xiàn)功能,使得修改電路和升級(jí)變得異常方便,大大提高了開發(fā)產(chǎn)品的效率,降低了成本。 經(jīng)過軟件仿真和硬件驗(yàn)證,本系統(tǒng)已經(jīng)基本實(shí)現(xiàn)了預(yù)想的功能,擴(kuò)展性較好,硬件資源開銷較小,具有實(shí)用價(jià)值。

    標(biāo)簽: FPGA DAB 信道 編碼器

    上傳時(shí)間: 2013-07-15

    上傳用戶:afeiafei309

  • 交織與解交織的算法研究及FPGA實(shí)現(xiàn)

    本文主要研究了數(shù)字聲音廣播系統(tǒng)(DAB)內(nèi)交織器與解交織器的算法及硬件實(shí)現(xiàn)方法。時(shí)間交織器與解交織器的硬件實(shí)現(xiàn)可以有幾種實(shí)現(xiàn)方案,本文對(duì)其性能進(jìn)行了分析比較,選擇了一種工程中實(shí)用的設(shè)計(jì)方案進(jìn)行設(shè)計(jì),并將設(shè)計(jì)結(jié)果以FPGA設(shè)計(jì)驗(yàn)證。時(shí)間解交織器的交織速度、電路面積、占用內(nèi)存、是設(shè)計(jì)中主要因素,文中采用了單口SRAM實(shí)現(xiàn),減少了對(duì)存儲(chǔ)器的使用,利用lC設(shè)計(jì)的優(yōu)化設(shè)計(jì)方法來(lái)改善電路的面積。硬件實(shí)現(xiàn)是采用工業(yè)EDA標(biāo)準(zhǔn)Top-to-Down設(shè)計(jì)思想來(lái)設(shè)計(jì)時(shí)間解交織,使用verilogHDL硬件描述語(yǔ)言來(lái)描述解交織器,用Cadence Nc-verilog進(jìn)行仿真,Debussy進(jìn)行debug,在Altera公司的FPGA開發(fā)板上進(jìn)行測(cè)試,然后用ASIC實(shí)現(xiàn)。測(cè)試結(jié)果證明:時(shí)間解交織器的輸出正確,實(shí)現(xiàn)速度較快,占用面積較小。

    標(biāo)簽: FPGA 算法研究

    上傳時(shí)間: 2013-04-24

    上傳用戶:梧桐

  • 可變點(diǎn)流水線結(jié)構(gòu)FFT處理器

    隨著電子技術(shù)和集成電路技術(shù)的飛速發(fā)展,數(shù)字信號(hào)處理已經(jīng)廣泛地應(yīng)用于通信、信號(hào)處理、生物醫(yī)學(xué)以及自動(dòng)控制等領(lǐng)域中。離散傅立葉變換(DFT)及其快速算法FFT作為數(shù)字信號(hào)處理中的基本變換,有著廣泛的應(yīng)用。特別是近年來(lái),基于FFT的ODFM技術(shù)的興起,進(jìn)一步推動(dòng)了對(duì)高速FFT處理器的研究。 FFT 算法從出現(xiàn)到現(xiàn)在已有四十多年代歷史,算法理論已經(jīng)趨于成熟,但是其具體實(shí)現(xiàn)方法卻值得研究。面向高速、大容量數(shù)據(jù)流的FFT實(shí)時(shí)處理,可以通過數(shù)據(jù)并行處理或者采用多級(jí)流水線結(jié)構(gòu)來(lái)實(shí)現(xiàn)。特別是流水線結(jié)構(gòu)使得FFT處理器在進(jìn)行不同點(diǎn)數(shù)的FFT計(jì)算時(shí)可以通過對(duì)模塊級(jí)數(shù)的控制很容易的實(shí)現(xiàn)。 本文在分析和比較了各種FFT算法后,選擇了基2和基4混合頻域抽取算法作為FFr處理器的實(shí)現(xiàn)算法,并提出了一種高速、處理點(diǎn)數(shù)可變的流水線結(jié)構(gòu)FFT處理器的實(shí)現(xiàn)方法。利用這種方法實(shí)現(xiàn)的FFT處理器成功的應(yīng)用到DAB接收機(jī)中,RTL級(jí)仿真結(jié)果表明FFT輸出結(jié)果與C模型輸出一致,在FPGA環(huán)境下仿真波形正確,用Ouaaus Ⅱ軟件綜合的最高工作頻率達(dá)到133MHz,滿足了高速處理的設(shè)計(jì)要求。

    標(biāo)簽: FFT 流水線結(jié)構(gòu) 處理器

    上傳時(shí)間: 2013-05-29

    上傳用戶:GavinNeko

  • 數(shù)字音頻廣播中OFDM調(diào)制的研究與實(shí)現(xiàn)

    正交頻分復(fù)用(OFDM)是一種無(wú)線環(huán)境下的高速傳輸技術(shù),它使用一系列低速子載波并行傳輸數(shù)據(jù),具有抗多徑干擾的能力、能以很高的頻譜利用率實(shí)現(xiàn)高速數(shù)據(jù)傳輸?shù)葍?yōu)點(diǎn)。數(shù)字音頻廣播(DAB)系統(tǒng)中采用OFDM調(diào)制技術(shù)。 本文首先概述了OF'DM的基本原理和實(shí)現(xiàn)方法,分析了DAB中不同模式下OFDM調(diào)制的參數(shù)和特點(diǎn)。實(shí)現(xiàn)OFDM的核心技術(shù)是快速傅立葉變換(FFT)。本文在分析研究了多種FFT算法的基礎(chǔ)上選擇了最適合FPGA實(shí)現(xiàn)的,滿足DAB系統(tǒng)中OFDM調(diào)制要求的FFT算法,即將2048點(diǎn)FFT分解為基-4和基-2混合基算法。 本文研究重點(diǎn)是使用FPGA實(shí)現(xiàn)2048點(diǎn)復(fù)數(shù)FFT處理器。2048點(diǎn)FFT由五級(jí)基-4運(yùn)算和一級(jí)基-2運(yùn)算組成。針對(duì)這一算法以及FPGA特點(diǎn),進(jìn)行系統(tǒng)結(jié)構(gòu)設(shè)計(jì)、各個(gè)模塊設(shè)計(jì)、FPGA實(shí)現(xiàn)和測(cè)試。一個(gè)基-4和基-2復(fù)用的蝶形運(yùn)算模塊是整個(gè)FFT處理器的核心部分。此外系統(tǒng)還包括:系統(tǒng)控制模塊,地址產(chǎn)生模塊,RAM和ROM。本文特別針對(duì)2048點(diǎn)按頻率抽取基-4/2順序處理的FFT處理器提出了一種巧妙的數(shù)據(jù)地址和旋轉(zhuǎn)因子地址生成的方法。 仿真和驗(yàn)證表明,運(yùn)算的結(jié)果可以達(dá)到一定的精度要求,運(yùn)算速度滿足系統(tǒng)要求,說(shuō)明該OFDM調(diào)制器的設(shè)計(jì)是可行的,可以應(yīng)用于DAB系統(tǒng)中

    標(biāo)簽: OFDM 數(shù)字音頻廣播 調(diào)制

    上傳時(shí)間: 2013-06-05

    上傳用戶:star_in_rain

  • 自己寫的小程序

    自己寫的小程序,包括了DAB系統(tǒng)各部分的波形及功率譜圖

    標(biāo)簽: 程序

    上傳時(shí)間: 2014-01-18

    上傳用戶:zhaoq123

  • viterbi 約束長(zhǎng)度為7的仿真

    viterbi 約束長(zhǎng)度為7的仿真,適用于DAB等卷積編碼譯碼的仿真

    標(biāo)簽: viterbi 長(zhǎng)度 仿真

    上傳時(shí)間: 2016-09-19

    上傳用戶:change0329

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