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DCDC集成快充芯片

  • 電路設計中電源芯片LDO還是DCDC的區別

    該文檔為電路設計中電源芯片LDO還是DCDC的區別總結文檔,是一份不錯的參考資料,感興趣的可以下載看看,,,,,,,,,,,,,,,,,

    標簽: 電路設計

    上傳時間: 2022-07-26

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  • 永磁無刷直流電機及其驅動系統的設計.rar

    風機的耗電量占全國總發電量的40﹪左右,是全國耗電最大的工業裝備,而且運行效率比國外低10﹪~30﹪。因此在風機(及水泵)上實行節能、節電、降耗是一個緊迫的任務,對緩解我國電能的供需矛盾、推進我國現代化建設、縮小我國和發達國家的差距具有非常現實和深遠的意義。 小型風機(1~10千瓦)特點是:單臺的耗電量很小,但是數量巨大,因此降低這些小型風機的耗電量同樣具有十分深遠的經濟意義。但在這一領域的節能研究一直未能得到充分重視。 本論文提出一種用于驅動小功率風機的永磁無刷直流電機,通過調速調節風量從而達到節能的目的。永磁無刷直流電機是近年隨著電力電子技術和永磁材料的進步而迅速發展起來的一種新型電機。它用一套電子換向裝置代替了有刷直流電動機的機械換向裝置,即克服了有刷直流電動機機械換向帶來的一系列缺點,又具備直流電動機運行效率高、無勵磁損耗以及調速性能好等諸多特點,因此在各個領域中得到了廣泛應用。 本論文從永磁材料、磁體結構、充磁方式、繞組分布、極弧系數等方面分析了風機外轉子永磁無刷直流電機的設計要求,給出永磁無刷直流電機結構、原理及一般設計要求;根據風機電機的驅動要求,設計制造外轉子風機用鐵氧體永磁無刷直流電機樣機;針對風機用電機驅動系統的調速及各種保護要求,基于降低成本的原則,設計制造永磁無刷直流電機的驅動系統。這一設計為基于專用集成芯片的小功率無刷直流電機的調速控制系統,并進行了試制、調試及試驗。實驗表明了系統具有簡單和優越的控制性能,適于小功率無刷直流電機的控制。 樣機實測數據表明外轉子永磁無刷直流電機用于驅動小功率風機具有良好的性能、較低的成本,具有進行產業化生產的優勢。

    標簽: 無刷直流電機 驅動系統

    上傳時間: 2013-04-24

    上傳用戶:sunzhp

  • 基于DSP的永磁同步電機伺服系統的研究.rar

    伺服系統是一種輸出能夠快速而精確地響應外部的輸入指令信號的控制系統。伺服系統在工業控制和家用電氣、航空航天等領域的應用越來越廣泛。現代工業生產對伺服設備的性能也提出了越來越高的要求。因此,研制高性能、高可靠性的交流伺服系統有著十分重要的現實意義。 在伺服領域,永磁同步電機在結構特點和運行方式上具有比其它類型的傳統伺服電機更為優秀的運行性能和更廣泛的適用范圍,被越來越多的應用到交流伺服系統。以數字信號處理技術為基礎、以永磁同步電機為執行電機,采用高性能控制策略的全數字化永磁同步交流伺服控制系統必將成為伺服控制系統發展的趨勢。 本論文在研究永磁同步電動機運行原理的基礎上,詳細討論了磁場定向矢量控制理論,確定了id=0的控制策略和空間矢量脈寬調制(SVPWM)的電壓調制方法。本文采用TI公司生產的專門用于電機控制的數字信號控制芯片DSP(TMS320LF2407A)作為控制系統核心處理芯片,設計了一套基于DSP的全數字永磁同步電動機伺服控制系統。論文詳細論述了控制電路各部分及外圍輔助電路的設計和調試,包括功率驅動電路,供電電路與電源電路以及傳感器電路等等。軟件開發均在TI的CCStudl02.2集成開發環境下完成,軟件采用匯編語言編寫,完成了主程序模塊和子程序模塊設計,實現了電流A/D采樣、模型切換、轉速PI調節等功能,實現了位置、速度和電流雙閉環矢量控制,同時給出了主程序和各個子程序模塊的流程圖。 實驗結果表明,基于DSP實現的全數字化交流伺服系統具有響應速度快、速度超調小、轉矩脈動小等特點,具有良好的動靜態特性以及較高的精度。基本達到了課題預期的效果,從而證明了系統設計的可行性。

    標簽: DSP 永磁同步電機 伺服系統

    上傳時間: 2013-05-18

    上傳用戶:bpbao2016

  • 基于FPGA的多功能電子測量系統的研究與實現.rar

    隨著計算機和微電子技術的飛速發展,基于數字信號處理的示波器、信號發生器、邏輯分析儀和頻譜分析儀等測量儀器已經應用到各個領域并且發揮著重要作用,但這些儀器昂貴的價格阻礙了它們的普遍使用。 本文針對電子測量儀器技術發展和普及的情況,結合用FPGA實現數字信號處理的優勢,研究一種基于FPGA的輔助性獨立電予測量儀器的軟件系統。這種儀器可以作為數模混合電路測試和驗證的工具,用來觀察模擬信號波形、數字信號時序波形、模擬信號的幅度頻譜,也可以用來產生DDS信號。在硬件選擇上,使用具有Altera公司CycloneⅡ器件的平臺來實現單片DSP系統,這種芯片成本低廉、工作速度快、技術兼容性好;在軟件設計上,采用基于FPGA的可編程數字邏輯設計方法,這種方法具有開發難度小、功能擴展簡單等優點。設計中采用的關鍵技術包括:基于FPGA和IP Core的Verilog HDL設計、數據采集、數據存儲、數據處理以及數據波形的實時顯示。對這些技術的研究探討不僅有理論研究價值,在科學實驗和產品設計中同樣具有重要的實用價值。系統的設計以低資源、高性能為目標,設計中采用了科學的模塊劃分、設計與集成的方法,在保持原四種信號處理功能不變的前提下,盡量多的節約各種FPGA資源,為實現低成本的輔助電子測量儀器提供了可能。

    標簽: FPGA 多功能電子 測量系統

    上傳時間: 2013-06-05

    上傳用戶:love_stanford

  • 基于LabVIEW和SOPC的智能型函數發生器的研究與設計.rar

    函數發生器又名任意波形發生器,是一種常用的信號源,廣泛應用于通信、雷達、導航等現代電子技術領域。信號發生器的核心技術是頻率合成技術,主要方法有:直接模擬頻率合成、鎖相環頻率合成(PLL)、直接數字合成技術(DDS)。DDS是開環系統,無反饋環節,輸出響應速度快,頻率穩定度高。因此直接數字頻率合成技術是目前頻率合成的主要技術之一,其輸出信號具有相對較大的帶寬、快速的相位捷變、極高的相位分辨率和相位連續等優點。本文的主要工作是采用SOPC結合虛擬儀器技術,進行DDS智能函數發生器的研制。 本文介紹了虛擬儀器技術的基本理論,簡要闡述了儀器驅動程序、VISA等相關技術。對SOPC技術進行了深入的研究:SOPC技術是基于可編程邏輯器件的可重構片上系統,它作為SOC和CPLD/FPGA相結合的一項綜合技術,結合了兩者的優點,集成了硬核或軟核CPU、DSP、鎖相環、存儲器、I/O接口及可編程邏輯,可以靈活高效地解決SOC方案,而且設計周期短,設計成本低,非常適合本設計的應用。本文還對基于DDS原理的設計方案進行了分析,介紹了DDS的基本理論以及數學綜合,在研究DDS原理的基礎上,利用SOPC技術,在一片FPGA芯片上實現了整個函數發生器的硬件集成。 本文就函數發生器的設計制定了整體方案,對軟硬件設計原理及實現方法進行了具體的介紹,包括整個系統的硬件電路,SOPC片上系統和PC端軟件的設計。在設計中,LabVIEW波形編輯軟件和函數發生器二者采用異步串口進行通信。利用LabVIEW的強大功能,把波形的編輯,系統的設置放到計算機上完 成,具有人機界面友好、系統升級方便、節約硬件成本等諸多優勢。同時充分利用了FPGA內部大量的邏輯資源,將DDS模塊和微處理器模塊集成到一個單片FPGA上,改變了傳統的系統設計思路。通過對系統仿真和實際測試,結果表明該智能型函數發生器不僅能產生理想的輸出信號,還具有集成度高、穩定性好和擴展性強等優點。關鍵詞:智能型函數發生器,虛擬儀器,可編程片上系統,直接數字合成技術,NiosⅡ處理器。

    標簽: LabVIEW SOPC 智能型

    上傳時間: 2013-07-09

    上傳用戶:zw380105939

  • 基于嵌入式藍牙技術的無線音頻傳輸的設計與實現.rar

    藍牙(Bluetooth)技術是近年來國外先進國家研究發展最快的短程無線通信技術之一,能夠廣泛地應用于工業短距離無線控制裝置、近距離移動無線控制設備、機器人控制、辦公自動化及多媒體娛樂設備等局部范圍內無線數據傳輸的領域中。在我國,由于對藍牙技術的研究還處于研究開發的初級階段, 還沒有形成藍牙數據短距離無線通信的一套開放性應用標準。 在無線音頻傳輸領域內,傳統的基于模擬調制方式的無線音頻傳輸由于抗干擾能力較差,傳輸的音頻質量會受到較大的影響,而國內市場上的藍牙音頻產品僅支持單聲道語音傳輸。所以,對基于藍牙技術的高品質多通道音頻傳輸技術的研究將具有一定的技術創新性,在無線音頻傳輸領域也具有較為廣闊的市場前景。 本文以嵌入式藍牙技術與音頻信號傳輸系統為研究開發課題,參考國外藍牙技術協議標準,利用功能模塊單元與嵌入式技術,目標是研制一種基于嵌入式開發應用的高品質雙聲道藍牙無線音頻傳輸系統。本系統通過對雙聲道線性模擬音源的數字化MP3編解碼處理,結合基于嵌入式應用的簡化后的HCI層藍牙應用協議,實現了藍牙信道帶寬內的高品質雙聲道音頻信號點對點的傳輸。 在硬件設計上,系統采用了模塊化設計思想。發送端和接收端由音頻處理模塊、控制傳輸模塊和無線模塊三部分構成。其中,音頻處理模塊以MAS3587音頻處理芯片為核心,負責音頻信號的AD采樣、MP3壓縮和解壓縮以及DA還原等工作;控制傳輸模塊以MSP430F169為核心,負責MP3數據幀的高速傳輸以及藍牙接口協議控制;無線模塊采用藍牙單芯片解決方案(集成藍牙射頻、基帶和鏈路管理等),負責MP3數據幀的射頻發送和接收。模塊與模塊之間采用工業標準接口方式連接。音頻處理模塊和控制傳輸模塊之間采用DMA方式的通用并口(PIO);控制傳輸模塊與藍牙模塊之間采用DMA方式的通用異步串口(UART)。 在軟件設計上,系統主要由藍牙協議解釋、傳輸控制和芯片驅動三部分構成。在藍牙協議解釋上,系統采用了基于HCI層的ACL數據包透明傳輸方式;在傳輸控制上,采用了基于通用并口(PIO)和異步串口(UART)的DMA方式高效率批量數據傳輸技術;芯片驅動主要指對MAS3587的基本配置。 對目標系統的測試實驗采用了目前流行的音頻測試虛擬儀器軟件Adobe Audition 1.5。實驗項目包括掃頻測試、音樂測試、聽覺測試、距離測試以及抗干擾測試等。實驗結果表明,輸入音源在經過MP3編碼、發射、接收及MP3解碼后,音頻質量基本上沒受影響,實際雙聲道音質接近于CD音質,而無線傳輸的可靠性遠高于模擬無線音頻傳輸,幾乎沒有斷音與錯音,充分體現了嵌入式藍牙無線技術的優勢。

    標簽: 嵌入式 傳輸 藍牙技術

    上傳時間: 2013-05-27

    上傳用戶:稀世之寶039

  • SATA2.0硬盤加解密接口芯片數據通路的設計與FPGA實現.rar

    SATA接口是新一代的硬盤串行接口標準,和以往的并行硬盤接口比較它具有支持熱插拔、傳輸速率快、執行效率高的明顯優勢。SATA2.0是SATA的第二代標準,它規定在數據線上使用LVDS NRZ串行數據流傳輸數據,速率可達3Gb/s。另外,SATA2.0還具有支持NCQ(本地命令隊列)、端口復用器、交錯啟動等一系列技術特征。正是由于以上的種種技術優點,SATA硬盤業已被廣泛的使用于各種企業級和個人用戶。 硬盤作為主要的信息載體之一,其信息安全問題尤其引起人們的關注。由于在加密時需要實時處理大量的數據,所以對硬盤數據的加密主要使用帶有密鑰的硬件加密的方式。因此將硬盤加密和SATA接口結合起來進行設計和研究,完成基于SATA2.0接口的加解密芯片系統設計具有重要的使用價值和研究價值。 本論文首先介紹了SATA2.0的總線協議,其協議體系結構包括物理層、鏈路層、傳輸層和命令層,并對系統設計中各個層次中涉及的關鍵問題進行了闡述。其次,本論文對ATA協議和命令進行了詳細的解釋和分析,并針對設計中涉及的命令和對其做出的修改進行了說明。接著,本論文對SATA2.0加解密控制芯片的系統設計進行了講解,包括硬件平臺搭建和器件選型、模塊和功能劃分、系統工作原理等,剖析了系統設計中的難點問題并給出解決問題的方法。然后,對系統數據通路的各個模塊的設計和實現進行詳盡的闡述,并給出各個模塊的驗證結果。最后,本文簡要的介紹了驗證平臺搭建和測試環境、測試方法等問題,并分析測試結果。 本SATA2.0硬盤加解密接口電路在Xilinx公司的Virtex5 XC5VLX50T FPGA上進行測試,目前工作正常,性能良好,已經達到項目性能指標要求。本論文在SATA加解密控制芯片設計與實現方面的研究成果,具有通用性、可移植性,有一定的理論及經濟價值。

    標簽: SATA FPGA 2.0

    上傳時間: 2013-04-24

    上傳用戶:JIUSHICHEN

  • SATA協議分析及其FPGA實現.rar

    并行總線PATA從設計至今已快20年歷史,如今它的缺陷已經嚴重阻礙了系統性能的進一步提高,已被串行ATA(Serial ATA)即SATA總線所取代。SATA作為新一代磁盤接口總線,采用點對點方式進行數據傳輸,內置數據/命令校驗單元,支持熱插拔,具有150MB/s(SATA1.0)或300MB/s(SATA2.0)的傳輸速度。目前SATA已在存儲領域廣泛應用,但國內尚無獨立研發的面向FPGA的SATAIP CORE,在這樣的條件下設計面向FPGA應用的SATA IP CORE具有重要的意義。 本論文對協議進行了詳細的分析,建立了SATA IP CORE的層次結構,將設備端SATA IP CORE劃分成應用層、傳輸層、鏈路層和物理層;介紹了實現該IPCORE所選擇的開發工具、開發語言和所選用的芯片;在此基礎上著重闡述協議IP CORE的設計,并對各個部分的設計予以分別闡述,并編碼實現;最后進行綜合和測試。 采用FPGA集成硬核RocketIo MGT(RocketIo Multi-Gigabit Transceiver)實現了1.5Gbps的串行傳輸鏈路;設計滿足協議需求、適合FPGA設計的并行結構,實現了多狀態機的協同工作:在高速設計中,使用了流水線方法進行并行設計,以提高速度,考慮到系統不同部分復雜度的不同,設計采用部分流水線結構;采用在線邏輯分析儀Chipscope pro與SATA總線分析儀進行片上調試與測試,使得調試工作方便快捷、測試數據準確;嚴格按照SATA1.0a協議實現了SATA設備端IP CORE的設計。 最終測試數據表明,本論文設計的基于FPGA的SATA IP CORE滿足協議需求。設計中的SATA IP CORE具有使用方便、集成度高、成本低等優點,在固態電子硬盤SSD(Solid-State Disk)開發中應用本設計,將使開發變得方便快捷,更能夠適應市場需求。

    標簽: SATA FPGA 協議分析

    上傳時間: 2013-06-21

    上傳用戶:xzt

  • MDIO接口邏輯設計及其FPGA驗證.rar

    隨著集成電路技術的飛速發展,芯片的規模越來越大,集成度越來越高,工作頻率越來越快,但是芯片的設計能力卻面臨巨大的挑戰。而IP核的重用則是解決當今芯片設計所面臨問題的最有效的解決方法。 MDIO接口模塊為以太網接口芯片中MAC層對PHY器件的控制管理接口。隨著以太網技術的快速發展以及MAC應用越來越廣泛,MDIO接口模塊的應用也越來越多,因此將MDIO接口模塊設計成可重用的IP核對于以各種太網接口集成芯片的設計具有很重要的作用。 本文詳細描述了MDIO接口模塊IP核的設計,介紹了該IP核的系統結構以及各個子模塊的詳細設計方法,對此IP核進行了仿真驗證,最后進行了FPGA測試,功能和性能達到了要求,最終通過了IP審核流程并且已成功應用于企業的以太網接口芯片中。

    標簽: MDIO FPGA 接口

    上傳時間: 2013-06-20

    上傳用戶:lishuoshi1996

  • 開關型單兩節鋰離子鋰聚合物充電管理芯片

    HT6298A 為開關型單節或兩節鋰離子/鋰聚合物電池充電管理芯片,非常適合于便攜式設備的充電管理應用。HT6298A 集內置功率MOSFET、高精度電壓和電流調節器、預充、充電狀態指示和充電截止等功

    標簽: 開關 充電管理芯片 鋰離子 鋰聚合物

    上傳時間: 2013-06-22

    上傳用戶:417313137

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