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MDIO

  • MDIO接口邏輯設(shè)計(jì)及其FPGA驗(yàn)證.rar

    隨著集成電路技術(shù)的飛速發(fā)展,芯片的規(guī)模越來越大,集成度越來越高,工作頻率越來越快,但是芯片的設(shè)計(jì)能力卻面臨巨大的挑戰(zhàn)。而IP核的重用則是解決當(dāng)今芯片設(shè)計(jì)所面臨問題的最有效的解決方法。 MDIO接口模塊為以太網(wǎng)接口芯片中MAC層對(duì)PHY器件的控制管理接口。隨著以太網(wǎng)技術(shù)的快速發(fā)展以及MAC應(yīng)用越來越廣泛,MDIO接口模塊的應(yīng)用也越來越多,因此將MDIO接口模塊設(shè)計(jì)成可重用的IP核對(duì)于以各種太網(wǎng)接口集成芯片的設(shè)計(jì)具有很重要的作用。 本文詳細(xì)描述了MDIO接口模塊IP核的設(shè)計(jì),介紹了該IP核的系統(tǒng)結(jié)構(gòu)以及各個(gè)子模塊的詳細(xì)設(shè)計(jì)方法,對(duì)此IP核進(jìn)行了仿真驗(yàn)證,最后進(jìn)行了FPGA測試,功能和性能達(dá)到了要求,最終通過了IP審核流程并且已成功應(yīng)用于企業(yè)的以太網(wǎng)接口芯片中。

    標(biāo)簽: MDIO FPGA 接口

    上傳時(shí)間: 2013-06-20

    上傳用戶:lishuoshi1996

  • MDIO接口邏輯設(shè)計(jì)及其FPGA驗(yàn)證

    隨著集成電路技術(shù)的飛速發(fā)展,芯片的規(guī)模越來越大,集成度越來越高,工作頻率越來越快,但是芯片的設(shè)計(jì)能力卻面臨巨大的挑戰(zhàn)。而IP核的重用則是解決當(dāng)今芯片設(shè)計(jì)所面臨問題的最有效的解決方法。 MDIO接口模塊為以太網(wǎng)接口芯片中MAC層對(duì)PHY器件的控制管理接口。隨著以太網(wǎng)技術(shù)的快速發(fā)展以及MAC應(yīng)用越來越廣泛,MDIO接口模塊的應(yīng)用也越來越多,因此將MDIO接口模塊設(shè)計(jì)成可重用的IP核對(duì)于以各種太網(wǎng)接口集成芯片的設(shè)計(jì)具有很重要的作用。 本文詳細(xì)描述了MDIO接口模塊IP核的設(shè)計(jì),介紹了該IP核的系統(tǒng)結(jié)構(gòu)以及各個(gè)子模塊的詳細(xì)設(shè)計(jì)方法,對(duì)此IP核進(jìn)行了仿真驗(yàn)證,最后進(jìn)行了FPGA測試,功能和性能達(dá)到了要求,最終通過了IP審核流程并且已成功應(yīng)用于企業(yè)的以太網(wǎng)接口芯片中。

    標(biāo)簽: MDIO FPGA 接口 邏輯設(shè)計(jì)

    上傳時(shí)間: 2013-07-20

    上傳用戶:nanfeicui

  • SEED-VPM642的以太網(wǎng)接口的測試。主要是測試EMAC 與MDIO 的配置及使用

    SEED-VPM642的以太網(wǎng)接口的測試。主要是測試EMAC 與MDIO 的配置及使用,以及如何設(shè)置一個(gè)PHY設(shè)備和CSL 庫中關(guān)于網(wǎng)絡(luò)接口部分程序的應(yīng)用。在此測試過程中,采用自閉環(huán)的方式完成的。

    標(biāo)簽: SEED-VPM EMAC MDIO 642

    上傳時(shí)間: 2017-01-07

    上傳用戶:愛死愛死

  • 目前以太網(wǎng)PHY芯片是通過總線MDC/MDIO

    目前以太網(wǎng)PHY芯片是通過總線MDC/MDIO,但是基本上是通過MAC芯片直接管理的,本代碼實(shí)現(xiàn)了通過FPGA管理PHY。即由FPGA完成MII管理

    標(biāo)簽: MDIO PHY MDC 以太網(wǎng)

    上傳時(shí)間: 2017-04-15

    上傳用戶:yuzsu

  • MDIO Verilog RTL代碼,SOC可以通過MDIO接口來訪問外部PHY等慢速外設(shè)

    MDIO Verilog RTL代碼,SOC可以通過MDIO接口來訪問外部PHY等慢速外設(shè)

    標(biāo)簽: verilog soc 接口

    上傳時(shí)間: 2022-06-26

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  • XAPP1042-利用GPIO實(shí)現(xiàn)以太網(wǎng)PHY寄存器訪問

    The XPS Ethernetlite peripheral does not provide any mechanism to access the Ethernet PHYregisters. These registers are used to configure auto negotiation parameters and to obtain PHYstatus. This application note provides reference systems and associated software to accessPHY registers by connecting the serial management bus signals MDC and MDIO to GPIOswhich the software controls directly.

    標(biāo)簽: XAPP 1042 GPIO PHY

    上傳時(shí)間: 2013-10-17

    上傳用戶:JamesB

  • XAPP807-封裝最小的三態(tài)以太網(wǎng)MAC處理引擎

    The Tri-Mode Ethernet MAC (TEMAC) UltraController-II module is a minimal footprint,embedded network processing engine based on the PowerPC™ 405 (PPC405) processor coreand the TEMAC core embedded within a Virtex™-4 FX Platform FPGA. The TEMACUltraController-II module connects to an external PHY through Gigabit Media IndependentInterface (GMII) and Management Data Input/Output (MDIO) interfaces and supports tri-mode(10/100/1000 Mb/s) Ethernet. Software running from the processor cache reads and writesthrough an On-Chip Memory (OCM) interface to two FIFOs that act as buffers between thedifferent clock domains of the PPC405 OCM and the TEMAC.

    標(biāo)簽: XAPP 807 MAC 封裝

    上傳時(shí)間: 2013-10-26

    上傳用戶:yuzsu

  • 基于51類單片機(jī)RTX51多任務(wù)系統(tǒng)

    基于51類單片機(jī)RTX51多任務(wù)系統(tǒng),通過串口發(fā)送控制命令,模擬實(shí)現(xiàn)i2c及MDIO口功能。(C語言)

    標(biāo)簽: RTX 51 單片機(jī) 多任務(wù)系統(tǒng)

    上傳時(shí)間: 2014-01-27

    上傳用戶:haohaoxuexi

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