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DQPSk

  • 一個(gè)DQPSk信號(hào)接收與發(fā)送部分的軟硬件設(shè)計(jì)。其中IF=70MHZ

    一個(gè)DQPSk信號(hào)接收與發(fā)送部分的軟硬件設(shè)計(jì)。其中IF=70MHZ,信息速率=10MBS,采用帶通信號(hào)采樣技術(shù),數(shù)字正交解調(diào)和調(diào)制技術(shù)。NCO頻率分辨率為32位,相位分辨率為10位

    標(biāo)簽: DQPSk MHZ 70 IF

    上傳時(shí)間: 2013-12-14

    上傳用戶:aix008

  • 實(shí)現(xiàn)π/4-DQPSk調(diào)制的一種快速算法.針對(duì)rd4.DQPSk調(diào)制數(shù)字化實(shí)現(xiàn)的運(yùn)算量大、高速調(diào)制難的問(wèn)題

    實(shí)現(xiàn)π/4-DQPSk調(diào)制的一種快速算法.針對(duì)rd4.DQPSk調(diào)制數(shù)字化實(shí)現(xiàn)的運(yùn)算量大、高速調(diào)制難的問(wèn)題,提出了一種適合于數(shù)字調(diào)制的 快速算法

    標(biāo)簽: DQPSk 調(diào)制 rd4 快速算法

    上傳時(shí)間: 2013-12-22

    上傳用戶:jjj0202

  • 實(shí)現(xiàn)DQPSk信號(hào)調(diào)制解調(diào)功能

    實(shí)現(xiàn)DQPSk信號(hào)調(diào)制解調(diào)功能,并給出了詳細(xì)的matlab仿真結(jié)果

    標(biāo)簽: DQPSk 信號(hào)調(diào)制 解調(diào)

    上傳時(shí)間: 2016-06-05

    上傳用戶:希醬大魔王

  • 詳細(xì)說(shuō)明了pi/4 DQPSk 調(diào)制、解調(diào)

    詳細(xì)說(shuō)明了pi/4 DQPSk 調(diào)制、解調(diào),RRC 匹配濾波器設(shè)計(jì), BER 蒙特卡洛仿真,rayleigh衰落下的系統(tǒng)仿真。 文檔中附有各個(gè)模塊的Matlab code。

    標(biāo)簽: DQPSk pi 調(diào)制 解調(diào)

    上傳時(shí)間: 2016-10-24

    上傳用戶:dengzb84

  • 基于TMS320C54x 實(shí)現(xiàn)πP4- DQPSk 調(diào)制 信息產(chǎn)業(yè)部電子第十研究所

    基于TMS320C54x 實(shí)現(xiàn)πP4- DQPSk 調(diào)制 信息產(chǎn)業(yè)部電子第十研究所

    標(biāo)簽: DQPSk 320C TMS 320

    上傳時(shí)間: 2013-12-03

    上傳用戶:dongqiangqiang

  • 基于MATLAB的理想π/4 - DQPSk系統(tǒng)仿真 --西安空間無(wú)線電技術(shù)研究所

    基于MATLAB的理想π/4 - DQPSk系統(tǒng)仿真 --西安空間無(wú)線電技術(shù)研究所

    標(biāo)簽: MATLAB DQPSk 系統(tǒng)仿真 無(wú)線電技術(shù)

    上傳時(shí)間: 2017-05-16

    上傳用戶:wfl_yy

  • 采用FPGA 實(shí)現(xiàn)π/ 4 DQPSk調(diào)制器-- 北 方 交 通 大 學(xué) 學(xué) 報(bào)

    采用FPGA 實(shí)現(xiàn)π/ 4 DQPSk調(diào)制器-- 北 方 交 通 大 學(xué) 學(xué) 報(bào)

    標(biāo)簽: DQPSk FPGA 調(diào)制器

    上傳時(shí)間: 2014-12-03

    上傳用戶:ruan2570406

  • DQPSk調(diào)制過(guò)程 解調(diào)過(guò)程 系統(tǒng)誤碼率 matlab程序

    DQPSk調(diào)制過(guò)程 解調(diào)過(guò)程 系統(tǒng)誤碼率 matlab程序

    標(biāo)簽: matlab DQPSk 過(guò)程 調(diào)制

    上傳時(shí)間: 2014-11-28

    上傳用戶:chongcongying

  • 基于FPGA的多速率調(diào)制解調(diào)器的實(shí)現(xiàn).rar

    隨著人們對(duì)于高速無(wú)線數(shù)據(jù)業(yè)務(wù)的急切需求以及新的無(wú)線通信技術(shù)的發(fā)展,頻譜資源匱乏問(wèn)題日益嚴(yán)重。無(wú)線頻譜的緊缺已經(jīng)成為限制無(wú)線通信與服務(wù)應(yīng)用持續(xù)發(fā)展的瓶頸。認(rèn)知無(wú)線電技術(shù)(Cognitive Radio)改變了傳統(tǒng)的固定頻譜分配方式,它以頻譜利用的高效性為目標(biāo),允許非授權(quán)用戶擇機(jī)利用授權(quán)用戶的頻譜空洞傳輸數(shù)據(jù),以此來(lái)解決無(wú)線頻譜資源短缺的問(wèn)題。它是具有自主尋找和使用空閑頻譜資源能力的智能無(wú)線電技術(shù)。本文的目標(biāo)是在基于FPGA+DSP的系統(tǒng)硬件平臺(tái)上,以軟件編程的方式實(shí)現(xiàn)認(rèn)知無(wú)線電數(shù)據(jù)傳輸?shù)墓δ堋?軟件無(wú)線電是實(shí)現(xiàn)認(rèn)知無(wú)線電的理想平臺(tái)。本文首先闡述了軟件無(wú)線電的基本工作原理及關(guān)鍵技術(shù)途徑,對(duì)多速率信號(hào)處理中的內(nèi)插和抽取、帶通采樣、數(shù)字下變頻、濾波等技術(shù)進(jìn)行了分析與探討,為設(shè)計(jì)多速率調(diào)制解調(diào)系統(tǒng)提供了理論基礎(chǔ)。然后針對(duì)軟件無(wú)線電的要求給出了基于FPFA+DSP的系統(tǒng)設(shè)計(jì)硬件框圖,并對(duì)其中的部分硬件(FPGA、AD9857、AD9235)做了簡(jiǎn)要的描述并給出其初始化過(guò)程。在理解基本概念和原理的基礎(chǔ)上,詳細(xì)論述了在系統(tǒng)硬件設(shè)計(jì)平臺(tái)上實(shí)現(xiàn)的π/4-DQPSk、8PSK、16QAM調(diào)制解調(diào)技術(shù)。本文給出了調(diào)制解調(diào)系統(tǒng)實(shí)現(xiàn)方案中的各個(gè)功能模塊(差分編、解碼,加同步頭、內(nèi)插和成形濾波,下變頻,系統(tǒng)同步等)具體的設(shè)計(jì)方案和通過(guò)硬件編程實(shí)現(xiàn)了板級(jí)的仿真和最后的硬件實(shí)現(xiàn),并對(duì)其中得到的數(shù)據(jù)進(jìn)行分析,進(jìn)一步驗(yàn)證方案的可行性。最后介紹了通信板同頻譜感知板協(xié)同工作原理,依據(jù)頻譜感知板獲取的各個(gè)信道狀況自適應(yīng)的選擇π/4-DQPSk、8PSK、16QAM調(diào)制解調(diào)方式并在FPGA上實(shí)現(xiàn)了其中部分功能。

    標(biāo)簽: FPGA 多速率 調(diào)制解調(diào)器

    上傳時(shí)間: 2013-05-30

    上傳用戶:fywz

  • 基于FPGA的π4DQPSk全數(shù)字中頻發(fā)射機(jī)和接收機(jī)的實(shí)現(xiàn).rar

    本文以電子不停車收費(fèi)系統(tǒng)課題為背景,設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的π/4-DOPSK全數(shù)字中頻發(fā)射機(jī)和接收機(jī)。π/4-DQPSk廣泛應(yīng)用于移動(dòng)通信和衛(wèi)星通信中,具有頻帶利用率高、頻譜特性好、抗衰落性能強(qiáng)的特點(diǎn)。 近年來(lái)現(xiàn)場(chǎng)可編程門陣列(FPGA)器件在芯片邏輯規(guī)模和處理速度等方面性能的迅速提高,用硬件編程實(shí)現(xiàn)無(wú)線功能的軟件無(wú)線電技術(shù)在理論和實(shí)用化上都趨于成熟和完善,因此可以把數(shù)字調(diào)制,數(shù)字上/下變頻,數(shù)字解調(diào)在同一塊FPGA上實(shí)現(xiàn),即實(shí)現(xiàn)了中頻發(fā)射機(jī)和接收機(jī)一體化的片上可編程系統(tǒng)(SOPC,System On Programmabie Chip)。 本文首先根據(jù)指標(biāo)要求對(duì)數(shù)字收發(fā)機(jī)方案進(jìn)行設(shè)計(jì),確定了適合不停車收費(fèi)系統(tǒng)的全數(shù)字發(fā)射機(jī)和接收機(jī)的結(jié)構(gòu),接著根據(jù)π/4-DQPSk發(fā)射機(jī)和接收機(jī)的理論,設(shè)計(jì)并實(shí)現(xiàn)了基于FPGA的成形濾波器SRRC、半帶濾波器HB和定時(shí)算法并給出性能分析,最后給出硬件測(cè)試平臺(tái)上結(jié)果和測(cè)試結(jié)果分析。

    標(biāo)簽: 4DQPSk FPGA 全數(shù)字

    上傳時(shí)間: 2013-06-23

    上傳用戶:chuckbassboy

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